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주관 본센터 구분 설계강좌 / / 초급 / 이론+실습 마감
강의제목 Quartus II를 이용한 Altera FPGA 디자인
강의일자 2017-01-18 ~ 2017-01-19 신청기간 2016-12-22 ~ 2017-01-13
정원 33명 현재신청자 33명
수강료(일반) 무료 수강료(학생) 무료
수강대상 FPGA 디자인에 관심있는 분
사전지식
선수과목
Digital 공학, 전자 회로

[강좌 목표]

FPGA 이해와 Design 방법

 

[강좌 개요]

본 "ALTERA Quartus II를 이용한 Altera FPGA 디자인” 과목은 FPGA설계 경험은 없으나 향후 FPGA를 사용하여 설계할 계획이 있거나, FPGA 설계에 대해 관심이 있는 사람을 대상으로 하는 기초 교육 과정입니다. 본 강의는 이틀에 걸쳐 이루어지는데 이론과 실습을 병행하여 진행함으로써 본 과정을 이수한 사람으로 하여금 ALTERA FPGA디바이스의 구조와 FPGA를 사용한 설계에 대한 기본 개념을 파악하도록 하는데 그 목적이 있습니다. 이론 강의의 내용으로는 ALTERA의 Stratix series, Cyclone Series, MAX series 디바이스의 구조 및 특징에 대한 설명과 ALTERA의 설계 툴인 Quartus II 등의 소프트웨어, 디바이스 제품군 소개 그리고 설계용 언어인 HDL또는 Schematic 을 이용한 디자인으로 그 내용이 구성이 되어 있습니다. 실습 강의는 비교적 간단한 회로를 예제로 실제 Quartus II 소프트웨어를 사용하여 구현해 봄으로써 ALTERA FPGA설계의 기본 개념을 파악할 수 있도록 구성되어 있습니다.

 

[강의 장소]

KAIST N26동 1층 IDEC 실습실

강좌상세
일자2017-01-18 시간09:30 ~ 12:00 강사이재철 부장 AXIOS
내용○ Introduction
- Altera사 H/W 와 S/W 그리고 개발 환경 소개
- Design Flow와 Tool Licensing 방법 소개
- 질의 및 답변
○ Altera Device Family Architecture
- CPLD(MAX) 계열 및 FPGA(Stratix series /Cyclone series) 디바이스의 특성 및 구조 설명
- PLD configuration 회로 구성 및 programming 방법 설명
○ PLD 디바이스에 대한 질의 및 답변
일자2017-01-18 시간13:00 ~ 17:30 강사이재철 부장 AXIOS
내용○ Basic training of Quartus II (1)
- Quartus II를 이용한 전체 디자인 전개 과정 소개
- Schematic 편집기를 이용한 디지털 로직 설계 및 Quartus Project 생성
○ Quartus II에 대한 질의 및 답변
○ 실습: Quartus II를 이용한 Device Architecture 적용
일자2017-01-19 시간09:30 ~ 12:00 강사이재철 부장 AXIOS
내용○ Basic training of Quartus II (2)
- Quartus II 내부 컴파일러 및 시뮬레이션 툴 활용
- Timing Analyzer를 이용하여 설계된 회로의 타이밍 분석
- Floorplan Editor로 PLD 디바이스 내부의 구조 이해 및 회로 분석
- 설계한 회로의 성능 향상을 위한 다양한 옵션 소개 및 활용
- ALTERA 사에서 제공하는 내부 라이브러리들의 생성 및 사용 방법 소개 (Megafunction wizard)
- Quartus II에 대한 질의 및 답변
일자2017-01-19 시간13:00 ~ 17:30 강사이재철 부장 AXIOS
내용○ Basic training of Quartus II (3)
- SignalTap II를 이용한 Board Debugging
- 앞서 수행했던 과정과 활용법들을 이용하여 교재에서 나와 있는 예제를 직접 풀어봄으로써 실질적인 교육의 활용 능력을 키운다.
- Exercise 정답 소개 / 질의 및 답변
○ [실습]Quartus II를 통한 Compilation정보 확인
강의장소
담당자 연락처
  • 본센터 담당자 : 김영지
  • 연락처 : 042-350-8536
  • 이메일 : yjkim@idec.or.kr

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