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캠퍼스 전남대-아카데미 구분 설계강좌 / Digital / 초중급 / 이론+실습 정원초과
강의제목 FPGA 임베디드 SoC 설계의 기초
강의일자 2025-07-16 ~ 2025-07-17 신청 및 취소기간 재직자 : 2025-06-16 00:00 ~ 2025-06-22 23:59
전  체  : 2025-06-23 00:00 ~ 2025-07-11 23:59
강의형태 대면 신청현황 25/25명
수강료(일반) 무료 수강료(학생) 무료
수강대상 임베디드 SoC 설계의 기초에 관심있는 재직자, 학부생 및 대학원생
사전지식
선수과목
Verilog, C++ 기초
강의목표

FPGA 기반으로 기초적인 임베디드 SoC를 설계할 수 있다.

강의개요

FPGA 기반으로 기초적인 임베디드 SoC의 설계 방법을 학습한다. SystemVerilog HDL 및 C++을 사용하여 간단한 SoC의 HW 및 SW를 설계하고 직접 FPGA에 구현하여 동작을 확인한다.

참고사항

♦ 정원 마감 시 수강을 희망하시는 재직자 분들은 담당자에게 연락주시기 바랍니다.
♦ 강의실(대면), 강의자료는 강의 1일 전 메일로 안내 예정입니다.
♦ 출석 100%, 퀴즈 3/5문제 통과시 수료증이 발급됩니다.
♦ 수강신청 기간 내에 홈페이지에서 수강 취소해야 정상 취소처리 됩니다.
♦ 1개 교육에 대해 전일 결석시, 추후 8개월간 수강신청이 자동차단됩니다. (취소는 홈페이지에서 직접 가능)

강좌상세
일자 2025-07-16 시간 10:00 ~ 12:00 강사 김건우 조교수 목포대학교
내용 ○ FPGA 및 Digilent Nexys 4 DDR 보드
○ RTL 관점에서의 SystemVerilog
○ RAM 및 FIFO 버퍼
일자 2025-07-16 시간 13:00 ~ 17:00 강사 김건우 조교수 목포대학교
내용 ○ Lab-1: FIFO 버퍼
○ Embedded SoC의 구성 및 개발 과정
○ Bare Metal 시스템 소프트웨어
일자 2025-07-17 시간 10:00 ~ 12:00 강사 김건우 조교수 목포대학교
내용 ○ SoC 버스 및 MMIO 코어
○ Lab-2: Vanilla FPro SoC
일자 2025-07-17 시간 13:00 ~ 17:00 강사 김건우 조교수 목포대학교
내용 ○ Lab-3: SSEG 코어
○ Lab-4: XADC 코어
○ Lab-5: UART 코어
강의장소

전남대학교 공과대학 7호관 / ZOOM

담당자 연락처
  • 전남대-아카데미 담당자 : 채보라
  • 연락처 : 062-530-0367
  • 이메일 : chae1530@jnu.ac.kr

     정원초과

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