| 캠퍼스 | 성균관대 | 구분 | 설계강좌 / Analog / / 이론+실습 | 마감 | ||||||||||||||||||||||||||||||||||||
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| 강의제목 | Cadence? Virtuoso Schematic & Layout | |||||||||||||||||||||||||||||||||||||||
| 강의일자 | 2015-02-25 ~ 2015-02-27 | 신청 및 취소기간 | 2014-12-31 00:00 ~ 2015-02-24 23:59 | |||||||||||||||||||||||||||||||||||||
| 강의형태 | 대면 | 신청현황 | 43/45명 | |||||||||||||||||||||||||||||||||||||
| 수강료(일반) | 50,000원 | 수강료(학생) | 30,000원 | |||||||||||||||||||||||||||||||||||||
| 성균관대 입금계좌 | ||||||||||||||||||||||||||||||||||||||||
| 수강대상 | ||||||||||||||||||||||||||||||||||||||||
| 사전지식 선수과목 |
- 전기 전자를 배운 엔지니어 - 반도체설계관련 학과 학부/대학원생 - Analog/Mixed Signal IC Designer/Custom Circuit Designer |
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- 강의 일자 : 2015년 2월 25일(수) ~ 2월 27일(금), 3일 - 강의 제목 : Cadence? Virtuoso Schematic & Layout - 강의 장소 : 성균관대학교 자연과학캠퍼스 반도체관 400203호 - 강사 : 나인플러스(주) [교육목표] PSpice를 활용한 회로 기본 법칙, RLC수동회로의 분석 및 설계, Diode/TR/MOSFET을 이용한 각종 기본 및 응용회로의 설계/분석, OPAMP, 전원IC 등의 subckt model을 이용한 실무 Application회로의 분석 및 설계 그리고 SI, PI 회로의 분석/설계의 기초능력 개발에 교육의 목적이 있다. [교육내용] -Cadence FULL-CUSTOM IC 설계를 위하여 Tool의 전반적인 이해와 기초 과정 -CMOS를 중심으로 기초적인 아날로그 회로에 대한 설계방법과 Layout design rule에 대한 이해, 다양한 layout technique을 기초 실습설계 CAD tools(Schematic, Layout, Assura DRC/LVS)의 이해 [활용분야] - 전기/전자/통신/정보통신 분야 개발/엔지니어(학부.대학원 반도체설계과정) [활용장비] - Cadence Virtuoso Schematic Editor_IC615 - Cadence Virtuoso Layout Editor_IC615 - Cadence Assura LVS , Assura DRC_IC615 [수강료 납부방법] * KAIST IDEC 교육 수강료 입금 계좌로 직접 입금 하시면 됩니다. 가. 수강신청 후 수강료 입금 우리은행 270-003359-13-137 예금주 : 한국과학기술원 : 수강료 입금자명 : 교육 첫 시작일-수강신청자 실명 (예시 : 0411-홍길동) 나. 계산서 또는 영수증 필요 시 수강신청 시 사이트 상 입력하여 요청 다. 문의 : 오가영, 042-350-8536, oky0818@idec.or.kr [참고사항] - 본 강좌는 비학위 과정이며 별도의 학점을 인정하지 않음 - 수강인원 부족으로 폐강 여부 결정시 (5인 미만) 등록된 이메일로 개별 공지 강좌상세
강의장소담당자 연락처
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