| 캠퍼스 | 본센터 | 구분 | Tool강좌 / / 중급 / 이론+실습 | 마감 | ||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
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| 강의제목 | [Synopsys] Low Power Verification | |||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
| 강의일자 | 2018-09-17 ~ 2018-09-19 | 신청 및 취소기간 | 2018-08-20 00:00 ~ 2018-09-12 23:59 | |||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
| 강의형태 | 대면 | 신청현황 | 11/33명 | |||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
| 수강료(일반) | 무료 | 수강료(학생) | 무료 | |||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
| 수강대상 | 저전력 설계 및 검증 인력 | |||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
| 사전지식 선수과목 |
ASIC 기초, Low Power Methodology, Cell library | |||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||||
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[강의 목표] 해당 과정을 통해, 저전력 반도체 구현과 검증을 이해하고, Low power 검증 솔루션과 테크닉을 배워본다. - Power가 디자인에 미치는 영향 - Power domain control 검증 - UPF 기초 - Power domain 구성 요소 - VCS-NLP 와 UPF를 사용한 시뮬레이션 - Verdi 를 이용한 디버깅 - UPF attributes을 통한 시뮬레이션 동작 control - VCS report 이해 - VCS-NLP상 assertion 이해 - Low power simulation coverage 리포트 - VC-LP 사용한 static 디버깅.
[강의 개요] 해당 과정은 강의와 랩을 통해, Low power 검증 전체에 대해 체험해 볼수 있다. 과정을 이수하면 UPF를 통해 저전력 구현 및 검증에 필요한 파워 구조를 작성할수 있게되고, 해당 UPF 를 가지고 VCS-NLP 시뮬레이션을 해서, 저전력 설계시 function 검증을 할수 있게 된다. 처음에 설계자가 가지고 있는 power intent 를 UPF로 작성하는 방법을 배운후, 해당 power intent 가 디자인과 검증에 어떤 영향을 미치는지 배운다. VCS-NLP 를 배운후에는, 시뮬레이션을 효과적으로 디버깅 하기 위해서, Power-aware Verdi를 사용한 디버깅 테크닉을 배우게 된다. 더 고급기능으로, 저전력 검증시 low power coverage 의 이해 및 사용 방법, 그리고 VCS, Verdi, 각종 report를 통해서 분석하는 방법을 배운다. 동적 시뮬레이션을 마친후에는, 저전력 반도체 구현을 Static 하게 검증하는 방법을 배운다. VC-LP 를 사용하여, DC/ICC 를 통해서 구현된 디자인을 Power intent 대비 구현이 잘되었는지 디버깅 하는 방법을 배운다. 위 내용들을 습득하기 위하여, 실무에서 볼수 있는 실전 예제를 통해 직접 체험하게 된다.
[강의 장소] 대전 KAIST N26동 1층 실습실
♦ 출석 100%, 퀴즈 3/5문제 통과시 수료증이 발급됩니다. ♦ 강의 시작 최소 3일 전(공휴일 제외) 수강 취소 해야 정상 취소처리 됩니다. (취소는 홈페이지에서 직접 가능) ♦ 최근 1년간 2개의 교육에 대해 전일 무단 결석했을 시, 추후 3개월간 수강신청이 자동 차단 되오니 유의 바랍니다. 강좌상세
강의장소담당자 연락처
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