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  제목 강사정보 등록일
2 [무료세미나]Fallacies of Computational Analog 송방섭 교수(U.S San Diego) 2016.03.25
1 (2014) VHDL 코드를 이용한 디지털회로 설계 및 simulation Honey Durga Tiwari 교수 2015.11.23
교육자료
  제목 작성자 작성일 조회
질문/답변
  제목 작성자 작성일 조회
191 [답변] [답변] vcs 설치 관련 문의

 회신 감사드립니다.   설치는 64bit 로 해서 linux 대신 amd64 로 확..

임수환 17.12.27 8
190 [답변] [답변] [답변] vcs 설치 관련 문의

  IDEC 선혜승입니다     예전에 말씀드린 바와 같습니다 &..

선혜승 17.12.27 5
189 [답변] [답변] [답변] [답변] vcs 설치 관련 문의

답변 감사드립니다. 하지만.. 추가 의문사항이 있어서 다시 문의드립니다. 번거롭게 해..

임수환 17.12.28 9
188 [답변] [답변] [답변] [답변] [답변] vcs 설치 관련 문의

  IDEC 선혜승입니다     죄송하지만 저희가 그 부분은 도와드릴..

선혜승 17.12.28 37
187 [답변] 케이던스 시뮬레이션 관련 오류질문드립니다.(버젼문제)

안녕하세요. IDEC 연구원 조인신입니다.   사용하고 있는 MMSIM 이 151&nbs..

조인신 17.12.21 35
186 [홍종필] 케이던스 시뮬레이션 관련 오류질문드립니다.(버젼문제)

안녕하세요 연구원님. 하이닉스 1702회차 설계했던 충북대학교 홍종필 교수..

유국현 17.12.21 32
185 [답변] [답변] 삼성 65nm PEX 관련

 안녕하세요. 한국항공대 조춘식 교수님 연구실 석사과정 최영석입니다. 저도 같..

최영석 17.12.29 47
184 [답변] [답변] [답변] 삼성 65nm PEX 관련

안녕하세요. IDEC 연구원 조인신입니다.   첨부한 에러 내용을 보면 XRR1 이 무..

조인신 17.12.29 23
183 [답변] [답변] [답변] [답변] 삼성 65nm PEX 관련

 안녕하세요. 한국항공대 조춘식 교수님 연구실 석사과정 최영석입니다. PEX 시 s..

최영석 17.12.29 19
182 [답변] [답변] [답변] [답변] [답변] 삼성 65nm PEX 관련

사용한 저항이 무엇인지 파악할 수 있도록 schematic 이나 pex.netlist 을 확인하여..

조인신 17.12.29 15
181 [답변] [답변] [답변] [답변] [답변] [답변] 삼성 65nm PEX 관련

 안녕하세요. 한국항공대 조춘식 교수님 연구실 석사과정 최영석입니다. 사용한 ..

최영석 17.12.29 33
180 [답변] [답변] [답변] [답변] [답변] [답변] [답변] 삼성 65nm PEX 관련

저항의 body 를 ground 로 한 것과는 상관없을 것입니다. 원격으로 확인이 필요할 것 같..

조인신 18.01.02 117
179 [답변] [답변] s65 pdk 설치 문의

 답변감사드립니다. csh 을 하니 source sourceme_total 은 잘 되네요 그런데 그 ..

장이산 17.11.27 14
178 [답변] [답변] [답변] s65 pdk 설치 문의

sourceme_toal 파일에 OA_HOME 이 선언되어 있을 텐데 OA_HOME 으로 선언된 경로가 제대..

조인신 17.11.27 35
177 [답변] Custom Designer 버전 관련

안녕하세요. IDEC 연구원 조인신입니다.   custom compiler 최신 버전을 ED..

조인신 17.11.13 16
176 [정하연] Custom Designer 버전 관련

안녕하세요. 이전에 Custom Designer에서 Post layout simulation에 대해 질문했던 장태..

장태진 17.11.12 14
175 [답변] sentaurus sde 관련 질문입니다.

By default, a device simulated in 2D is assumed to have a ‘thickness’ i..

조인신 17.08.09 8
174 [답변] [답변] sentaurus sde 관련 질문입니다.

By default, a device simulated in 2D is assumed to have a ‘thickness’ i..

이주찬 17.08.09 5
173 [답변] [답변] [답변] sentaurus sde 관련 질문입니다.

By default, a device simulated in 2D is assumed to have a ‘thickness’ i..

조인신 17.08.09 18
172 [답변] Cadence OA_HOME 문제

안녕하세요. IDEC 연구원 조인신입니다.   우선 몇가지 정보가 필요합니다. 1. ..

조인신 17.07.31 53
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  제목 작성자 작성일 조회
1 e2l-접적회로-ASM 차트에서 Xilinx를 이용한 DC motor 구동

영문제목 : DC motor driving By implementing ASM chart on Xilinx FPGA 개요 : Xilin..

구재희 06.08.22 1027
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참여교수 성과 - 논문 FPGA-Accelerated Neural Network Inference via a μkernel-Enabled Byte..

강진구 26.01.14 3
참여교수 성과 - 특허 Memory Device Including In-Memory Operation Circuit and Operating Me..

A memory device includes an in-memory operation circuit connected to a write word l..

정윤영 26.01.13 22
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The present disclosure provides a 4T ternary content addressable memory (TCAM) cell..

정윤영 26.01.13 13
참여교수 성과 - 특허 2T DRAM Cell with Asymmetric Parasitic Capacitor and 2T DRAM Cell Ar..

The present disclosure provides a 2T DRAM cell with an asymmetric parasitic capac..

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이규호 26.01.12 0
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공지사항 [홍보] IEEE A-SSCC 2025 홍보 안내

IC Design Education Center(IDEC)   [홍보] IEEE A-SSCC ..

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이수연 25.06.18 14
참여교수 성과 - 논문 Extraction of Subgap Density of States in Amorphous In–Ga–Zn–O Thin-..

이수연 25.06.18 10
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