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  제목 강사정보 등록일
2 [무료세미나]Fallacies of Computational Analog 송방섭 교수(U.S San Diego) 2016.03.25
1 (2014) VHDL 코드를 이용한 디지털회로 설계 및 simulation Honey Durga Tiwari 교수 2015.11.23
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질문/답변
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111 [답변] [답변] [답변] [답변] [답변] [답변] [답변] 라이센스 서버 관련 질문입니다.

메일로 원격을 위한 내용 드렸습니다. 확인 후 연락 바랍니다.    [홍..

조인신 16.09.13 38
110 Synopsys 설치 후 실행 할때 libstdc++.so.6 관련 메시지가 뜹니다.

  기술문의 담당자 분께   안녕하세요 울산과학기술원에서 석박통합과정에..

정재원 16.08.02 29
109 [답변] Synopsys 설치 후 실행 할때 libstdc++.so.6 관련 메시지가 뜹니다.

안녕하세요. IDEC 연구원 조인신입니다.   사용하고 있는 OS 의 Type 과&nb..

조인신 16.08.02 27
108 [답변] [답변] Synopsys 설치 후 실행 할때 libstdc++.so.6 관련 메시지가 뜹니다.

   다음과 같이 창이 뜹니다. 전에 보여드린 사진처럼 libstdc++.so.6 ..

정재원 16.08.02 43
107 [답변] [답변] [답변] Synopsys 설치 후 실행 할때 libstdc++.so.6 관련 메시지가 ..

안녕하세요. IDEC 연구원 조인신입니다.   사용하고 있는 서버의 OS type 과&nbs..

조인신 16.08.02 9
106 [답변] [답변] [답변] [답변] Synopsys 설치 후 실행 할때 libstdc++.so.6 관련 메..

   OS 는 Red Hat Enterprise Linux server release 5.5 (Tikanga) 입니다 T..

정재원 16.08.02 23
105 [답변] [답변] [답변] [답변] [답변] Synopsys 설치 후 실행 할때 libstdc++.so.6 ..

안녕하세요. IDEC 연구원 조인신입니다.   유선상으로 말씀 드린대로 사용하고 ..

조인신 16.08.02 49
104 삼성 65nm ERC 관련 질문드립니다.

안녕하세요 강원대학교 권구덕 교수님 연구실입니다. TW소자(lvtnfettw_rf)를 사용하는..

김신영 16.08.01 31
103 [답변] 삼성 65nm ERC 관련 질문드립니다.

안녕하세요. IDEC 연구원 조인신입니다.    nfet 의 bulk 는 Ground ..

조인신 16.08.02 40
102 DRC 에러 문의

By fingers must be on different nets where x = 1-6 and y = 1, 2, A, B   라는..

정재승 16.07.16 32
101 [답변] DRC 에러 문의

By fingers must be on different nets where x = 1-6 and y = 1, 2, A, B   라는..

선혜승 16.07.18 48
100 [유창식] Virtuoso Mixed transient simulatuon error 문의

한양대학교 유창식 교수님 연구실 정동혁 입니다. Virtuoso mixed transient simulation..

정동혁 16.07.13 8
99 [답변] Virtuoso Mixed transient simulatuon error 문의

안녕하세요. IDEC 연구원 조인신입니다.   환경 설정 파일에 LD_LIBRARY_PATH 정..

조인신 16.07.13 9
98 [답변] [답변] Virtuoso Mixed transient simulatuon error 문의

 setenv path에는 문제가 없었으나, 여전히 같은 문제가 발생합니다. ADE 창에서 s..

정동혁 16.07.13 5
97 [답변] [답변] [답변] Virtuoso Mixed transient simulatuon error 문의

안녕하세요. IDEC 연구원 조인신입니다.   setenv path 가 아닌 setenv LD_LIBR..

조인신 16.07.13 10
96 [답변] [답변] Virtuoso Mixed transient simulatuon error 문의

 현재 source 파일에 LD_LIBRARY_PATH 정의가 되어있지 않아, 추가하였습니다...

정동혁 16.07.13 4
95 [답변] [답변] [답변] Virtuoso Mixed transient simulatuon error 문의

안녕하세요. IDEC 연구원 조인신입니다.   환경설정이 적용되었는지를 확인하는 ..

조인신 16.07.13 14
94 [답변] PEX관련 에러 문의

By 를 얼마로 하였나요? 위 란의 숫자가 커서 두 MOS 가 붙는 현상이 발생한 것으로 보..

조인신 16.07.04 33
93 [답변] [답변] PEX관련 에러 문의

By 를 얼마로 하였나요? 위 란의 숫자가 커서 두 MOS 가 붙는 현상이 발생한 것으로 보..

민웅기 16.07.04 2
92 [답변] [답변] [답변] PEX관련 에러 문의

By 를 얼마로 하였나요? 위 란의 숫자가 커서 두 MOS 가 붙는 현상이 발생한 것으로 보..

조인신 16.07.04 4
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1 e2l-접적회로-ASM 차트에서 Xilinx를 이용한 DC motor 구동

영문제목 : DC motor driving By implementing ASM chart on Xilinx FPGA 개요 : Xilin..

구재희 06.08.22 1027
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참여교수 성과 - 논문 FPGA-Accelerated Neural Network Inference via a μkernel-Enabled Byte..

강진구 26.01.14 3
참여교수 성과 - 특허 Memory Device Including In-Memory Operation Circuit and Operating Me..

A memory device includes an in-memory operation circuit connected to a write word l..

정윤영 26.01.13 22
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A memory device includes an in-memory operation circuit connected to a write word l..

정윤영 26.01.13 15
참여교수 성과 - 특허 4T TCAM Cell Utilizing Dual-Gate Transistors, 4T TCAM Cell Array, an..

The present disclosure provides a 4T ternary content addressable memory (TCAM) cell..

정윤영 26.01.13 13
참여교수 성과 - 특허 2T DRAM Cell with Asymmetric Parasitic Capacitor and 2T DRAM Cell Ar..

The present disclosure provides a 2T DRAM cell with an asymmetric parasitic capac..

정윤영 26.01.13 19
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정윤영 26.01.13 15
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백윤흥 26.01.12 2
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이규호 26.01.12 0
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강인만 26.01.06 8
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공지사항 [홍보] IEEE A-SSCC 2025 홍보 안내

IC Design Education Center(IDEC)   [홍보] IEEE A-SSCC ..

이의숙 25.09.30 5954
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궁재하 25.09.22 22
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이종민 25.07.10 9
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이수연 25.06.18 14
참여교수 성과 - 논문 Extraction of Subgap Density of States in Amorphous In–Ga–Zn–O Thin-..

이수연 25.06.18 10
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