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답변 주셔서 감사합니다. 말씀하신대로 가드링 연결을 수정하였습니다. 그래도 아직 Dr..

2~5 의 에러에 대해서는 layout 에 문제가 없는지 부터 확인해 보시기 바랍니다. ..

답변 주셔서 감사합니다. 말씀하신대로 lvs를 돌렸을때는 통과가 되는 것을 확인하였고,..

PAD 는 아무런 Definition 을 해주지 않으면 기본적으로 I/O signal 용으로 인식합..

답변 주셔서 감사합니다. 말씀하신대로 power pad쪽에 net definition을통해 1~4까지의 ..

해당 에러의 rule 을 보면 에러가 발생하는 부분이 LC power supply pad 로 연결되어야 ..

안녕하세요 인천대학교 송준영교수님 연구실(ICS Lab)에 있는 강윤하 연구생입니다. 레..

  IDEC 선혜승입니다     저희가 배포하고 있는 OUTLINE 이 ..

안녕하세요. IDEC  석은주입니다.   문의 내용 관련하여 Synopsys사로 부터..

안녕하세요, 카이스트 유회준 교수님 연구실 한동현입니다. 저희가 사용하고 있는 input..

  IDEC 선혜승입니다     어떤 명령을 하다가 나온 것인지 궁금..

 RTL 파일을 읽은 후 "check_design"이라는 command 를 쳤을 때 발견되었습니다. &..

안녕하세요 삼성 20n 참여중인 유니스트 박사과정 장이산입니다.   ESD30a,b 에러..

    IDEC 선혜승입니다     네 waive 는 가능하긴 한데&nb..

안녕하세요. IDEC 연구원 조인신입니다.   CDM resistor 는 opppcres, opreres ..

    IDEC 선혜승입니다     정상적인 겁니다  저도 ..

  빠른 답변 주셔서 감사드립니다.   사전 머지 과정도 진행해보겠습니다. ..

  Cadence IC 618을 설치한 후,  virtuoso 명령어를 통해 Cadence IC 618을 ..

안녕하세요. IDEC 연구원 조인신입니다.   warning 은 무시해도 됩니다. 첨부한..

안녕하세요. 카이스트 유회준 교수님 연구실 권수린입니다. esd Drc 관련하여 문의드리..

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