반도체설계교육센터

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	제목	강사정보	등록일
16	(2025) Cell-Based Chip Design Flow_Day5	김연태,선혜승/연구원/IDEC	2025.12.30
15	FPGA 기반 시스템 설계 (SDrAM 컨트롤러 및 NIOS 프로세서 IP 활용)	박근용/대표/(주)레디에이트	2025.02.25
14	[IDEC 제작강좌] Full Custom Layout Design (DrC&LVS)	정용운/조교수/세종대학교	2024.10.23
13	딥러닝 기초 및 설계	김동국/교수/전남대학교	2024.08.09
12	SystemVerilog를 이용한 검증 방법론	이중희 부교수(고려대)	2024.02.14
11	SDrAM 제어를 통해 배우는 FPGA 임베디드 시스템 설계 기초	박근용 대표 (주)레디에이트	2024.02.07
10	Low-Dropout (LDO) Regulator 회로설계	김현식/교수/KAIST	2023.03.17
9	FPGA환경하에서 메모리 콘트롤러 설계 및 테스트	박근용 대표 (주)레디에이트	2023.02.01
8	PMIC 설계 기초 및 응용	박병하 교수 서강대학교	2021.09.17
7	반도체 집적회로를 설계하기 위한 Full Custom 개요	남철 전무	2021.03.09
6	XMODEL을 활용한 실리콘포토닉스 시스템 모델링 및 시뮬레이션	김재하 교수(서울대)	2020.07.30
5	비휘발성 메모리 Overview	정두석 교수(한양대)	2020.06.04
4	임베디드 시스템 기초	최수일/교수/전남대학교	2019.10.21
3	[무료세미나]Fallacies of Computational Analog	송방섭 교수(U.S San Diego)	2016.03.25
2	(2014)SoC Architecture	한태희 교수(성균관대학교)	2014.10.31
1	(2013)SoC architecture 설계	유승주 교수(포항공대)	2013.10.24

교육자료

	제목	작성자	작성일	조회
7	[ 캠퍼스](한양대) SDrAM 제어를 통해 배우는 FPGA 임베디드 시스템 설계 기초	박명희	24.01.18	2067
6	AnDroid Platform Architecture 분석	김영지	17.11.01	203
5	Linux Device Driver 설계 기술	구재희	02.07.05	119
4	Linux Device Driver 설계 기술	구재희	01.09.19	79
3	Linux Device Driver 설계 기술	구재희	01.08.03	39
2	Linux Device Driver 설계 기술	구재희	01.06.29	47
1	Memory(DrAM) Design Overview	구재희	13.08.01	897

질문/답변

	제목	작성자	작성일	조회
73	[답변] [답변] [답변] [답변] [답변] Synopsys SPW 설치 및 실행시 program hang 안녕하세요IDEC 선혜승 연구원입니다저희는 사실 따로 LD_LIBRARY_PATH 는 지정하..	선혜승	14.02.26	51
72	Synopsys SPW 설치 및 실행시 program hang --EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) : SPW EDA Tool 버전(SCL/L..	이종화	14.02.25	33
71	[답변] 동부0.35공정이 올해부터 cadence 6버전이상을 사용하라고 해서 문의드립니다. 안녕하세요.IDEC 연구원 조인신입니다. IC614 이상을 설치하면 됩니다.IDEC E..	조인신	14.02.20	21
70	동부0.35공정이 올해부터 cadence 6버전이상을 사용하라고 해서 문의드립니다. --EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) : cadence EDA Tool 버전(S..	이경록	14.02.20	109
69	[답변] assura parasitic extraction 문제 안녕하세요.IDEC 연구원 조인신입니다. 해당 문제는 직접 해결 해드렸습..	조인신	14.02.19	29
68	assura parasitic extraction 문제 --EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) : CADENCE EDA Tool 버전(S..	김현민	14.02.19	124
67	[답변] Assura LVS 시 error 메세지 안녕하세요.IDEC 연구원 조인신입니다. LVS 가 실행이 안되는 원인은 E..	조인신	14.02.17	80
66	[답변] [답변] Assura LVS 시 error 메세지 안녕하세요. 답변 감사드립니다. 그런데, 이 LVS가 IDEC ASIC 실습실에서 Calibre ..	김현민	14.02.17	11
65	[답변] [답변] [답변] Assura LVS 시 error 메세지 안녕하세요.IDEC 연구원 조인신입니다. LVS 설정을 잘 못한 것 같습니다. rule..	조인신	14.02.17	10
64	[답변] [답변] [답변] [답변] Assura LVS 시 error 메세지 안녕하세요. 말씀해주신 LVS rule file로 물리고 했는데, 이전에 첨부했던 err..	김현민	14.02.17	13
63	[답변] [답변] [답변] [답변] Assura LVS 시 error 메세지 안녕하세요.IDEC 연구원 조인신입니다. 그리고, 한 가지 더 말씀 드리면 LVS ..	조인신	14.02.17	11
62	[답변] [답변] [답변] [답변] [답변] Assura LVS 시 error 메세지 네, 말씀하신데요. 설정했더니 잘 동작하는것 확인했습니다. 친절한 답변 감..	김현민	14.02.17	32
61	[답변] IC 615 Hotfix설치 99% 완료 후 메세지 문의 하신 내용에 회신 드립니다. browse를 눌러서 base 버젼의 CDrOM1 포더를 지정..	김창수	14.02.04	20
60	[답변] [답변] IC 615 Hotfix설치 99% 완료 후 메세지 답변 감사합니다.답변하신대로 설치하고 실행해보니 이런 에러메세지가 생깁니다... ..	박윤수	14.02.05	13
59	[답변] [답변] [답변] IC 615 Hotfix설치 99% 완료 후 메세지 안녕하세요 아이덱 김창수입니다. 추가 회신 드립니다.IC615 버젼이 아니고 I..	김창수	14.02.05	12
58	IC 615 Hotfix설치 99% 완료 후 메세지 --EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) : Cadence IC615 EDA Tool ..	박윤수	14.02.04	10
57	[답변] EDA tool 설치 중 질문 드립니다. 안녕하세요.IDEC 연구원 조인신입니다. 질문에 답변 드립니다. 몇몇 버..	조인신	14.02.04	20
56	EDA tool 설치 중 질문 드립니다. --EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) : EDA Tool 버전(SCL/LCU/..	정현민	14.02.03	32
55	[답변] 회로 레이아웃시 문제 해결 방안 안녕하세요 아이덱 김창수입니다. 문의 하신 내용에 회신 드립니다. 가장 정확..	김창수	13.11.18	22
54	회로 레이아웃시 문제 해결 방안 --EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) : mycad EDA Tool 버전(SCL..	김아연	13.11.17	43

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자료실

	제목	작성자	작성일	조회
1	e2l-접적회로-Memory cell and structure 영문제목 : Memory cell and structure 개요 : ● Memory cell 이란 ? ● Memory cell 구..	구재희	04.12.30	719

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