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다른 유사한 질문의 답변 글에도 있듯이    .subckt lvsres p n .ends 로 ..

자꾸 번거롭게 해드려 죄송하지만, 말씀해주신 방법대로 실행하여도 에러가 해결이 안되..

R2947 N_VSS_R2947_pos N_47_R2947_neg lvsres R=0.001 를  R2947 N_VSS_R2947_po..

수정하여 진행했음에도 마찬가지로 이번에는 resistor 가 정의되어 있지 않다는 에러가 ..

이전 답변에  ----------------------------------------------------------------..

  1.VDD VSS Floating  디자인에 따라 발생하는 이유가 다르기 때문에 스크..

 1. VDD VSS Floating power plan 후 스크린샷(사진1) 첨부하였습니다. 이후 Drc,..

   1.    이미지를 보면 standard cell 이 power rail 에 위치하..

안녕하세요. 숙명여자대학교 정준원 교수님 랩실의 석사과정 송예슬입니다. 다름이 아..

IDEC 이종행입니다.   공지사항의 설계자 수정사항이 있습니다.    ..

안녕하세요. 숙명여자대학교 정준원 교수님 랩실 석사과정 송예슬입니다.   해당..

  안녕하세요. PH18C0810_ISO라는 I/O Library cell을 LEF 파일에서 GDS 파일로 ..

제공하는 I/O 의 LEF 는 실제 모든 layer 가 포함되어 있지 않은 phantom cell 입니다. ..

안녕하세요, 연세대학교 정성욱 교수님 연구실 석사과정 오웅빈입니다. 다름이 아니라 ..

  IDEC 선혜승입니다     문서를 보면 50 Ohm에 대한 내용이 있..

  답변 감사합니다.   [선혜승]님의 글 =================================..

  제공되는 IO 패드는 최대 250Mhz ~ 300Mhz 수준입니다.   50ohm 임피던스 ..

 답변 감사합니다.     [김연태]님의 글 ===========================..

--EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) : EDA Tool 버전(SCL/LCU/MGLS 포함..

 관련하여서는 EDA 담당자 분에게 메일로 가이드를 받으시는 것이 좋을 듯 합니다.&..

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