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답변감사합니다.. 말씀해주신 에러를 찾아보니,   Loading MPDK_HL18G/libInit.i..

에러 내용을 보면 OUTLINE Library 안에 VIA24IO_1488 cell 에 layout 이 없어서 문제가..

gds를 다시 불러와도 via 몇개가 엑박으로 뜨는데 해결방법이 없을까요ㅠㅠ?&n..

OUTLINE_34X34.gds 파일을 import 하여 확인해보았으나 아무런 문제가 없습니..

안녕하세요 충북대학교 최호용교수님 연구실 석사과정 이희진입니다.   현재 pad ..

에러에 대한 설명은 calibre 창 하단에 표기되어 있습니다. (또는 DRC Rule 파일을 열어 ..

안녕하세요 충북대학교 최호용교수님 연구실 석사과정 이희진입니다.   아래 erro..

 안녕하세요 IDEC 김연태 입니다.     해당 에러는 제작에는 문..

안녕하세요. 카이스트 유회준 교수님 연구실 석사과정 권수린입니다. ams 시뮬레이션 ..

  IDEC 선혜승입니다    IUS 가 아직 남아 있는 것 같습니다 &nb..

IV152setenv OA_HOME /tools/CADENCE/IC616/oa_v22.43.054 setenv CDS_LIC_FILE 5280@14..

전화상으로 알려 드린대로 IDEC 에 Mentor 라이선스 신청한 것이 없어 IDEC 의 서..

안녕하세요. 박종선 교수님 연구실의 이경호입니다. 다름이 아니라 아이덱에서 멘토 그..

안녕하세요. IDEC 석은주입니다. Vendor에서 제공하는 EDA Tool은 억대 고가의 Tool로 ..

  다른 방법으로는, 기존의 라이센스를 발급받은 맥주소에 해당하는 서버에서 라이..

라이선스 데몬이 구동하고 있는 서버가 있고 (ex. server1) tool 을 실..

안녕하세요. 중앙대학교 백광현 교수님 연구실의 윤동현입니다. 중앙대에서는 이번 "정..

IVA, ASSURA, PVS) 에서 사용할 수 있는 Rule 만 포함되어 있습니다. Mentor&..

IVA, ASSURA, PVS) 에서 사용할 수 있는 Rule 만 포함되어 있습니다. Mentor&..

IVA, ASSURA, PVS) 에서 사용할 수 있는 Rule 만 포함되어 있습니다. Mentor&..

(소개글) AI반도체 설계 시 기존 디자인과는 복잡도나 연산구조에 있어 Manual로 PPA를 ..

IC Design Education Center(IDEC)   (Tool 활용법 공유) Caden..

MPW 칩을 테스트 하기 위한 환경이 부족함을 개선하기 위하여 최근 IDEC 에서 칩 테..

영문제목 : Low-Power Design 개요 : 키워드 : 저전력, Leakage, Switching ActIVit..

영문제목 : computer & semiconductor 개요 : ● Eniac부터 4004, Pentium chip까지 발..

영문제목 : Low-Power Design 개요 : ● 배터리 기술 ● 소자레벨 ● 회로 ● 구조 및 알고..

영문제목 : Embedded S/W Practice 개요 : 키워드 : Firmware, FPGA, Device drIVer..

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영문제목 : Advanced Digital Logic Design Using Verilog 개요 : The main focus of t..

영문제목 : Embedded S/W Practice 개요 : 2005년 정부의 임베디드 소프트웨어 지원 정..

영문제목 : Digital System Design with Verilog-HDL 개요 : ●· Verilog-HDL 에 대한 ..

영문제목 : The Principle of PLL / understand and Applications of PLL 개요 : 키..

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IV, Integer linear programming-10/21 Partitioning I-10/26 Midterm examination-10/28..

영문제목 : CMOS RF 개요 : 키워드 : TransceIVer, LNA, mixer, VCO, frequency syn..