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  제목 강사정보 등록일
2 SoC 설계를 위한 IC Compiler 실습 손병복/연구소장/스마트브이 2019.12.19
1 SoC 설계를 위한 IC Compiler 활용 교육 손병복/연구소장/스마트브이 2019.12.19
교육자료
  제목 작성자 작성일 조회
질문/답변
  제목 작성자 작성일 조회
509 [답변] StarRC 툴 구동 관련 문의

라이선스 파일은 서버의 어떤 폴더에 있어도 상관없습니다. 하지만, 파일만 서버에 둔다..

조인신 22.01.20 13
508 [답변] StarRC 툴 구동 관련 문의

 잘 해결되었습니다. 답변 감사합니다.     [조인신]님의 글 ========..

장동원 22.01.23 68
507 analogLib switch셀 에러 문의

안녕하세요? 저는 한동대학교 김영식교수님 랩실 김서진입니다.다름이아니라, analogLib..

김서진 22.01.02 32
506 [답변] analogLib switch셀 에러 문의

안녕하세요. IDEC 연구원 조인신입니다.   첨부한 내용만으로는 원인을 알기 어..

조인신 22.01.03 48
505 PBIDIR_18_18_NT_DR cell PS signal

안녕하세요 고려대학교 박종선 교수님 연구실 석사과정 박현철입니다.   PAD IO ..

박현철 21.12.21 19
504 [답변] PBIDIR_18_18_NT_DR cell PS signal

    IDEC 선혜승입니다     PE 는 Pull Enable 이라서 def..

선혜승 21.12.21 45
503 서버 로그인 제한 및 접근 경로 문제

안녕하세요 연세대학교 김태욱 교수님 연구실 석사과정 정윤철 입니다.    ..

정윤철 21.12.03 47
502 [답변] 서버 로그인 제한 및 접근 경로 문제

  IDEC 선혜승입니다     용량문제인 것으로 보입니다 &nbs..

선혜승 21.12.03 26
501 [답변] 서버 로그인 제한 및 접근 경로 문제

답변 감사드립니다.  혹시 MobaXterm 및 서버에서 해당 폴더로 접근이 안되는 문제..

정윤철 21.12.03 35
500 Power 분석 관련 문의

안녕하세요, 김장우 교수님 연구실 학생 이헌준입니다.   Design Compiler / ICC..

이헌준 21.11.30 24
499 [답변] Power 분석 관련 문의

  IDEC 선혜승입니다     추측으로 답을 드리기는 어렵습니다&nb..

선혜승 21.12.01 13
498 [답변] Power 분석 관련 문의

네 알겠습니다.   toggle_rate을 임의로 0.5로 setting을 하고 돌리는 경우에도 ..

이헌준 21.12.01 5
497 [답변] Power 분석 관련 문의

  IDEC 선혜승입니다     네 그렇습니다   보기 어렵..

선혜승 21.12.01 39
496 [답변] tcad sentaurus visual 관련 문의

기본적으로 tool 에서 지원하는 물질들은 sdevice 선택 후 마우스 우클릭 -> Edit In..

조인신 21.11.30 74
495 [siliconsmart] DFF function generation 관련 질문 사항

--EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) : siliconsmart EDA Tool 버전(SCL/..

이광연 21.11.25 25
494 [답변] [siliconsmart] DFF function generation 관련 질문 사항

  IDEC 선혜승입니다     확인해보니 클럭핀에는  clock : ..

선혜승 21.11.25 34
493 [답변] [siliconsmart] DFF function generation 관련 질문 사항

  친절한 답변 감사합니다.  현재 저는 Reset이 존재하는 TSPC를 이용해 .li..

이광연 21.11.22 34
492 [답변] StarRC .spf 파일 추출

IDEC 선혜승입니다     finesim 은 spf, spef 등을 모두 iNPUt 으로 받..

선혜승 21.11.03 63
491 Multi clock Timing constraint

--EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) : EDA Tool 버전(SCL/LCU/MGLS 포함..

문한결 21.10.06 17
490 [답변] Multi clock Timing constraint

  IDEC 선혜승입니다    CLK_IN, CLK_gen 이렇게 2가지에 대해서..

선혜승 21.10.07 39
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Single-INPUt Multi-Output Resonant Regulating Rectifier

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