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  제목 강사정보 등록일
2 SoC 설계를 위한 IC Compiler 실습 손병복/연구소장/스마트브이 2019.12.19
1 SoC 설계를 위한 IC Compiler 활용 교육 손병복/연구소장/스마트브이 2019.12.19
교육자료
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질문/답변
  제목 작성자 작성일 조회
409 [답변] CentOS 7.6과 IC617 문제

안녕하세요. IDEC 연구원 조인신입니다.   warning 은 홈폴더(터미널 창에서 cd ..

조인신 21.01.15 63
408 [답변] CentOS 7.6과 IC617 문제

  친절한 설명 감사드립니다. 그동안 주신 답변들을 모두 적용을 해보니, warnin..

조근호 21.01.16 35
407 [답변] CentOS 7.6과 IC617 문제

warning 들은 모두 무시하셔도 됩니다. tool 을 사용하는데 아무런 문제가 없습니다.&nb..

조인신 21.01.18 165
406 virtuoso 시뮬레이션 과정에서 에러발생에 대해 질문드립니다.

제가 첫번째 사진과 같은 회로를 설계 후 ADE_L로 'spectre'로 시뮬레이션을 돌리렸습니..

박민석 20.11.15 23
405 [답변] virtuoso 시뮬레이션 과정에서 에러발생에 대해 질문드립니다.

안녕하세요. IDEC 연구원 조인신입니다.   IDEC 에서는 freePDK45를 사용하지 않..

조인신 20.11.16 13
404 [답변] virtuoso 시뮬레이션 과정에서 에러발생에 대해 질문드립니다.

   그렇다면 혹시 gpdk180 라이브러리를 다운로드 받는 방법과 추가하는 방..

박민석 20.11.16 15
403 [답변] virtuoso 시뮬레이션 과정에서 에러발생에 대해 질문드립니다.

cadence 사에서 제공하는 gpdk180 는 IDEC 의 EDA Tool 설치 파일 제공 FTP 에서 다운로..

조인신 20.11.16 14
402 [답변] virtuoso 시뮬레이션 과정에서 에러발생에 대해 질문드립니다.

   제가 학교계정으로 생성된 cadence를 사용해서 잘 설명해주신 해결책대로 ..

박민석 20.11.16 19
401 [답변] virtuoso 시뮬레이션 과정에서 에러발생에 대해 질문드립니다.

virtuoso tool 에서 제공하는 기본 model library 파일이 많기 때문에 무엇을 사용..

조인신 20.11.16 76
400 DC report_constraint violation 관련

안녕하세요.  Design compiler단계에서 compiler 후 report_constraint -all_viola..

문승현 20.09.18 41
399 [답변] DC report_constraint violation 관련

  IDEC 선혜승입니다     해당 에러들이 클럭과 리셋 등의 라인..

선혜승 20.09.18 106
398 region interface 에서의 surface recombination 을 변수로써 추가를 하고싶습니다.

--EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) :TCAD sentaurus  EDA Tool 버..

신재관 20.09.14 26
397 [답변] region interface 에서의 surface recombination 을 변수로써 추가를 하고싶..

안녕하세요. IDEC 석은주입니다. 시높시스사로 부터 아래의 회신을 받았습니다. 아래 ..

석은주 20.09.15 18
396 [답변] Hierarchical synthesis 관련

 답변 감사드립니다.   추가적인 질문이 있는데, sub module을 포함하여 syn..

문승식 20.09.14 12
395 [답변] Hierarchical synthesis 관련

  IDEC 선혜승입니다     delay time 이라고 표현하는 것이 더 ..

선혜승 20.09.14 19
394 [답변] Hierarchical synthesis 관련

안녕하세요.   우선 sub-module을 합성할 때에는 같은 종류의 셀에서 delay time..

문승식 20.09.14 70
393 Synopsys DFT Compiler - Scan cell redesign

--EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) : Synopsys Design Compiler EDA To..

Ibtesam 20.09.02 16
392 메모리 hold violation 관련

안녕하세요. 포항공과대학교 이영주 교수님 연구실 문승식입니다.   현재 S65 공..

문승식 20.08.06 30
391 [답변] 메모리 hold violation 관련

  IDEC 선혜승입니다    ema 값이 000 으로 되면 가장 빠르게 동작하..

선혜승 20.08.07 18
390 [답변] 메모리 hold violation 관련

안녕하세요. 이영주 교수님 연구실 문승식입니다.   우선 답변 감사드립니다. ..

문승식 20.08.07 14
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참여교수 성과 - 논문 A 4.5 GOhm-INPUt Impedance Chopper Amplifier With Embedded DC-Servo ..

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Accordingly, the present invention has been made keeping in mind the above problems..

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A Mixer included in a receiver of a wireless communication system is provided. The ..

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양병도 21.02.15 10
참여교수 성과 - 논문 A Piezoelectric Harvesting Interface with Capacitive Partial Electri..

이윤명 21.02.09 3
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Disclosed are a spin logic device based on spin-charge conversion and a spin logic ..

오새룬터 21.02.08 2
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김수환 21.02.05 5
개설 희망 강좌 신청 [ 캠퍼스][답변] NPU (Neural Processing Unit)의 이해 강좌 신청

안녕하세요 성민규님   아직 해당 강좌 개설 계획이 없습니다.   추후 개..

김지영 21.01.28 5271
개설 희망 강좌 신청 NPU (Neural Processing Unit)의 이해 강좌 신청

해당 강좌 개설 계획이 있나요?   연구때문에 꼭 들어야하는데 자료찾기가 쉽지않..

성민규 21.01.27 4633
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고형호 21.01.07 22
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