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  제목 강사정보 등록일
2 SoC 설계를 위한 IC Compiler 실습 손병복/연구소장/스마트브이 2019.12.19
1 SoC 설계를 위한 IC Compiler 활용 교육 손병복/연구소장/스마트브이 2019.12.19
교육자료
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질문/답변
  제목 작성자 작성일 조회
329 [답변] 합성 관련 질문

  IDEC 선혜승입니다     먼저 분명히 할 것은 analyze 를 한 ..

선혜승 20.04.08 26
328 [답변] 합성 관련 질문

elaborate, uniquify, current_design compile_ultra -no_autoungroup 등의 기본적인 ..

이경준 20.04.08 36
327 [답변] 합성 관련 질문

    IDEC 선혜승입니다     우선 set_dont_touch 를 ..

선혜승 20.04.09 69
326 Standard I/O pad 삽입 시점

안녕하세요. Standard I/O pad를 삽입해야하는 시점에 대해 문의드립니다. 일반적인 설..

이경준 20.04.03 16
325 [답변] Standard I/O pad 삽입 시점

  IDEC 선혜승입니다     설계에 대한 기본적인 흐름은 홈페이지..

선혜승 20.04.03 100
324 Cadence virtuoso 시뮬레이션 돌리는데 질문이 있습니다

안녕하세요 연구원님 다름이아니라 회로를 디자인해서 시뮬레이션을 돌렸을때 다음과 같..

유용준 20.03.30 53
323 [답변] Cadence virtuoso 시뮬레이션 돌리는데 질문이 있습니다

안녕하세요. IDEC 연구원 조인신입니다.   우선 사용하고 있는 라이선스가 ..

조인신 20.03.31 80
322 [답변] 삼성 28nm 공정 합성에 관해 질문드립니다

  IDEC 선혜승입니다     PIN LOAD 가 매우 크게 되어 있군요&nb..

선혜승 20.03.30 32
321 [답변] 삼성 28nm 공정 합성에 관해 질문드립니다

 답변 감사합니다. 답변해주신 내용 중에 궁금한 부분이 있어서 다시 질문드리려고..

조정훈 20.03.30 10
320 [답변] 삼성 28nm 공정 합성에 관해 질문드립니다

 IDEC 선혜승입니다   네 줄여야 합니다   셀 DELAY 가 매우..

선혜승 20.03.30 100
319 I/O Ring에서 Power Domain 관련 질문입니다.

안녕하세요. 한양대학교 박상규 교수님 연구실 석사과정 백경호입니다.   외부에..

백경호 20.03.25 42
318 [답변] I/O Ring에서 Power Domain 관련 질문입니다.

  IDEC 선혜승입니다     답변을 첨부로 드렸습니다  ..

선혜승 20.03.25 34
317 [답변] I/O Ring에서 Power Domain 관련 질문입니다.

안녕하세요.AVDD 1V Cell로 Diigital 회로에1V를 공급할 수 있는 것이군요.   한..

백경호 20.03.25 16
316 [답변] I/O Ring에서 Power Domain 관련 질문입니다.

  IDEC 선혜승입니다     공정사에서 제공하는 IO 셀 중에 정말..

선혜승 20.03.25 17
315 [답변] I/O Ring에서 Power Domain 관련 질문입니다.

답변 감사합니다. 정말 많은 도움이 되었습니다..!! 말씀해주신 내용 참고하여 진행하겠..

백경호 20.03.25 80
314 IC Compiler에서의 DRC 질문입니다.

안녕하세요. 한양대학교 박상규 교수님 연구실 석사과정 백경호입니다.   IC Comp..

백경호 20.03.21 31
313 [답변] IC Compiler에서의 DRC 질문입니다.

  IDEC 선혜승입니다     제가 질문하신 분의 디자인에 대하여 ..

선혜승 20.03.23 86
312 [ICC] stream export 문의

안녕하세요   한양대학교 권오경교수님연구실 박사과정 정재형입니다. 선혜승 연..

정재형 20.03.17 43
311 [답변] [ICC] stream export 문의

   IDEC 선혜승입니다     1. Warning 은 무시하셔도 됩니..

선혜승 20.03.17 31
310 [답변] [ICC] stream export 문의

   감사합니다.     1. Warning 은 무시하셔도 됩니다 &nb..

정재형 20.03.18 18
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참여교수 성과 - 논문 A Low-Power RF-DC Converter Using an Adaptive Architecture to Achiev..

권익진 26.02.20 8
참여교수 성과 - 논문 FINEA: An Efficient Neural Network Accelerator Exploiting Factorized..

구건재 26.02.13 5
참여교수 성과 - 논문 A Resistive Dynamic Bias Comparator with Flying Capacitors Achieving..

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참여교수 성과 - 논문 S3A-NPU: A High-Performance Hardware Accelerator for Spiking Self-Su..

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유담 26.01.21 7
참여교수 성과 - 논문 An 8-Bit 400-MS/s 1-Then-2-Bit/Cycle SAR ADC With Comparator Rotatio..

김철우 26.01.17 5
참여교수 성과 - 논문 A 3× Offset, 2.9× Power, 1.3× Sensing Time, and 4× Area Reduction Di..

정성욱 26.01.15 7
참여교수 성과 - 특허 어레이 내부로 연장되는 도파관을 포함하는 뉴로모픽 시스템

본 발명에서 제안하는 어레이 내부로 연장되는 도파관을 포함하는 뉴로모픽 시스템은, 입..

이수연 26.01.12 3
참여교수 성과 - 특허 MEMORY DEVICE SUPPORTING IN-MEMORY MAC OPERATION BETWEEN TERNARY INP..

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박종선 26.01.12 0
참여교수 성과 - 논문 A Low-Power, Auto-DC-Suppressed Photoplethysmography Readout System ..

전현탁 26.01.12 8
참여교수 성과 - 논문 A Hybrid Step-Down DC-DC Converter for High INPUt-Voltage and High V..

조건희 26.01.12 0
참여교수 성과 - 논문 A 36-65V INPUt Quadruple Step-Down Converter with Inherently Current..

조건희 26.01.12 4
참여교수 성과 - 논문 A 9-72V INPUt to 1-2.2V Output Single-Inductor Multi- Path Multi-Sta..

조건희 26.01.12 0
참여교수 성과 - 논문 Posit adder and multiplier with variable iNPUt and output exponent s..

김현진 26.01.12 2
참여교수 성과 - 논문 Rectifier array with wide iNPUt power and frequency ranges using har..

오준택 26.01.07 23
참여교수 성과 - 논문 PyTorchSim: A Comprehensive, Fast, and Accurate NPU Simulation Frame..

박종세 26.01.06 6
참여교수 성과 - 논문 Wide iNPUt range readout IC for efficient signal extraction in gas s..

김현준 26.01.06 4
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