반도체설계교육센터

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	제목	강사정보	등록일
2	SoC 설계를 위한 IC Compiler 실습	손병복/연구소장/스마트브이	2019.12.19
1	SoC 설계를 위한 IC Compiler 활용 교육	손병복/연구소장/스마트브이	2019.12.19

교육자료

	제목	작성자	작성일	조회

질문/답변

	제목	작성자	작성일	조회
89	cadence virtuoso 관련 질문드립니다. iNPUt output pin이 있는 회로를 간단하게 시뮬레이션 할때 ADE simulator 에서 schemat..	양이삭	17.04.14	7
88	[답변] cadence virtuoso 관련 질문드립니다. 안녕하세요. IDEC 연구원 조인신입니다. stimuli 는 기본적으로&nbs..	조인신	17.04.14	7
87	[조광현] cadence virtuoso 관련질문 안녕하세요, cadence virtuoso 에서 ADE 시뮬레이션을 수행할때 iNPUt signal을 clock..	양이삭	17.04.12	6
86	[답변] cadence virtuoso 관련질문 안녕하세요. IDEC 연구원 조인신입니다. analogLib 에 있는 vsource ..	조인신	17.04.13	10
85	[답변] [답변] 답변 정말 감사드립니다. 답변 정말 감사드립니다. 양이삭 드림 [조인신 ]님의글 =====..	양이삭	17.04.13	3
84	[답변] (재질문) Design Compiler Area IDEC 선혜승입니다 모호하게 답을 드렸나 보네요 um^2 ..	선혜승	17.03.27	23
83	[답변] Design Compiler/ IC Compiler Area NPUT NAND gate 의 면적으로 나누면 몇 게이트인지 알 수 있습니다 감사..	선혜승	17.03.27	29
82	[답변] virtuoso 타이핑 문제 안녕하세요. IDEC 연구원 조인신입니다. 사용하고 있는 서버의 입력방식 ..	조인신	17.03.20	15
81	DB 제출 및 점검 관련 문의 안녕하세요 인하대 강진구교수님 연구실 장나래입니다. 두가지 질문 있습니다. ..	장나래	17.03.14	61
80	[답변] DB 제출 및 점검 관련 문의 2. 둘다 제출 하시면 됩니다. 4. 따로 작성하여 제출하시면 됩니다. ..	김연태	17.03.14	92
79	[정의영] siliconsmart 결제 관련 안녕하세요, 연세대학교 정의영 교수님 연구실 석사 박영민입니다. 먼저, 11/25..	박영민	16.11.30	51
78	[답변] siliconsmart 결제 관련 전화로 답변드렸습니다. 감사합니다. 석은주 드림 [박영민 ]님의글 ===========..	석은주	16.12.02	51
77	magna180공정으로 그린 layout을 PEX를 하는중에 질문드립니다. 현재 저희 상황을 말씀드리자면 Full Top layout에는 0.18-Micron 1.8V Standard Cell L..	임일영	16.11.25	20
76	[답변] magna180공정으로 그린 layout을 PEX를 하는중에 질문드립니다. 디지털 블럭을 포함하여 PEX 를 하시려면 IDEC 에 방문하여 Physical..	김연태	16.11.25	33
75	[답변] [답변] [답변] TCAD-Sentaurus 사용 관련 질문 드립니다. 우선 Tool 버전을 현재 사용하는 2013 이 아닌 2016 으로 사용하시기 바랍니다. ..	조인신	16.10.18	6
74	[답변] [답변] [답변] [답변] TCAD-Sentaurus 사용 관련 질문 드립니다. 답변 감사드립니다. 말씀해주신 대로 Sentaurus 2016버전을 새로 설치하려고 하..	오동준	16.10.18	6
73	[답변] [답변] [답변] [답변] [답변] TCAD-Sentaurus 사용 관련 질문 드립니다. 1. 설치 방법은 2012와 2016에 차이가 없습니다. 단지&nb..	조인신	16.10.18	8
72	[답변] [답변] [답변] [답변] [답변] [답변] TCAD-Sentaurus 사용 관련 질문 드립니.. 이전 질문 내용에 대해서 답변해주셔서 SDVICE의 commands를 확인했는데, 제가 입력한 t..	오동준	16.11.09	6
71	[답변] [답변] [답변] [답변] [답변] [답변] [답변] TCAD-Sentaurus 사용 관련 질문.. tool 버전을 2016으로 업데이트 하고 진행하는 것인가요? 이전에 알려 드린 대로 tool ..	조인신	16.11.09	25
70	cadence 5141 설치중 문의 OS: centos 6.7 edatool: cadence 5141 Error lineread/rea..	이용호	16.10.06	9

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구분	제목	작성자	작성일	조회
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참여교수 성과 - 논문	Double clock sampling XBBPFD for distortion of iNPUt data duty cycle	범진욱	24.02.13	10
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참여교수 성과 - 논문	A Capacitive Computing-In-Memory Circuit With Low INPUt Loading SRAM..	김재준	24.02.01	14
참여교수 성과 - 논문	A 3.8 mW 1.9 mΩ/√Hz Electrical Impedance Tomography Imaging with 28...	유회준	24.02.01	11

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