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교육자료
질문/답변
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 3298 |
Cadence virtusso 수정 후 icc2 컴파일러 사용 질문
--EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) : EDA Tool 버전(SCL/LCU/MGLS 포함.. |
문한결 | 21.03.19 | 9 |
| 3297 |
[답변] Cadence virtusso 수정 후 icc2 컴파일러 사용 질문
IDEC 선혜승입니다 read_gds 명령이 있네요 .. |
선혜승 | 21.03.19 | 23 |
| 3296 |
smartspice
--EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) :slivaco smartspice EDA Tool 버전.. |
강서진 | 21.03.19 | 28 |
| 3295 |
[답변] smartspice
안녕하세요. IDEC 연구원 조인신입니다. IDEC 서버에서 라이선스를 가지.. |
조인신 | 21.03.19 | 12 |
| 3294 |
[답변] smartspice
여전히 사용할 수 없다고 뜹니다.. [조인신]님의 글 ===========.. |
강서진 | 21.03.19 | 21 |
| 3293 |
[답변] smartspice
silvaco tool 실행 시에는 -flexlm 옵션을 주어야 합니다. 윈도우에서 실행하려면 .. |
조인신 | 21.03.19 | 22 |
| 3292 |
[답변] smartspice
네 감사합니다 gateway는 실행이 되었고, gateway에서 회로 구성 후 시뮬.. |
강서진 | 21.03.19 | 13 |
| 3291 |
[답변] smartspice
IDEC 에서 지원하는 silvaco 라이선스는 multicore 가 지원되지 않는 라이선스.. |
조인신 | 21.03.19 | 12 |
| 3290 |
[답변] smartspice
그럼 gateway와 smartview를 동시에 같이 사용하지 못한다는 말씀이신가요..? &nb.. |
강서진 | 21.03.19 | 17 |
| 3289 |
[답변] smartspice
시뮬레이션 시 multicore 를 사용할 수 없다는 것입니다. gateway와 smartview를 .. |
조인신 | 21.03.19 | 6 |
| 3288 |
[답변] smartspice
어떻게 multicore를 사용하지 않고 시뮬레이션을 진행할 수 있을까요,, .. |
강서진 | 21.03.19 | 5 |
| 3287 |
[답변] smartspice
회로 구성 및 시뮬레이션 설정 & 환경 설정 등이 어떻게 되어 있는지.. |
조인신 | 21.03.19 | 11 |
| 3286 |
[답변] smartspice
먼저 multicore라는 것이 뭔지 잘 모르겠습니다.. [조인신]님의 글 ===========.. |
강서진 | 21.03.22 | 4 |
| 3285 |
[답변] smartspice
multicore 는 CPU 를 1 개가 아닌 2 개 이상을 사용하는 것을 의미합니다.. |
조인신 | 21.03.22 | 43 |
| 3284 |
[답변] Synopsys design compiler 실행 문제
조인신 연구원님,UNIST의 박지호입니다.추가적으로 지금 라이센스 ip로 Ping을 날려 보았.. |
박지호 | 21.03.19 | 17 |
| 3283 |
[답변] Synopsys design compiler 실행 문제
라이선스 신청 내용을 확인해보니 10. 으로 시작하는 ip 가 등록되어 있.. |
조인신 | 21.03.19 | 35 |
| 3282 |
Spectre license
--EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) : Spectre EDA Tool 버전(SCL/LCU/M.. |
유종호 | 21.03.18 | 50 |
| 3281 |
[답변] Spectre license
안녕하세요. IDEC 연구원 조인신입니다. 확인 결과 schong-5513-0 서버의 plut.. |
조인신 | 21.03.18 | 9 |
| 3280 |
[답변] Spectre license
계정내 모든 프로세스를 종료하고 서버를 재부팅해도 해당문제가 발생합니.. |
유종호 | 21.03.18 | 15 |
| 3279 |
[답변] Spectre license
라이선스 서버에서 작업을 했으니 4시 반경 확인해 보시기 바랍니다. .. |
조인신 | 21.03.18 | 4 |
자료실
| 제목 | 작성자 | 작성일 | 조회 | |
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| 37 |
칩 테스트 보드 Ver2.0
IDEC 에서 칩 검증을 위하여 제작한 테스트 전용 보드이다.Ver2.0 보드는 기존 보드와 비.. |
선혜승 | 17.08.17 | 10609 |
| 36 |
Synopsys Custom Designer User guide
본 자료는 ipDK 를 사용하는 유저들이 필수적으로 참고해야 할 자료입니다 Synopsys .. |
선혜승 | 15.10.05 | 6973 |
| 35 |
e2l-반도체공학-반도체의 주요 응용 분야:컴퓨터와 반도체
ip까지 발전사 ● Mainframe, PC, workstation ● OS ● device driver ● 주변장치 ● post P.. |
구재희 | 04.12.30 | 737 |
| 34 |
e2l-반도체공학-반도체와 경제: semiconductor intellectual property
영문제목 : semiconductor intellectual property 개요 : ● 지적재산권(산업재산권, 저.. |
구재희 | 04.12.30 | 923 |
| 33 |
e2l-반도체공학-반도체와 경제: 반도체 분야의 career planning
영문제목 : Semiconductor career planning 개요 : ● 반도체 기술자의 유형(process, d.. |
구재희 | 04.12.30 | 1000 |
| 32 |
e2l-반도체공학-미래의 반도체 기술: Technology Roadmap
ip size ● wafer size ● pins ● frequency ● supply voltage ● power dissipation ● wiri.. |
구재희 | 04.12.30 | 1040 |
| 31 |
e2l-디지털시스템-디지털논리회로
ip-flop, FSM |
구재희 | 07.11.30 | 968 |
| 30 |
e2l-디지털시스템-임베디드 컴퓨터 구조
ipelining, Memory Hierarchy, Parallel Processing 키워드 : computer performance, c.. |
구재희 | 06.12.21 | 937 |
| 29 |
e2l-디지털시스템-디지털시스템의 ASIC 구현 방법 소개
영문제목 : Introduction to ASIC Impleementation Method of Digital Systems 개요 : .. |
구재희 | 06.06.13 | 964 |
| 28 |
e2l-디지털시스템-고속연산회로의 설계(가산기, 곱셈기,나눗셈기, 부동소수점 연산)
iplier Design 개요 : 키워드 : unsigned multiplier, Baugh-Wooley multiplier, mo.. |
구재희 | 06.06.13 | 1009 |
| 27 |
e2l-디지털시스템-기본 이진 연산회로의 설계(덧셈기의 설계)
ipple carry adder, carry look-ahead adder, carry-select adder, Brenk Kung adder |
구재희 | 06.06.13 | 979 |
| 26 |
e2l-디지털시스템-SoC 설계 자동화
ip communication, hardware synthesis, software synthesis, low power systems design,.. |
구재희 | 06.05.22 | 1019 |
| 25 |
e2l-디지털시스템-디지털논리회로
ip-flop, FSM |
구재희 | 05.09.20 | 1217 |
| 24 |
e2l-디지털시스템-디지털공학
iplier, Mux, Demux |
구재희 | 05.09.20 | 984 |
| 23 |
e2l-디지털시스템-시스템온칩설계
ip Design 개요 : 정보통신, 반도체 산업 및 집적회로 기술의 발전으로 과거에 한 보드.. |
구재희 | 05.09.20 | 1024 |
| 22 |
e2l-디지털시스템-컴퓨터 구조
ipelining, exceptions, advanced pipelining techniques, caches and memory hierarchy,.. |
구재희 | 05.09.16 | 786 |
| 21 |
e2l-디지털시스템-고속연산회로의 설계(가산기, 곱셈기,나눗셈기, 부동소수점 연산)
iplier Design 개요 : ●고속 가산기의 원리, 종류(Carry Lookahead, Carry Skip, Carry.. |
구재희 | 04.12.30 | 1721 |
| 20 |
e2l-디지털시스템-기본 이진 연산회로의 설계(덧셈기의 설계)
ipple 가산기의 원리 및 장.단점 ● Serial 및 Ripple 가산기의 설계 ● 이진 곱셈기/나눗.. |
구재희 | 04.12.30 | 1135 |
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e2l-디지털시스템-Verilog-HDL에 의한 디지털시스템 설계
ip-flop, Register, Counter 등) 교육방법: ● · 트레이닝 키트에 의한 관련 예제 회로 실.. |
구재희 | 04.12.30 | 1121 |
| 18 |
e2l-디지털시스템-디지털시스템의 ASIC 구현 방법 소개
영문제목 : Introduction to ASIC Impleementation Method of Digital Systems 개요 : .. |
구재희 | 04.12.30 | 1466 |
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