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교육자료
질문/답변
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 238 |
삼성 65nm STD cell
안녕하세요.. 고려대 전재훈입니다.IDEC homepage 의 Analog cell ip Page 를 보면, 몇몇.. |
전재훈 | 15.04.29 | 39 |
| 237 |
[답변] 삼성 65nm STD cell
안녕하세요IDEC 김연태 입니다. 삼성공정도 다른 공정과 마찬가.. |
김연태 | 15.04.30 | 24 |
| 236 |
[김철우교수님] LVS 오류 메시지 관련 질문(MAGNA 0.18um)
--EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) : Calibre EDA Tool 버전(S.. |
송재근 | 15.04.25 | 243 |
| 235 |
[답변] LVS 오류 메시지 관련 질문(MAGNA 0.18um)
안녕하세요.IDEC 연구원 조인신입니다. 질문에 답변드립니다. MS 공정의 경우 .. |
조인신 | 15.04.25 | 117 |
| 234 |
[답변] [답변] LVS 오류 메시지 관련 질문(MAGNA 0.18um)
예 빠른 답변 감사합니다. 그 문제는 해결 되었습니다.추가적으로 질문이 있습니다.. |
송재근 | 15.04.29 | 44 |
| 233 |
[답변] [답변] [답변] LVS 오류 메시지 관련 질문(MAGNA 0.18um)
안녕하세요.IDEC 연구원 조인신입니다. 질문에 답변드립니다. calibre pex 후 .. |
조인신 | 15.04.30 | 42 |
| 232 |
[답변] [답변] [답변] [답변] LVS 오류 메시지 관련 질문(MAGNA 0.18um)
예 친절한 답변 감사합니다.1. Full_custom 설계 flow 교육 자료를 참고하던 중 문.. |
송재근 | 15.04.30 | 32 |
| 231 |
[답변] [답변] [답변] [답변] [답변] LVS 오류 메시지 관련 질문(MAGNA 0.18um)
안녕하세요.IDEC 연구원 조인신입니다. 질문에 답변드립니다. 1. calibre.. |
조인신 | 15.04.30 | 25 |
| 230 |
[답변] [답변] [답변] [답변] [답변] [답변] LVS 오류 메시지 관련 질문(MAGNA 0.18..
예 답변 감사합니다.1.의 경우 schematic과 layout이 있는 cell에서 생성을 하긴 .. |
송재근 | 15.04.30 | 33 |
| 229 |
[답변] [답변] [답변] [답변] [답변] [답변] [답변] LVS 오류 메시지 관련 질문(MAG..
안녕하세요.IDEC 연구원 조인신입니다. 질문에 답변드립니다. 기존의 caliview.. |
조인신 | 15.04.30 | 234 |
| 228 |
[답변] 마그나 0.18um 설치 관련 문의드립니다.
ip 파일을 unzip하여 HSPICE 폴더 안에 있는 HL18G-S3.7S.lib 파일을 tt_tn을 옵션으로 .. |
조인신 | 15.03.13 | 9 |
| 227 |
[답변] [답변] 마그나 0.18um 설치 관련 문의드립니다.
ip 파일을 unzip하여 HSPICE 폴더 안에 있는 HL18G-S3.7S.lib 파일을 tt_tn을 옵션으로 .. |
송재근 | 15.03.13 | 6 |
| 226 |
[답변] [답변] [답변] 마그나 0.18um 설치 관련 문의드립니다.
ip 파일을 unzip하여 HSPICE 폴더 안에 있는 HL18G-S3.7S.lib 파일을 tt_tn을 옵션으로 .. |
조인신 | 15.03.13 | 4 |
| 225 |
[답변] [답변] [답변] [답변] 마그나 0.18um 설치 관련 문의드립니다.
ip 파일을 unzip하여 HSPICE 폴더 안에 있는 HL18G-S3.7S.lib 파일을 tt_tn을 옵션으로 .. |
송재근 | 15.03.13 | 3 |
| 224 |
[답변] [답변] [답변] [답변] [답변] 마그나 0.18um 설치 관련 문의드립니다.
ip 파일을 unzip하여 HSPICE 폴더 안에 있는 HL18G-S3.7S.lib 파일을 tt_tn을 옵션으로 .. |
조인신 | 15.03.13 | 4 |
| 223 |
[답변] [답변] [답변] [답변] [답변] [답변] 마그나 0.18um 설치 관련 문의드립니다.
ip 파일을 unzip하여 HSPICE 폴더 안에 있는 HL18G-S3.7S.lib 파일을 tt_tn을 옵션으로 .. |
송재근 | 15.03.13 | 8 |
| 222 |
[김철우 교수님] 마그나 0.18um 설치 관련 문의드립니다.
ip 파일을 unzip하여 HSPICE 폴더 안에 있는 HL18G-S3.7S.lib 파일을 tt_tn을 옵션으로 .. |
송재근 | 15.03.13 | 13 |
| 221 |
[답변] [답변] 마그나칩/하이닉스 0.18 공정관련하여 문의 드립니다.
안녕하세요 답변 주신 내용을 바탕으로 virtuoso의 경우 IC5141_Hotfix에 있는&nbs.. |
김삼기 | 15.03.11 | 29 |
| 220 |
[답변] [답변] [답변] 마그나칩/하이닉스 0.18 공정관련하여 문의 드립니다.
안녕하세요.IDEC 연구원 조인신입니다. 질문에 답변드립니다. 1. spectre 버전.. |
조인신 | 15.03.12 | 35 |
| 219 |
[답변] 삼성 65nm 서버관리
ip를 바꿨습니다.그후에 openvpn에서 edit config에 ip부분을 수정하고 실행했는데도 접.. |
관리자 | 15.02.05 | 65 |
자료실
| 제목 | 작성자 | 작성일 | 조회 | |
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| 37 |
칩 테스트 보드 Ver2.0
IDEC 에서 칩 검증을 위하여 제작한 테스트 전용 보드이다.Ver2.0 보드는 기존 보드와 비.. |
선혜승 | 17.08.17 | 10609 |
| 36 |
Synopsys Custom Designer User guide
본 자료는 ipDK 를 사용하는 유저들이 필수적으로 참고해야 할 자료입니다 Synopsys .. |
선혜승 | 15.10.05 | 6973 |
| 35 |
e2l-반도체공학-반도체의 주요 응용 분야:컴퓨터와 반도체
ip까지 발전사 ● Mainframe, PC, workstation ● OS ● device driver ● 주변장치 ● post P.. |
구재희 | 04.12.30 | 737 |
| 34 |
e2l-반도체공학-반도체와 경제: semiconductor intellectual property
영문제목 : semiconductor intellectual property 개요 : ● 지적재산권(산업재산권, 저.. |
구재희 | 04.12.30 | 923 |
| 33 |
e2l-반도체공학-반도체와 경제: 반도체 분야의 career planning
영문제목 : Semiconductor career planning 개요 : ● 반도체 기술자의 유형(process, d.. |
구재희 | 04.12.30 | 1000 |
| 32 |
e2l-반도체공학-미래의 반도체 기술: Technology Roadmap
ip size ● wafer size ● pins ● frequency ● supply voltage ● power dissipation ● wiri.. |
구재희 | 04.12.30 | 1040 |
| 31 |
e2l-디지털시스템-디지털논리회로
ip-flop, FSM |
구재희 | 07.11.30 | 968 |
| 30 |
e2l-디지털시스템-임베디드 컴퓨터 구조
ipelining, Memory Hierarchy, Parallel Processing 키워드 : computer performance, c.. |
구재희 | 06.12.21 | 937 |
| 29 |
e2l-디지털시스템-디지털시스템의 ASIC 구현 방법 소개
영문제목 : Introduction to ASIC Impleementation Method of Digital Systems 개요 : .. |
구재희 | 06.06.13 | 964 |
| 28 |
e2l-디지털시스템-고속연산회로의 설계(가산기, 곱셈기,나눗셈기, 부동소수점 연산)
iplier Design 개요 : 키워드 : unsigned multiplier, Baugh-Wooley multiplier, mo.. |
구재희 | 06.06.13 | 1009 |
| 27 |
e2l-디지털시스템-기본 이진 연산회로의 설계(덧셈기의 설계)
ipple carry adder, carry look-ahead adder, carry-select adder, Brenk Kung adder |
구재희 | 06.06.13 | 979 |
| 26 |
e2l-디지털시스템-SoC 설계 자동화
ip communication, hardware synthesis, software synthesis, low power systems design,.. |
구재희 | 06.05.22 | 1019 |
| 25 |
e2l-디지털시스템-디지털논리회로
ip-flop, FSM |
구재희 | 05.09.20 | 1217 |
| 24 |
e2l-디지털시스템-디지털공학
iplier, Mux, Demux |
구재희 | 05.09.20 | 984 |
| 23 |
e2l-디지털시스템-시스템온칩설계
ip Design 개요 : 정보통신, 반도체 산업 및 집적회로 기술의 발전으로 과거에 한 보드.. |
구재희 | 05.09.20 | 1024 |
| 22 |
e2l-디지털시스템-컴퓨터 구조
ipelining, exceptions, advanced pipelining techniques, caches and memory hierarchy,.. |
구재희 | 05.09.16 | 786 |
| 21 |
e2l-디지털시스템-고속연산회로의 설계(가산기, 곱셈기,나눗셈기, 부동소수점 연산)
iplier Design 개요 : ●고속 가산기의 원리, 종류(Carry Lookahead, Carry Skip, Carry.. |
구재희 | 04.12.30 | 1721 |
| 20 |
e2l-디지털시스템-기본 이진 연산회로의 설계(덧셈기의 설계)
ipple 가산기의 원리 및 장.단점 ● Serial 및 Ripple 가산기의 설계 ● 이진 곱셈기/나눗.. |
구재희 | 04.12.30 | 1135 |
| 19 |
e2l-디지털시스템-Verilog-HDL에 의한 디지털시스템 설계
ip-flop, Register, Counter 등) 교육방법: ● · 트레이닝 키트에 의한 관련 예제 회로 실.. |
구재희 | 04.12.30 | 1121 |
| 18 |
e2l-디지털시스템-디지털시스템의 ASIC 구현 방법 소개
영문제목 : Introduction to ASIC Impleementation Method of Digital Systems 개요 : .. |
구재희 | 04.12.30 | 1466 |
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