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교육자료
질문/답변
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 8614 |
[답변] [SB130-2401] LV CMOS LVS 관련
ipsub : psub to vdd(tw) dipw : bulk to vdd(tw) 그리고, 메일과 같이 NSUBFGR guard .. |
권아연 | 24.09.26 | 21 |
| 8613 |
[답변] [SB130-2401] LV CMOS LVS 관련
ipsub : psub to vdd(tw) dipw : bulk to vdd(tw) 그리고, 메일과 같이 NSUBFGR guard .. |
조인신 | 24.09.26 | 122 |
| 8612 |
[답변] cadence LCU 관련 문의드립니다.
ip broken 명령어 혹은 rpm -Va --nofiles --nodigest를 진행해도 되는 지 여쭙고 싶습니.. |
조혜양 | 24.09.26 | 4 |
| 8611 |
[답변] cadence LCU 관련 문의드립니다.
ip broken 명령어 혹은 rpm -Va --nofiles --nodigest를 진행해도 되는 지 여쭙고 싶습니.. |
조인신 | 24.09.26 | 3 |
| 8610 |
[답변] cadence LCU 관련 문의드립니다.
ip broken 명령어 혹은 rpm -Va --nofiles --nodigest를 진행해도 되는 지 여쭙고 싶습니.. |
조혜양 | 24.09.26 | 3 |
| 8609 |
[답변] cadence LCU 관련 문의드립니다.
ip broken 명령어 혹은 rpm -Va --nofiles --nodigest를 진행해도 되는 지 여쭙고 싶습니.. |
조인신 | 24.09.26 | 1 |
| 8608 |
[답변] cadence LCU 관련 문의드립니다.
ip broken 명령어 혹은 rpm -Va --nofiles --nodigest를 진행해도 되는 지 여쭙고 싶습니.. |
조혜양 | 24.09.26 | 18 |
| 8607 |
[답변] cadence LCU 관련 문의드립니다.
ip broken 명령어 혹은 rpm -Va --nofiles --nodigest를 진행해도 되는 지 여쭙고 싶습니.. |
조인신 | 24.09.30 | 33 |
| 8606 |
Calibre 환경설정 이후 에러 관련
--EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) : Siemens Calibre EDA Tool 버전(S.. |
최예진 | 24.09.24 | 12 |
| 8605 |
[답변] Calibre 환경설정 이후 에러 관련
안녕하세요. IDEC 연구원 조인신입니다. 에러에 대해 calibre 연동을 위한 내.. |
조인신 | 24.09.25 | 17 |
| 8604 |
[답변] Calibre 환경설정 이후 에러 관련
안녕하세요. 우선 .cshrc 파일에 아래와 같이, 사용자 계정에서의 상대 디렉토리로 cali.. |
최예진 | 24.09.25 | 46 |
| 8603 |
[답변] Calibre 환경설정 이후 에러 관련
MGC_HOME 의 내용은 상대 경로가 아닌 절대 경로로 하시고 CALIBRE 설치 경로가 .. |
조인신 | 24.09.26 | 72 |
| 8602 |
[SF28-2401] Power, I/O cell에 대해 질문드립니다.
ip 내부 ip에 파워를 공급해주기 위해 2번 종류의 셀을 사용하려 "PVDDIA*" 와 "PVDDI*" .. |
안예현 | 24.09.23 | 116 |
| 8601 |
SCL 실행 시 glibc 2.7 not found 발생
--EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) : SCL EDA Tool 버전(SCL/LCU/MGLS .. |
한정원 | 24.09.21 | 21 |
| 8600 |
[답변] SCL 실행 시 glibc 2.7 not found 발생
안녕하세요. IDEC 조인신입니다. 라이선스 데몬과 OS의 버전이 낮아서.. |
조인신 | 24.09.23 | 10 |
| 8599 |
[답변] SCL 실행 시 glibc 2.7 not found 발생
안녕하십니까, 답변 감사합니다.지금 저희 연구실의 경우, 교수님께서 은퇴 후에.. |
한정원 | 24.09.23 | 9 |
| 8598 |
[답변] SCL 실행 시 glibc 2.7 not found 발생
Synopsys network license 지원은 하고 있습니다. EDA Tool -> EDA Tool 신청 페이지.. |
조인신 | 24.09.23 | 29 |
| 8597 |
Cadence 라이센스 관련 문의드립니다.
안녕하세요 인하대학교 변경수 교수님 연구실 변영준 입니다. 교육용으로 IDEC에서 .. |
변영준 | 24.09.20 | 38 |
| 8596 |
[답변] Cadence 라이센스 관련 문의드립니다.
안녕하세요. IDEC 조인신입니다. 해당 서버에서 라이선스를 사용하고 .. |
조인신 | 24.09.20 | 55 |
| 8595 |
cadence virtuoso 환경설정및 실행 질문
--EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) : cadence virtuoso EDA Tool 버전(.. |
양지민 | 24.09.19 | 74 |
자료실
| 제목 | 작성자 | 작성일 | 조회 | |
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| 37 |
칩 테스트 보드 Ver2.0
IDEC 에서 칩 검증을 위하여 제작한 테스트 전용 보드이다.Ver2.0 보드는 기존 보드와 비.. |
선혜승 | 17.08.17 | 10609 |
| 36 |
Synopsys Custom Designer User guide
본 자료는 ipDK 를 사용하는 유저들이 필수적으로 참고해야 할 자료입니다 Synopsys .. |
선혜승 | 15.10.05 | 6973 |
| 35 |
e2l-반도체공학-반도체의 주요 응용 분야:컴퓨터와 반도체
ip까지 발전사 ● Mainframe, PC, workstation ● OS ● device driver ● 주변장치 ● post P.. |
구재희 | 04.12.30 | 737 |
| 34 |
e2l-반도체공학-반도체와 경제: semiconductor intellectual property
영문제목 : semiconductor intellectual property 개요 : ● 지적재산권(산업재산권, 저.. |
구재희 | 04.12.30 | 923 |
| 33 |
e2l-반도체공학-반도체와 경제: 반도체 분야의 career planning
영문제목 : Semiconductor career planning 개요 : ● 반도체 기술자의 유형(process, d.. |
구재희 | 04.12.30 | 1000 |
| 32 |
e2l-반도체공학-미래의 반도체 기술: Technology Roadmap
ip size ● wafer size ● pins ● frequency ● supply voltage ● power dissipation ● wiri.. |
구재희 | 04.12.30 | 1040 |
| 31 |
e2l-디지털시스템-디지털논리회로
ip-flop, FSM |
구재희 | 07.11.30 | 968 |
| 30 |
e2l-디지털시스템-임베디드 컴퓨터 구조
ipelining, Memory Hierarchy, Parallel Processing 키워드 : computer performance, c.. |
구재희 | 06.12.21 | 937 |
| 29 |
e2l-디지털시스템-디지털시스템의 ASIC 구현 방법 소개
영문제목 : Introduction to ASIC Impleementation Method of Digital Systems 개요 : .. |
구재희 | 06.06.13 | 964 |
| 28 |
e2l-디지털시스템-고속연산회로의 설계(가산기, 곱셈기,나눗셈기, 부동소수점 연산)
iplier Design 개요 : 키워드 : unsigned multiplier, Baugh-Wooley multiplier, mo.. |
구재희 | 06.06.13 | 1009 |
| 27 |
e2l-디지털시스템-기본 이진 연산회로의 설계(덧셈기의 설계)
ipple carry adder, carry look-ahead adder, carry-select adder, Brenk Kung adder |
구재희 | 06.06.13 | 979 |
| 26 |
e2l-디지털시스템-SoC 설계 자동화
ip communication, hardware synthesis, software synthesis, low power systems design,.. |
구재희 | 06.05.22 | 1019 |
| 25 |
e2l-디지털시스템-디지털논리회로
ip-flop, FSM |
구재희 | 05.09.20 | 1217 |
| 24 |
e2l-디지털시스템-디지털공학
iplier, Mux, Demux |
구재희 | 05.09.20 | 984 |
| 23 |
e2l-디지털시스템-시스템온칩설계
ip Design 개요 : 정보통신, 반도체 산업 및 집적회로 기술의 발전으로 과거에 한 보드.. |
구재희 | 05.09.20 | 1024 |
| 22 |
e2l-디지털시스템-컴퓨터 구조
ipelining, exceptions, advanced pipelining techniques, caches and memory hierarchy,.. |
구재희 | 05.09.16 | 786 |
| 21 |
e2l-디지털시스템-고속연산회로의 설계(가산기, 곱셈기,나눗셈기, 부동소수점 연산)
iplier Design 개요 : ●고속 가산기의 원리, 종류(Carry Lookahead, Carry Skip, Carry.. |
구재희 | 04.12.30 | 1721 |
| 20 |
e2l-디지털시스템-기본 이진 연산회로의 설계(덧셈기의 설계)
ipple 가산기의 원리 및 장.단점 ● Serial 및 Ripple 가산기의 설계 ● 이진 곱셈기/나눗.. |
구재희 | 04.12.30 | 1135 |
| 19 |
e2l-디지털시스템-Verilog-HDL에 의한 디지털시스템 설계
ip-flop, Register, Counter 등) 교육방법: ● · 트레이닝 키트에 의한 관련 예제 회로 실.. |
구재희 | 04.12.30 | 1121 |
| 18 |
e2l-디지털시스템-디지털시스템의 ASIC 구현 방법 소개
영문제목 : Introduction to ASIC Impleementation Method of Digital Systems 개요 : .. |
구재희 | 04.12.30 | 1466 |
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