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  제목 강사정보 등록일
1 Verilog 언어를 활용한 FPGA 실습 서기범/교수/우송대학교 2015.10.29
교육자료
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질문/답변
  제목 작성자 작성일 조회
2083 [답변] synopsys-back end 환경설정 작성 문의드립니다.

ported라고 문구가 나오고 다운이 안됩니다. 어떻해 조치를 취해야 하는지 궁금합니다. ..

조인신 21.08.23 15
2082 [답변] synopsys-back end 환경설정 작성 문의드립니다.

ported라고 문구가 나오고 다운이 안됩니다. 어떻해 조치를 취해야 하는지 궁금합니다. ..

조용수 21.08.23 13
2081 [답변] synopsys-back end 환경설정 작성 문의드립니다.

ported라고 문구가 나오고 다운이 안됩니다. 어떻해 조치를 취해야 하는지 궁금합니다. ..

조인신 21.08.23 103
2080 [답변] backend 툴 설치 관련 문의

port  connection 이 주요 목적이므로  cell 내부의 mos 정보를 가지고 있지 ..

김연태 21.08.23 23
2079 [답변] cadence virtuoso 실행 오류

port 를 차단하는 경우가 있습니다.  학교 전산실에 문의 하셔서 IDEC IP와 port ..

김연태 21.08.19 76
2078 [답변] Cadence DRC 에러 질문입니다.

port 선택 2. calibre layout export setup 창에서 Layer Map File 란에 해당 공정..

조인신 21.08.18 39
2077 Synopsys Licence Tool

port logging. Use Flexera Software LLC's17:19:08 (lmgrd) software license administr..

박성정 21.08.13 41
2076 [답변] Synopsys Licence Tool

port logging. Use Flexera Software LLC's17:19:08 (lmgrd) software license administr..

조인신 21.08.13 61
2075 PRIMETIME-setup time fixation

port and fix_eco_timing output in console. Is there anything I am missing? I am u..

Ibtesam 21.08.10 22
2074 [답변] PRIMETIME-setup time fixation

portant point about eco fix should be done to Hold violation endpoints in BE  ..

선혜승 21.08.10 63
2073 Custom Explorer 실행 시 에러 메세지

Custom Explorer 실행 시 아래와 같은 메세지가 나옵니다.   (snpslmd) UNSUPport..

조근호 21.08.10 15
2072 [답변] Custom Explorer 실행 시 에러 메세지

안녕하세요. IDEC 연구원 조인신입니다.   IDEC 에서 지원하는 라이선스를 ..

조인신 21.08.10 21
2071 [답변] Virtuoso 실행 오류 문의

ported by cdsGetOABinPath.virtuoso: INFO: Note that OpenAccess (OA) requires runnin..

홍사라 21.08.10 10
2070 [답변] Virtuoso 실행 오류 문의

ported by cdsGetOABinPath.virtuoso: INFO: Note that OpenAccess (OA) requires runnin..

조인신 21.08.10 21
2069 [답변] Virtuoso 실행 오류 문의

ported by cdsGetOABinPath.virtuoso: INFO: Note that OpenAccess (OA) requires runnin..

홍사라 21.08.13 22
2068 [답변] Virtuoso 실행 오류 문의

ported by cdsGetOABinPath.virtuoso: INFO: Note that OpenAccess (OA) requires runnin..

조인신 21.08.13 18
2067 [답변] Virtuoso 실행 오류 문의

ported by cdsGetOABinPath.virtuoso: INFO: Note that OpenAccess (OA) requires runnin..

홍사라 21.08.13 20
2066 [답변] Virtuoso 실행 오류 문의

ported by cdsGetOABinPath.virtuoso: INFO: Note that OpenAccess (OA) requires runnin..

조인신 21.08.13 203
2065 Xcelium 2009메뉴얼 요청합니다

port.cadence.com > Tools > All products > Xcelium 경로대로 접속해서 자료를..

정현석 21.08.09 25
2064 [답변] Xcelium 2009메뉴얼 요청합니다

port.cadence.com > Tools > All products > Xcelium 경로대로 접속해서 자료를..

조인신 21.08.10 55
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1 e2l-접적회로-컴퓨터이용설계의 기초

port deadline-12/16 Final examination 키워드 : CAD, algorithm, complexity, optimi..

구재희 05.01.05 735
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구분 제목 작성자 작성일 조회
참여교수 성과 - IP LEA-128/192/256

ports three key lengths of 128, 192, and 256 bits. The LEA-128/192/256 IP perform..

신경욱 15.08.26 27
참여교수 성과 - IP LEA-128 Encryption/Decryption

port for encryption and decryption of 128-bit block cipher LEA - Support for key l..

신경욱 15.08.26 19
참여교수 성과 - IP LEA-128 Encryption

ports three key lengths of 128, 192, and 256 bits. The LEA128-Enc IP performs enc..

신경욱 15.08.26 20
참여교수 성과 - IP Census transform based adaptive support weight stereo matching IP

port weight stereo matching IP

문병인 15.08.25 38
공지사항 제23회 한국반도체학술대회 Chip Design Contest (CDC) 개최 (2016.02.23..

ported by the IDEC' 문구 삽입 ..

김하늘 15.11.09 7158
공지사항 JICAS(Vol1. No.2) 논문 모집 안내

JICAS 논문 모집 안내  반도체설계교육센터(IDEC)을 통해 매년 300여 개의 칩을 통..

이의숙 15.11.05 7386
참여교수 성과 - IP High Efficiency Current-Regulated Charge Pump for LED Driver

portant for a liquid crystal display (LCD) panel to get high quality display with l..

김철우 14.09.20 30
참여교수 성과 - IP 6Gbps injection locked CDR

portional to the jitter-tolerance performance. However, the injection strength can ..

김철우 14.09.20 20
공지사항 JICAS 논문 모집 안내

JICAS 논문 모집 안내   반도체설계교육센터(IDEC)을 통해 매년 300여 개의 칩을 ..

전항기 14.12.26 17588
참여교수 성과 - IP 4.5GHz Injection locked all-digital PLL

portional path and integral path to generate high quality clock and make overall lo..

김철우 14.09.20 17
참여교수 성과 - IP Tile-based Rasterizer for 3D graphics

portant, the amount of calculation in rasterization phase which is required to calc..

이광엽 14.09.18 34
공지사항 제22회 한국반도체학술대회 Chip Design Contest(CDC) 개최(2015.02.11(..

ported by the IDEC' 문구 삽입 시상 Award 명수상팀수내역Best Desig..

구재희 14.10.20 26913
공지사항 [채용공고] KAIST IDEC 행정원 채용 공고(신입/경력)

 KAIST IDEC 행정원 채용 공고(신입/경력)   반도체설계교육센터(..

석은주 14.09.16 19129
참여교수 성과 - IP AXI protocol converter

port all the operations required by the protocol

이찬호 14.09.02 16
참여교수 성과 - IP 8x8 AXI Interconnect

port operation with improved efficiency of the communication protocol. It also sup..

이찬호 14.09.02 21
구인/구직 (재)충북테크노파크 2014년 제5차 직원채용 공고

공고번호 : 충북TP-2014 - A7호(재)충북테크노파크 직원채용 공고 지역산업기술의 ..

전항기 15.01.08 5697
참여교수 성과 - IP A 12b 10MS/s 0.34mm2 2.0mW 0.11um CMOS SAR ADC

port : 없음(자체 보유한 Silicon Proven Report가 없음) 정보공유 여부 : N

이승훈 14.08.30 51
참여교수 성과 - IP A 14b 50MS/s 1.17mm2 146.1mW 0.13um CMOS ADC

port : 있음(File을 등록하지 않고, Provider의 승인/NDA 체결 후 전달하겠음) 정보공..

이승훈 14.08.30 9
참여교수 성과 - IP A 12b 100MS/s 1.34mm2 25.3mW 0.11um CMOS ADC

port : 있음(File을 등록하지 않고, Provider의 승인/NDA 체결 후 전달하겠음) 정보공..

이승훈 14.08.30 16
참여교수 성과 - IP A 12b 10MS/s 0.34mm2 2.4mW 0.11um CMOS SAR ADC

port : 있음(File을 등록하지 않고, Provider의 승인/NDA 체결 후 전달하겠음) 정보공..

이승훈 14.08.30 13
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