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  제목 강사정보 등록일
1 Verilog 언어를 활용한 FPGA 실습 서기범/교수/우송대학교 2015.10.29
교육자료
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질문/답변
  제목 작성자 작성일 조회
2023 [답변] 동부 180ns 공정 Back End 진행 중에 질문 있습니다.

port_filter_mode off -cell_master_filter_mode off -cell_instance_filter_mode off -v..

고광현 21.07.18 100
2022 [답변] Synopsys waveview 실행 오류

port logging. Use Flexera's13:38:32 (lmgrd) software license administration solutio..

이찬형 21.07.19 23
2021 [답변] Synopsys waveview 실행 오류

port logging. Use Flexera's13:38:32 (lmgrd) software license administration solutio..

조인신 21.07.19 8
2020 [답변] Synopsys waveview 실행 오류

port logging. Use Flexera's15:44:01 (lmgrd) software license administration solutio..

이찬형 21.07.19 45
2019 [답변] Synopsys waveview 실행 오류

port logging. Use Flexera's15:44:01 (lmgrd) software license administration solutio..

선혜승 21.07.19 25
2018 [답변] Synopsys waveview 실행 오류

port logging. Use Flexera's15:44:01 (lmgrd) software license administration solutio..

이찬형 21.07.20 17
2017 [답변] Synopsys waveview 실행 오류

port logging. Use Flexera's15:44:01 (lmgrd) software license administration solutio..

선혜승 21.07.20 38
2016 [답변] Synopsys waveview 실행 오류

port logging. Use Flexera's15:44:01 (lmgrd) software license administration solutio..

이찬형 21.07.19 122
2015 [본센터] 정원초과 과목 수강신청 관련

  안녕하세요.   금일 수강신청 open 된 [Synopsys] 반도체 공정/소자 시..

유송길 21.07.15 24
2014 [본센터] [답변] 정원초과 과목 수강신청 관련

안녕하세요. 저희 Zoom 라이선스 제약상 300명이 최대 수강할수 있습니다. 양해를 부탁..

김영지 21.07.15 40
2013 Merge 후 LVS check

port 인데 동일한 name 을 가지고 있다면서 open circuit 이라고 인식을 하는 것 같습니..

박현철 21.07.13 92
2012 [답변] Merge 후 LVS check

port 인데 동일한 name 을 가지고 있다면서 open circuit 이라고 인식을 하는 것 같습니..

선혜승 21.07.13 71
2011 [답변] Merge 후 LVS check

port 인데 동일한 name 을 가지고 있다면서 open circuit 이라고 인식을 하는 것 같습니..

박현철 21.07.14 32
2010 [답변] Merge 후 LVS check

port 인데 동일한 name 을 가지고 있다면서 open circuit 이라고 인식을 하는 것 같습니..

선혜승 21.07.14 122
2009 [SS28-2101] CADENCE Virtuoso license 관련 질문

ported Linux configuration.2021/07/10 18:28:39 For more info, please run CheckSysCo..

김동규 21.07.10 63
2008 [답변] [SS28-2101] CADENCE Virtuoso license 관련 질문

ported Linux configuration.2021/07/10 18:28:39 For more info, please run CheckSysCo..

조인신 21.07.12 72
2007 Cadence virtuoso 툴 ADE XL 오류 관련 질문입니다.

ported linux configuration] 에러메시지가 뜹니다. 그래서 IC618 버전을 다운받아서 시..

김우영 21.07.09 43
2006 [답변] Cadence virtuoso 툴 ADE XL 오류 관련 질문입니다.

ported linux configuration 는 에러가 아닙니다. WARNING 입니다. CentOS 를 사용하..

조인신 21.07.09 23
2005 [답변] Cadence virtuoso 툴 ADE XL 오류 관련 질문입니다.

ported linux configuration 는 에러가 아닙니다. WARNING 입니다. CentOS 를 사용하..

김우영 21.07.09 12
2004 [답변] Cadence virtuoso 툴 ADE XL 오류 관련 질문입니다.

ported linux configuration 는 에러가 아닙니다. WARNING 입니다. CentOS 를 사용하..

조인신 21.07.09 64
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1 e2l-접적회로-컴퓨터이용설계의 기초

port deadline-12/16 Final examination 키워드 : CAD, algorithm, complexity, optimi..

구재희 05.01.05 735
1
기타 게시판
구분 제목 작성자 작성일 조회
참여교수 성과 - IP A high efficiency PWM DC-DC buck converter with 2.7V to 4.2V supply ..

port : 있음(File을 등록하지 않고, Provider의 승인/NDA 체결 후 전달하겠음) 정보공..

이승훈 14.08.30 25
참여교수 성과 - IP A 10b 10MS/s 0.26mm2 2.3mW 0.11um CMOS SAR ADC

port : 있음(File을 등록하지 않고, Provider의 승인/NDA 체결 후 전달하겠음) 정보공..

이승훈 14.08.30 15
참여교수 성과 - IP A 18W Stereo Class-D Audio Output Power Stage for a DTV Application

port : 있음(File을 등록하지 않고, Provider의 승인/NDA 체결 후 전달하겠음) 정보공..

이승훈 14.08.30 13
참여교수 성과 - IP A 14b 100MS/s 1.20mm2 78.4mW 0.13um CMOS ADC

port : 있음(File을 등록하지 않고, Provider의 승인/NDA 체결 후 전달하겠음) 정보공..

이승훈 14.08.30 18
참여교수 성과 - IP A 12b 100MS/s 0.43mm2 29.8mW 45nm CMOS ADC

port : 있음(File을 등록하지 않고, Provider의 승인/NDA 체결 후 전달하겠음) 정보공..

이승훈 14.08.30 14
참여교수 성과 - IP A 10b 50MS/s 0.23mm2 17.5mW 90nm CMOS ADC

port : 있음(File을 등록하지 않고, Provider의 승인/NDA 체결 후 전달하겠음) 정보공..

이승훈 14.08.30 15
참여교수 성과 - IP A 11b 150MS/s 2.42mm2 46.8mW 0.13um CMOS Pipelined SAR ADC

port : 있음(File을 등록하지 않고, Provider의 승인/NDA 체결 후 전달하겠음) 정보공..

이승훈 14.08.30 13
참여교수 성과 - IP A 10b 150MS/s 0.40mm2 47.3mW 45nm CMOS A/D Converter

port : 있음(File을 등록하지 않고, Provider의 승인/NDA 체결 후 전달하겠음) 정보공..

이승훈 14.08.30 25
구인/구직 소프트웨어정책연구소 연구원 초빙 공고

소프트웨어 중심 사회를 선도할 국책연구소로 출범하는소프트웨어정책연구소에서는 SW정..

전항기 14.01.13 3542
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