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  제목 강사정보 등록일
1 Verilog 언어를 활용한 FPGA 실습 서기범/교수/우송대학교 2015.10.29
교육자료
  제목 작성자 작성일 조회
질문/답변
  제목 작성자 작성일 조회
1983 [답변] DB180-2101 LVS관련 문의

port 하는 경향이 있습니다   function 적으로 Q 만 사용하기 때문에  Q..

선혜승 21.07.05 26
1982 [답변] DB180-2101 LVS관련 문의

port 하는 경향이 있습니다   function 적으로 Q 만 사용하기 때문에  Q..

한창선 21.07.06 18
1981 [답변] DB180-2101 LVS관련 문의

port 하는 경향이 있습니다   function 적으로 Q 만 사용하기 때문에  Q..

조인신 21.07.06 60
1980 Cadence Support 웹사이트 접근 관련입니다.

port 웹사이트 (support#cadence#com)의 접근 권한이 며칠 전의 라이센스 갱신과 함께 사..

서진오 21.07.05 21
1979 [답변] Cadence Support 웹사이트 접근 관련입니다.

port 웹사이트 계정 관련 문의는 universityprogram@cadence.com 로 부탁드리..

이경옥 21.07.05 31
1978 waveview tool 활용 관련 문의드립니다.

port기능으로 텍스트파일을 추출하고   윈도우 환경에서 cmd를 실행하고 scp명령..

백승조 21.07.05 19
1977 [답변] waveview tool 활용 관련 문의드립니다.

port기능으로 텍스트파일을 추출하고   윈도우 환경에서 cmd를 실행하고 scp명령..

조인신 21.07.05 16
1976 [답변] SYNOPSYS license 문의

port number) 이렇게 말입니다      감사합니다     ..

선혜승 21.07.04 38
1975 [답변] SYNOPSYS license 문의

port number) 이렇게 말입니다      감사합니다     ..

조인신 21.07.06 44
1974 Hierarchical Design TOP 설계시 drc violation

port 인 .A 쪽의 신호에 buffer 를 삽입해 보았습니다.   그러나 이와 같은 방법..

박현철 21.07.02 39
1973 [답변] Hierarchical Design TOP 설계시 drc violation

port 인 .A 쪽의 신호에 buffer 를 삽입해 보았습니다.   그러나 이와 같은 방법..

선혜승 21.07.02 22
1972 [답변] Hierarchical Design TOP 설계시 drc violation

port 인 .A 쪽의 신호에 buffer 를 삽입해 보았습니다.   그러나 이와 같은 방법..

박현철 21.07.02 95
1971 [답변] cadence install error

ported Linux configuration.2021/07/02 17:36:30 For more info, please run CheckSysCo..

조인신 21.07.02 33
1970 [답변] Dummy metal 관련

  IDEC 선혜승입니다     EXCLUDE 를 쓰면  DUMMY 제거는 ..

선혜승 21.07.02 8
1969 [답변] Dummy metal 관련

   답변 감사합니다!~~    [선혜승]님의 글 ===================..

방현태 21.07.02 49
1968 라이센스 연결오류 관련

안녕하십니까, 경북대학교 송대건 교수님연구실의 고종현입니다. 이번 시높시스 라이센..

고종현 21.07.01 70
1967 [답변] 라이센스 연결오류 관련

  IDEC 선혜승입니다     데몬 버전도 저희와 동일하고  ..

선혜승 21.07.01 52
1966 [답변] 라이센스 연결오류 관련

   안녕하십니까, 선혜승 연구원님. 빠른 답변 감사드립니다.   말씀..

고종현 21.07.01 68
1965 [답변] 라이센스 연결오류 관련

   IDEC 선혜승입니다     설정상 특이사항이 없네요 ..

선혜승 21.07.01 15
1964 [답변] 라이센스 연결오류 관련

안녕하십니까, 연구원님.   안내해주신 대로 진행하였으나 여전히 문제가 발생하..

고종현 21.07.01 22
자료실
  제목 작성자 작성일 조회
1 e2l-접적회로-컴퓨터이용설계의 기초

port deadline-12/16 Final examination 키워드 : CAD, algorithm, complexity, optimi..

구재희 05.01.05 735
1
기타 게시판
구분 제목 작성자 작성일 조회
참여교수 성과 - IP LEA-128/192/256

ports three key lengths of 128, 192, and 256 bits. The LEA-128/192/256 IP perform..

신경욱 15.08.26 27
참여교수 성과 - IP LEA-128 Encryption/Decryption

port for encryption and decryption of 128-bit block cipher LEA - Support for key l..

신경욱 15.08.26 19
참여교수 성과 - IP LEA-128 Encryption

ports three key lengths of 128, 192, and 256 bits. The LEA128-Enc IP performs enc..

신경욱 15.08.26 20
참여교수 성과 - IP Census transform based adaptive support weight stereo matching IP

port weight stereo matching IP

문병인 15.08.25 38
공지사항 제23회 한국반도체학술대회 Chip Design Contest (CDC) 개최 (2016.02.23..

ported by the IDEC' 문구 삽입 ..

김하늘 15.11.09 7158
공지사항 JICAS(Vol1. No.2) 논문 모집 안내

JICAS 논문 모집 안내  반도체설계교육센터(IDEC)을 통해 매년 300여 개의 칩을 통..

이의숙 15.11.05 7387
참여교수 성과 - IP High Efficiency Current-Regulated Charge Pump for LED Driver

portant for a liquid crystal display (LCD) panel to get high quality display with l..

김철우 14.09.20 30
참여교수 성과 - IP 6Gbps injection locked CDR

portional to the jitter-tolerance performance. However, the injection strength can ..

김철우 14.09.20 20
공지사항 JICAS 논문 모집 안내

JICAS 논문 모집 안내   반도체설계교육센터(IDEC)을 통해 매년 300여 개의 칩을 ..

전항기 14.12.26 17589
참여교수 성과 - IP 4.5GHz Injection locked all-digital PLL

portional path and integral path to generate high quality clock and make overall lo..

김철우 14.09.20 17
참여교수 성과 - IP Tile-based Rasterizer for 3D graphics

portant, the amount of calculation in rasterization phase which is required to calc..

이광엽 14.09.18 34
공지사항 제22회 한국반도체학술대회 Chip Design Contest(CDC) 개최(2015.02.11(..

ported by the IDEC' 문구 삽입 시상 Award 명수상팀수내역Best Desig..

구재희 14.10.20 26913
공지사항 [채용공고] KAIST IDEC 행정원 채용 공고(신입/경력)

 KAIST IDEC 행정원 채용 공고(신입/경력)   반도체설계교육센터(..

석은주 14.09.16 19129
참여교수 성과 - IP AXI protocol converter

port all the operations required by the protocol

이찬호 14.09.02 16
참여교수 성과 - IP 8x8 AXI Interconnect

port operation with improved efficiency of the communication protocol. It also sup..

이찬호 14.09.02 21
구인/구직 (재)충북테크노파크 2014년 제5차 직원채용 공고

공고번호 : 충북TP-2014 - A7호(재)충북테크노파크 직원채용 공고 지역산업기술의 ..

전항기 15.01.08 5697
참여교수 성과 - IP A 12b 10MS/s 0.34mm2 2.0mW 0.11um CMOS SAR ADC

port : 없음(자체 보유한 Silicon Proven Report가 없음) 정보공유 여부 : N

이승훈 14.08.30 51
참여교수 성과 - IP A 14b 50MS/s 1.17mm2 146.1mW 0.13um CMOS ADC

port : 있음(File을 등록하지 않고, Provider의 승인/NDA 체결 후 전달하겠음) 정보공..

이승훈 14.08.30 9
참여교수 성과 - IP A 12b 100MS/s 1.34mm2 25.3mW 0.11um CMOS ADC

port : 있음(File을 등록하지 않고, Provider의 승인/NDA 체결 후 전달하겠음) 정보공..

이승훈 14.08.30 16
참여교수 성과 - IP A 12b 10MS/s 0.34mm2 2.4mW 0.11um CMOS SAR ADC

port : 있음(File을 등록하지 않고, Provider의 승인/NDA 체결 후 전달하겠음) 정보공..

이승훈 14.08.30 13
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