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  제목 강사정보 등록일
1 Verilog 언어를 활용한 FPGA 실습 서기범/교수/우송대학교 2015.10.29
교육자료
  제목 작성자 작성일 조회
질문/답변
  제목 작성자 작성일 조회
1803 [답변] pad_TOP front-end 작업 관련 문의

port 중 일부입니다. fanout이 큰 U42 buffer 와 dont touch로 설정된 하위 design 내부..

선혜승 21.02.16 14
1802 [답변] pad_TOP front-end 작업 관련 문의

port 중 일부입니다. fanout이 큰 U42 buffer 와 dont touch로 설정된 하위 design 내부..

문승현 21.02.16 110
1801 [답변] license for the Virtuoso(R) Spectre-RF option관련 문의입니다.

port에 인가하여 설계하는 회로에 포함시켰는데, 이것을 제거하고 pss simulation을 하면..

임현웅 20.12.22 9
1800 [답변] license for the Virtuoso(R) Spectre-RF option관련 문의입니다.

port에 인가하여 설계하는 회로에 포함시켰는데, 이것을 제거하고 pss simulation을 하면..

조인신 20.12.22 20
1799 [답변] Cloud server ICC2 관련

port_utilization 해보시기 바랍니다   답으로 나온 값이 0.5-0.7 즉 50-70% ..

선혜승 20.12.21 6
1798 [답변] Cloud server ICC2 관련

port_utilization한 결과 0.236으로 나왔습니다. blockage는 메모리들을 쓰고 있어서 그..

문승식 20.12.21 8
1797 [답변] Cloud server ICC2 관련

port_utilization한 결과 0.236으로 나왔습니다. blockage는 메모리들을 쓰고 있어서 그..

선혜승 20.12.21 6
1796 [답변] Cloud server ICC2 관련

port_utilization한 결과 0.236으로 나왔습니다. blockage는 메모리들을 쓰고 있어서 그..

문승식 20.12.21 25
1795 [답변] [Cadence Calibre PEX] Rule load하는 과정에서 error가 발생하여 문의드립..

port 를 선택하면 뜨는 창에서 Include File 부분에 추가해야하는 파일입니다. 이 때 ..

조인신 20.12.16 28
1794 [답변] [Cadence Calibre PEX] Rule load하는 과정에서 error가 발생하여 문의드립..

port 를 선택하면 뜨는 창에 추가해주었구요!. 그렇게 하고 load 하려 했지만 rcx 파일..

허재훈 20.12.16 25
1793 [답변] [Cadence Calibre PEX] Rule load하는 과정에서 error가 발생하여 문의드립..

port 를 선택하면 뜨는 창에 추가해주었구요!. 그렇게 하고 load 하려 했지만 rcx 파일..

조인신 20.12.16 15
1792 [답변] [Cadence Calibre PEX] Rule load하는 과정에서 error가 발생하여 문의드립..

port 를 선택하면 뜨는 창에 추가해주었구요!. 그렇게 하고 load 하려 했지만 rcx 파일..

허재훈 20.12.16 81
1791 PDK 설치 오류 문의

port GUI modematch library name:tsmc18Total Case Selection:4*Available types of HRI..

김태수 20.12.10 40
1790 [답변] PDK 설치 오류 문의

port GUI modematch library name:tsmc18Total Case Selection:4*Available types of HRI..

조인신 20.12.11 47
1789 [답변] Cadence 가입 관련 문의드립니다.

port 및 Online training course 사용을 위해 가입 시 홈페이지를 통해 직접 ..

이경옥 20.12.04 59
1788 PEX 관련 질문있습니다

안녕하세요 충북대학교 홍종필 교수님 연구실입니다.   현재 삼성 28nm 공정에 ..

김재우 20.12.03 61
1787 [답변] PEX 관련 질문있습니다

    IDEC 선혜승입니다     VI 로 작업하시고 저장할때&nb..

선혜승 20.12.03 92
1786 [답변] EDA Tool license 오류

port SNPLMD_LICENSE_FILE=26585@143.248.175.155 로만 하시고 export LM_LICENSE_..

조인신 20.11.23 14
1785 [답변] EDA Tool license 오류

port SNPLMD_LICENSE_FILE=26585@143.248.175.155 로만 하시고 export LM_LICENSE_..

김정훈 20.11.23 27
1784 TCAD sentaurus license 설치 및 실행 관련

port number가 사용중이라하여 daemon 실행 종료 이후 실행하여도 계속 동일한 문제가 생..

김동훈 20.11.19 78
자료실
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1 e2l-접적회로-컴퓨터이용설계의 기초

port deadline-12/16 Final examination 키워드 : CAD, algorithm, complexity, optimi..

구재희 05.01.05 735
1
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참여교수 성과 - 특허 Delay Circuit And Duty Cycle Controller Including The Same

Delay Cirtuit And Duty Cycle Controller Including The Same

김수환 20.02.04 11
참여교수 성과 - 특허 Duty Cycle Detector And Phase Difference Detector

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김수환 20.02.04 5
참여교수 성과 - 논문 A Contact-Based Data Communication Technique Using Capacitive Touch ..

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신경욱 20.01.17 17
참여교수 성과 - 특허 PROCESSOR IN MEMORY SUPportING BINARY CONVOLUTION OPERATION AND METH..

국제 특허 출원

박종선 20.01.14 5
참여교수 성과 - 논문 Computational Design of Highly Efficient and Robust Hole Transport L..

홍기하 20.01.13 12
참여교수 성과 - 논문 A 2.4-GHz Dual-Mode CMOS Power Amplifier with a Bypass Structure Usi..

박창근 19.10.22 8
공지사항 (중요!) ISOCC 2019 CDC 포스터 접수 안내 (~07.26 마감)

IC Design Education Center (IDEC)   ISOCC 2019 Chip Design ..

김영지 19.06.19 16046
공지사항 [홍보] 2019 SiFive 기술 심포지엄(2019.06.17-18, KAIST 학술문화관, 한..

IC Design Education Center(IDEC)   [홍보] 2019 SiFive 기술 ..

이의숙 19.06.07 14189
참여교수 성과 - 논문 Cohesive Techniques for Cell Layout Optimization Supporting 2D Metal..

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참여교수 성과 - 논문 Low Power TCAM Based Search Engine Supporting Non-volatile Memory Ce..

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참여교수 성과 - 논문 A New FPGA Implementation of a Time-to-Digital Converter Supporting ..

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참여교수 성과 - 논문 A Compact Multiple Notched Ultra-Wide Band Antenna with an Analysis ..

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장영찬 18.11.06 4
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