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| 제목 | 강사정보 | 등록일 | |
|---|---|---|---|
| 1 | Verilog 언어를 활용한 FPGA 실습 | 서기범/교수/우송대학교 | 2015.10.29 |
교육자료
| 제목 | 작성자 | 작성일 | 조회 |
|---|
질문/답변
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 623 |
[신경욱] 작업 PC로 라이센스로 적용시키는 방법에 대해 문의드립니다.
port DesignCompiler=/usr/tools/DesignCompiler export LM_LICENSE_FILE=27020@localho.. |
이상현 | 18.04.09 | 11 |
| 622 |
[답변] 작업 PC로 라이센스로 적용시키는 방법에 대해 문의드립니다.
port DesignCompiler=/usr/tools/DesignCompiler export LM_LICENSE_FILE=27020@localho.. |
선혜승 | 18.04.09 | 15 |
| 621 |
[김준엽] Cadence 신청과 Calibre 라이센스 관련질문 입니다.
port 설계 pdf 파일 등을 얻기위해 계정을 얻고싶은데 어떻게해야하는지 여쭤봅니다. |
김진우 | 18.04.03 | 20 |
| 620 |
[답변] Cadence 신청과 Calibre 라이센스 관련질문 입니다.
port 설계 pdf 파일 등을 얻기위해 계정을 얻고싶은데 어떻게해야하는지 여쭤봅니다. |
석은주 | 18.04.03 | 18 |
| 619 |
[범진욱] cadence 홈페이지 가입시 license 관련
port 설계 pdf 파일 등을 얻고싶어서 cadence 아이디를 가입하려고 합니다. license ho.. |
이정빈 | 18.04.02 | 37 |
| 618 |
[답변] cadence 홈페이지 가입시 license 관련
port는 작년 User수가 많은 10개 대학 중 Support 접속 권한 신청 연구실만 접속 권한이.. |
석은주 | 18.04.03 | 65 |
| 617 |
[답변] MIXED layout LVS error 관련 문의
port 로 지정해주면 됩니다. [노진섭 ]님의글 ===============================.. |
조인신 | 18.03.19 | 47 |
| 616 |
[지동우] MIXED layout LVS error 관련 문의
port로 지정) 디지털 회로 PNR(design compiler & Astro 사용)을 한 layout에도 err.. |
노진섭 | 18.03.19 | 46 |
| 615 |
[답변] Cadence Innovus에서 CTS 실행 중 limited access feature문제
port가 필요하다고 합니다. CTS와 관련된 엔진을 이용하기 위해선 setLimitedAcces.. |
선혜승 | 18.03.19 | 9 |
| 614 |
[답변] [답변] Cadence Innovus에서 CTS 실행 중 limited access feature문제
port가 필요하다고 합니다. CTS와 관련된 엔진을 이용하기 위해선 setLimitedAcces.. |
김현규 | 18.03.19 | 15 |
| 613 |
[답변] [답변] [답변] Cadence Innovus에서 CTS 실행 중 limited access feature문제
port가 필요하다고 합니다. CTS와 관련된 엔진을 이용하기 위해선 setLimitedAcces.. |
선혜승 | 18.03.19 | 16 |
| 612 |
[최우영] Cadence Innovus에서 CTS 실행 중 limited access feature문제
port가 필요하다고 합니다. CTS와 관련된 엔진을 이용하기 위해선 setLimitedAcces.. |
김현규 | 18.03.19 | 22 |
| 611 |
[답변] Post-sim중 에러 질문있습니다.
안녕하세요. IDEC 연구원 조인신입니다. 해당 문제는 PIN 또는 port .. |
조인신 | 18.03.12 | 22 |
| 610 |
[답변] [답변] Post-sim중 에러 질문있습니다.
대문자로 바꾸어서 po-sim을 진행하였습니다. DRC, LVS, PEX를 진행하고 문제가 없이 진.. |
고기영 | 18.03.12 | 10 |
| 609 |
[답변] [답변] [답변] Post-sim중 에러 질문있습니다.
출력이 나오지 않는 것이 무슨 의미 인지 파악이 안됩니다. Po-sim 을 했을 때 입.. |
조인신 | 18.03.12 | 7 |
| 608 |
[답변] [답변] [답변] [답변] Post-sim중 에러 질문있습니다.
출력 값이 0으로 나오고 있습니다. 혹시 해서 IDEC Library에 있는 inverter를 .. |
고기영 | 18.03.12 | 9 |
| 607 |
[답변] [답변] [답변] [답변] [답변] Post-sim중 에러 질문있습니다.
우선 사용하고 있는 tool 들의 버전부터 확인 바랍니다. 아래 권장 버전과 되도록이면 .. |
조인신 | 18.03.12 | 9 |
| 606 |
[답변] [답변] [답변] [답변] [답변] [답변] Post-sim중 에러 질문있습니다.
사용하고 있는 Tool 버전은 다음과 같습니다. virtuoso : IC6.1.6-64b.500.14 MMSIM : .. |
고기영 | 18.03.12 | 11 |
| 605 |
[답변] [답변] [답변] [답변] [답변] [답변] [답변] Post-sim중 에러 질문있습니다.
제공하는 파일 중 PEX rule 파일인 Calibre_HL18G_XRC_S3.7_b.rule 의 .. |
조인신 | 18.03.12 | 14 |
| 604 |
[답변] Post-sim중 에러 질문있습니다.
Rule파일을 가이드대로 수정하고 include 파일도 수정하였습니다. 이후 config하고 ADE.. |
고기영 | 18.03.12 | 15 |
자료실
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 1 |
e2l-접적회로-컴퓨터이용설계의 기초
port deadline-12/16 Final examination 키워드 : CAD, algorithm, complexity, optimi.. |
구재희 | 05.01.05 | 735 |
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기타 게시판
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ports the 224-bit ECC over GF(p) and the 2,048-bit RSA defined by NIST Std. FIPS PU.. |
신경욱 | 18.10.29 | 33 |
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ARIA-GCM Authenticated Encryption Core IP
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신경욱 | 18.10.29 | 23 |
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신경욱 | 18.10.29 | 28 |
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2018 XUP(Xilinx University Program) Professor Workshop Invitation
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석은주 | 18.10.19 | 47893 |
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ECC-P224 core
port 224-bit elliptic curve over prime field defined by NIST - Support for private.. |
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| 참여교수 성과 - IP |
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신경욱 | 17.10.24 | 60 |
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ISOCC 2018 call for paper
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김하늘 | 18.06.29 | 40191 |
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[한국반도체학술대회] '제 2회 강대원상'의 주인공을 찾습니다! (신청 마..
『제 25회 한국반도체학술대회』 The 25th Korean Conference on Semiconductors 2018.. |
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김종선 | 15.09.05 | 5 |
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All-digital Fractional-ratio Frequency Multiplying Delay-Locked Loop
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김종선 | 15.09.05 | 11 |
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Displayport v1.2a Receiver PHY
Displayport v1.2a Receiver PHY |
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LPDDR Memory Controller
port 100MHz speed grades of LPDDR devices. It is designed using Verilog-HDL and ver.. |
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