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  제목 강사정보 등록일
1 Verilog 언어를 활용한 FPGA 실습 서기범/교수/우송대학교 2015.10.29
교육자료
  제목 작성자 작성일 조회
질문/답변
  제목 작성자 작성일 조회
363 [답변] MS18_1701 post simulation 중

port name 을 모두 소문자로 했을 경우 calibre 에서 PEX 시 제대로 추출이 안됩니다. ..

조인신 17.02.23 28
362 [답변] [답변] MS18_1701 post simulation 중

port name 을 모두 소문자로 했을 경우 calibre 에서 PEX 시 제대로 추출이 안됩니다. ..

최요한 17.02.23 12
361 [답변] [답변] [답변] MS18_1701 post simulation 중

port name 을 모두 소문자로 했을 경우 calibre 에서 PEX 시 제대로 추출이 안됩니다. ..

조인신 17.02.23 47
360 [답변] hspice 라이센스 관련문의

port 가 설정되어야 합니다. 데몬이 정상적으로 구동 중인지 IP 와 port..

조인신 17.02.06 10
359 [답변] [답변] [답변] 리눅스 툴 설치 문의드립니다.

port HSPICE_HOME=/hspice설치폴더 처럼 내용을 적어야 합니다. 터미널 창에서 csh 로 ..

조인신 17.02.02 3
358 [답변] [답변] [답변] [답변] 리눅스 툴 설치 문의드립니다.

port HSPICE_HOME=/hspice설치폴더 처럼 내용을 적어야 합니다. 터미널 창에서 csh 로 ..

양이삭 17.02.02 2
357 [답변] [답변] [답변] [답변] [답변] 리눅스 툴 설치 문의드립니다.

port HSPICE_HOME=/hspice설치폴더 처럼 내용을 적어야 합니다. 터미널 창에서 csh 로 ..

조인신 17.02.02 3
356 [답변] [답변] [답변] [답변] [답변] [답변] 리눅스 툴 설치 문의드립니다.

port HSPICE_HOME=/hspice설치폴더 처럼 내용을 적어야 합니다. 터미널 창에서 csh 로 ..

양이삭 17.02.02 3
355 [답변] [답변] [답변] [답변] [답변] [답변] [답변] 리눅스 툴 설치 문의드립니다.

port HSPICE_HOME=/hspice설치폴더 처럼 내용을 적어야 합니다. 터미널 창에서 csh 로 ..

조인신 17.02.02 3
354 [답변] [답변] [답변] [답변] [답변] [답변] [답변] [답변] 리눅스 툴 설치 문의드..

port HSPICE_HOME=/hspice설치폴더 처럼 내용을 적어야 합니다. 터미널 창에서 csh 로 ..

양이삭 17.02.02 6
353 [답변] [답변] [답변] [답변] [답변] [답변] [답변] [답변] [답변] 리눅스 툴 설치 ..

port HSPICE_HOME=/hspice설치폴더 처럼 내용을 적어야 합니다. 터미널 창에서 csh 로 ..

조인신 17.02.02 4
352 [답변] [답변] [답변] [답변] [답변] [답변] [답변] [답변] [답변] [답변] 리눅스 ..

port HSPICE_HOME=/hspice설치폴더 처럼 내용을 적어야 합니다. 터미널 창에서 csh 로 ..

양이삭 17.02.02 22
351 [전동석] PEX관련하여 에러가 발생하여 문의드립니다.

port시키는 과정에서 에러가 발생합니다.  calibreview setup 과 calview.log를 첨..

신광현 17.01.19 14
350 [답변] PEX관련하여 에러가 발생하여 문의드립니다.

port시키는 과정에서 에러가 발생합니다.  calibreview setup 과 calview.log를 첨..

조인신 17.01.19 10
349 [답변] [답변] PEX관련하여 에러가 발생하여 문의드립니다.

port시키는 과정에서 에러가 발생합니다.  calibreview setup 과 calview.log를 첨..

신광현 17.01.19 8
348 [답변] [답변] [답변] PEX관련하여 에러가 발생하여 문의드립니다.

port시키는 과정에서 에러가 발생합니다.  calibreview setup 과 calview.log를 첨..

조인신 17.01.19 13
347 [답변] Cadence 관련하여 질문이 있습니다.

port CDS_INST_DIR 만 변경해주면 됩니다. 그리고, .cdsinit 와 .cdsenv 는 복사를 하지..

조인신 17.01.18 21
346 [답변] Virtuoso re-scale the chip ring

ported on IC61   Thank you    [TRANG ]님의글 ==============..

선혜승 17.01.11 2
345 [윤상웅] 삼성65nm 공정 질문

port와 checklist 는 지도교수님과 각 참여학생들의 서명을 받아 스캔본을 업로드 하는 ..

임주환 17.01.09 21
344 [답변] 삼성65nm 공정 질문

port와 checklist 는 지도교수님과 각 참여학생들의 서명을 받아 스캔본을 업로드 하는 ..

선혜승 17.01.09 42
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1 e2l-접적회로-컴퓨터이용설계의 기초

port deadline-12/16 Final examination 키워드 : CAD, algorithm, complexity, optimi..

구재희 05.01.05 735
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ports the 224-bit ECC over GF(p) and the 2,048-bit RSA defined by NIST Std. FIPS PU..

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ports five modes of operation of ARIA including ECB, CBC, OFB, CTR and CFB, and sup..

신경욱 18.10.29 23
참여교수 성과 - IP AES-GCM Authenticated Encryption Core IP

ports CTR mode of operation of AES and two key sizes of 128-bit and 256-bit for enc..

신경욱 18.10.29 28
공지사항 2018 XUP(Xilinx University Program) Professor Workshop Invitation

port/university/workshops/korea-registration-form.html     &nb..

석은주 18.10.19 47893
참여교수 성과 - IP ECC-P224 core

port 224-bit elliptic curve over prime field defined by NIST - Support for private..

신경욱 17.10.24 82
참여교수 성과 - IP ECC-B233 core

port 233-bit elliptic curve over binary field defined by NIST - Support for privat..

신경욱 17.10.24 60
공지사항 ISOCC 2018 call for paper

portant Dates : □ Submission of Special Session and Tutorial Proposals: June 22, 2..

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개설 희망 강좌 신청 low drop-out regulator 설계 관련 강의가 열렸으면 좋겠습니다.

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참여교수 성과 - IP Multi-phase Fractional-ratio Frequency Multiplying Delay-Locked Loop

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김종선 15.09.05 5
참여교수 성과 - IP All-digital Fractional-ratio Frequency Multiplying Delay-Locked Loop

portability. Implemented in a 65nm 1.0-V CMOS process, the proposed clock generato..

김종선 15.09.05 11
참여교수 성과 - IP Displayport v1.2a Receiver PHY

Displayport v1.2a Receiver PHY

김철우 15.09.03 20
참여교수 성과 - 논문 시그마 델타 변조를 이용한 HDMI 표준의 Display port 오디오 타임스탬프..

강진구 14.09.03 15
참여교수 성과 - 특허 Antenna device for a portable terminal

적층기판 환경에서 구성한 소형 LC loaded 안테나

김문일 14.09.15 3
참여교수 성과 - IP LPDDR Memory Controller

port 100MHz speed grades of LPDDR devices. It is designed using Verilog-HDL and ver..

이찬호 15.08.27 18
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