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| 제목 | 강사정보 | 등록일 | |
|---|---|---|---|
| 1 | Verilog 언어를 활용한 FPGA 실습 | 서기범/교수/우송대학교 | 2015.10.29 |
교육자료
| 제목 | 작성자 | 작성일 | 조회 |
|---|
질문/답변
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 2723 |
[답변] 28nm MPW 소자 spec 관련 문의드립니다.
port 이라는 것을 명시해주기 있는 layer 입니다. 실제로 만들어지는 layer 는 아.. |
조인신 | 23.06.27 | 17 |
| 2722 |
[답변] 28nm MPW 소자 spec 관련 문의드립니다.
port 이라는 것을 명시해주기 있는 layer 입니다. 실제로 만들어지는 layer 는 아.. |
장진엽 | 23.06.29 | 20 |
| 2721 |
[답변] 28nm MPW 소자 spec 관련 문의드립니다.
port VNCAP 으로 LVS 시에만 필요한 layer 입니다. 별도의 기능은 없습니다. &nb.. |
조인신 | 23.06.29 | 8 |
| 2720 |
[답변] 28nm MPW 소자 spec 관련 문의드립니다.
port VNCAP 으로 LVS 시에만 필요한 layer 입니다. 별도의 기능은 없습니다. &nb.. |
장진엽 | 23.06.30 | 24 |
| 2719 |
[답변] 28nm MPW 소자 spec 관련 문의드립니다.
port VNCAP 으로 LVS 시에만 필요한 layer 입니다. 별도의 기능은 없습니다. &nb.. |
조인신 | 23.06.30 | 12 |
| 2718 |
[답변] 28nm MPW 소자 spec 관련 문의드립니다.
port VNCAP 으로 LVS 시에만 필요한 layer 입니다. 별도의 기능은 없습니다. &nb.. |
장진엽 | 23.06.30 | 6 |
| 2717 |
[답변] 28nm MPW 소자 spec 관련 문의드립니다.
port VNCAP 으로 LVS 시에만 필요한 layer 입니다. 별도의 기능은 없습니다. &nb.. |
조인신 | 23.06.30 | 86 |
| 2716 |
[답변] Virtuoso에서 custom한 block을 .lib형태로 추출하는 방법관련 질문드립니다..
port 가 아니라 LVS 를 진행해도 가능합니다 LVS 시, schematic 에 .. |
선혜승 | 23.06.26 | 35 |
| 2715 |
[답변] Virtuoso에서 custom한 block을 .lib형태로 추출하는 방법관련 질문드립니다..
port 가 아니라 LVS 를 진행해도 가능합니다 LVS 시, schematic 에 .. |
신정민 | 23.06.26 | 65 |
| 2714 |
Cadence Virtuoso 라이센스 관련 질문 드립니다.
port for assistance. 와 같은 에러를 출력하며 잠시 프로그램이 실행되었다가 꺼지고 .. |
백종민 | 23.06.26 | 62 |
| 2713 |
[답변] Cadence Virtuoso 라이센스 관련 질문 드립니다.
port for assistance. 와 같은 에러를 출력하며 잠시 프로그램이 실행되었다가 꺼지고 .. |
선혜승 | 23.06.26 | 42 |
| 2712 |
[답변] Cadence Virtuoso 라이센스 관련 질문 드립니다.
port for assistance. 와 같은 에러를 출력하며 잠시 프로그램이 실행되었다가 꺼지고 .. |
백종민 | 23.06.26 | 24 |
| 2711 |
[답변] Cadence Virtuoso 라이센스 관련 질문 드립니다.
port for assistance. 와 같은 에러를 출력하며 잠시 프로그램이 실행되었다가 꺼지고 .. |
선혜승 | 23.06.26 | 17 |
| 2710 |
[답변] Cadence Virtuoso 라이센스 관련 질문 드립니다.
port for assistance. 와 같은 에러를 출력하며 잠시 프로그램이 실행되었다가 꺼지고 .. |
백종민 | 23.06.26 | 20 |
| 2709 |
[답변] Cadence Virtuoso 라이센스 관련 질문 드립니다.
port for assistance. 와 같은 에러를 출력하며 잠시 프로그램이 실행되었다가 꺼지고 .. |
백종민 | 23.06.26 | 14 |
| 2708 |
[답변] Cadence Virtuoso 라이센스 관련 질문 드립니다.
port for assistance. 와 같은 에러를 출력하며 잠시 프로그램이 실행되었다가 꺼지고 .. |
관리자 | 23.06.27 | 15 |
| 2707 |
[답변] Cadence Virtuoso 라이센스 관련 질문 드립니다.
port for assistance. 와 같은 에러를 출력하며 잠시 프로그램이 실행되었다가 꺼지고 .. |
백종민 | 23.06.27 | 110 |
| 2706 |
TCAD 실행 오류
port@host or license file is being used, or the port or hostname in the license fil.. |
황현주 | 23.06.23 | 52 |
| 2705 |
[답변] TCAD 실행 오류
port@host or license file is being used, or the port or hostname in the license fil.. |
조인신 | 23.06.23 | 32 |
| 2704 |
[답변] TCAD 실행 오류
port@host or license file is being used, or the port or hostname in the license fil.. |
황현주 | 23.06.23 | 36 |
자료실
| 제목 | 작성자 | 작성일 | 조회 | |
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e2l-접적회로-컴퓨터이용설계의 기초
port deadline-12/16 Final examination 키워드 : CAD, algorithm, complexity, optimi.. |
구재희 | 05.01.05 | 735 |
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신경욱 | 18.10.29 | 28 |
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신경욱 | 17.10.24 | 60 |
| 공지사항 |
ISOCC 2018 call for paper
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김하늘 | 18.06.29 | 40191 |
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김필수 | 18.09.22 | 6662 |
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『제 25회 한국반도체학술대회』 The 25th Korean Conference on Semiconductors 2018.. |
김하늘 | 17.12.22 | 28519 |
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김종선 | 15.09.05 | 5 |
| 참여교수 성과 - IP |
All-digital Fractional-ratio Frequency Multiplying Delay-Locked Loop
portability. Implemented in a 65nm 1.0-V CMOS process, the proposed clock generato.. |
김종선 | 15.09.05 | 11 |
| 참여교수 성과 - IP |
Displayport v1.2a Receiver PHY
Displayport v1.2a Receiver PHY |
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| 참여교수 성과 - 특허 |
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