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  제목 강사정보 등록일
1 Verilog 언어를 활용한 FPGA 실습 서기범/교수/우송대학교 2015.10.29
교육자료
  제목 작성자 작성일 조회
질문/답변
  제목 작성자 작성일 조회
2663 [답변] TCAD 환경설정 문의드립니다.

port SNPSLMD_LICENSE_FILE=26585@143.248.230.161   [장은교]님의 글 ==========..

장은교 23.04.28 12
2662 [답변] TCAD 환경설정 문의드립니다.

port SNPSLMD_LICENSE_FILE=26585@143.248.230.161   [장은교]님의 글 ==========..

조인신 23.04.28 50
2661 [답변] Cadence 설치 문제 오류

ported Linux configuration.2023/04/24 21:42:37 For more info, please run CheckSysCo..

우성현 23.04.24 24
2660 [답변] Cadence 설치 문제 오류

ported Linux configuration.2023/04/24 21:42:37 For more info, please run CheckSysCo..

조인신 23.04.25 115
2659 ISO 소자 관련 문의 드립니다

port가 D, S, G, B, sub가 있는데 body에 3V를 걸고 sub에 0V를 걸어서 3V 이상의 큰 전..

유효준 23.04.17 25
2658 [답변] ISO 소자 관련 문의 드립니다

port가 D, S, G, B, sub가 있는데 body에 3V를 걸고 sub에 0V를 걸어서 3V 이상의 큰 전..

조인신 23.04.17 31
2657 ISO소자 관련

port가 D, S, G, B, iso, sub가 있는데   이 중 기본적으로 sub는 GND, iso는 VDD..

홍순성 23.04.14 25
2656 [답변] ISO소자 관련

port가 D, S, G, B, iso, sub가 있는데     이 중 기본적으로 sub는 GND, iso..

조인신 23.04.14 16
2655 PAD 포함 LVS 관련 질문 문의

port만 지정 하고 LVS BOX를 친 상태에서 LVS를 돌리려고 세팅하였었습니다. 현재 저는 P..

공선호 23.04.10 96
2654 [답변] PAD 포함 LVS 관련 질문 문의

port만 지정 하고 LVS BOX를 친 상태에서 LVS를 돌리려고 세팅하였었습니다. 현재 저는 P..

선혜승 23.04.10 57
2653 [답변] PAD 포함 LVS 관련 질문 문의

port만 지정 하고 LVS BOX를 친 상태에서 LVS를 돌리려고 세팅하였었습니다. 현재 저는 P..

공선호 23.04.10 29
2652 [답변] PAD 포함 LVS 관련 질문 문의

port만 지정 하고 LVS BOX를 친 상태에서 LVS를 돌리려고 세팅하였었습니다. 현재 저는 P..

선혜승 23.04.10 32
2651 [답변] PAD 포함 LVS 관련 질문 문의

port만 지정 하고 LVS BOX를 친 상태에서 LVS를 돌리려고 세팅하였었습니다. 현재 저는 P..

공선호 23.04.10 22
2650 [답변] PAD 포함 LVS 관련 질문 문의

port만 지정 하고 LVS BOX를 친 상태에서 LVS를 돌리려고 세팅하였었습니다. 현재 저는 P..

선혜승 23.04.10 146
2649 cell과 port사이 버퍼 방지 방법

--EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) : EDA Tool 버전(SCL/LCU/MGLS 포함..

문한결 23.04.03 24
2648 [답변] cell과 port사이 버퍼 방지 방법

  IDEC 선혜승입니다   PnR 과정에서 타이밍 요구사항을 충족하기 위해..

선혜승 23.04.04 13
2647 [답변] cell과 port사이 버퍼 방지 방법

안녕하세요. 친절한 답변 감사드립니다. 제가 몇가지 전제를 빼 먹은 것 같습니다. 1. ..

문한결 23.04.04 20
2646 [답변] cell과 port사이 버퍼 방지 방법

  IDEC 선혜승입니다  답이 늦었습니다    일단 원하는 명령은 ..

선혜승 23.04.05 29
2645 [답변] Cadence LCU 라이선스 매니저 lmgrd 오류

port LM_LICENSE_FILE=5280@143.248.230.161   [김홍구]님의 글 ================..

조인신 23.03.24 10
2644 [답변] Cadence LCU 라이선스 매니저 lmgrd 오류

port LM_LICENSE_FILE=5280@143.248.230.161   [김홍구]님의 글 ================..

김홍구 23.03.24 18
자료실
  제목 작성자 작성일 조회
1 e2l-접적회로-컴퓨터이용설계의 기초

port deadline-12/16 Final examination 키워드 : CAD, algorithm, complexity, optimi..

구재희 05.01.05 735
1
기타 게시판
구분 제목 작성자 작성일 조회
참여교수 성과 - IP LEA-128/192/256

ports three key lengths of 128, 192, and 256 bits. The LEA-128/192/256 IP perform..

신경욱 15.08.26 27
참여교수 성과 - IP LEA-128 Encryption/Decryption

port for encryption and decryption of 128-bit block cipher LEA - Support for key l..

신경욱 15.08.26 19
참여교수 성과 - IP LEA-128 Encryption

ports three key lengths of 128, 192, and 256 bits. The LEA128-Enc IP performs enc..

신경욱 15.08.26 20
참여교수 성과 - IP Census transform based adaptive support weight stereo matching IP

port weight stereo matching IP

문병인 15.08.25 38
공지사항 제23회 한국반도체학술대회 Chip Design Contest (CDC) 개최 (2016.02.23..

ported by the IDEC' 문구 삽입 ..

김하늘 15.11.09 7158
공지사항 JICAS(Vol1. No.2) 논문 모집 안내

JICAS 논문 모집 안내  반도체설계교육센터(IDEC)을 통해 매년 300여 개의 칩을 통..

이의숙 15.11.05 7387
참여교수 성과 - IP High Efficiency Current-Regulated Charge Pump for LED Driver

portant for a liquid crystal display (LCD) panel to get high quality display with l..

김철우 14.09.20 30
참여교수 성과 - IP 6Gbps injection locked CDR

portional to the jitter-tolerance performance. However, the injection strength can ..

김철우 14.09.20 20
공지사항 JICAS 논문 모집 안내

JICAS 논문 모집 안내   반도체설계교육센터(IDEC)을 통해 매년 300여 개의 칩을 ..

전항기 14.12.26 17588
참여교수 성과 - IP 4.5GHz Injection locked all-digital PLL

portional path and integral path to generate high quality clock and make overall lo..

김철우 14.09.20 17
참여교수 성과 - IP Tile-based Rasterizer for 3D graphics

portant, the amount of calculation in rasterization phase which is required to calc..

이광엽 14.09.18 34
공지사항 제22회 한국반도체학술대회 Chip Design Contest(CDC) 개최(2015.02.11(..

ported by the IDEC' 문구 삽입 시상 Award 명수상팀수내역Best Desig..

구재희 14.10.20 26913
공지사항 [채용공고] KAIST IDEC 행정원 채용 공고(신입/경력)

 KAIST IDEC 행정원 채용 공고(신입/경력)   반도체설계교육센터(..

석은주 14.09.16 19129
참여교수 성과 - IP AXI protocol converter

port all the operations required by the protocol

이찬호 14.09.02 16
참여교수 성과 - IP 8x8 AXI Interconnect

port operation with improved efficiency of the communication protocol. It also sup..

이찬호 14.09.02 21
구인/구직 (재)충북테크노파크 2014년 제5차 직원채용 공고

공고번호 : 충북TP-2014 - A7호(재)충북테크노파크 직원채용 공고 지역산업기술의 ..

전항기 15.01.08 5697
참여교수 성과 - IP A 12b 10MS/s 0.34mm2 2.0mW 0.11um CMOS SAR ADC

port : 없음(자체 보유한 Silicon Proven Report가 없음) 정보공유 여부 : N

이승훈 14.08.30 51
참여교수 성과 - IP A 14b 50MS/s 1.17mm2 146.1mW 0.13um CMOS ADC

port : 있음(File을 등록하지 않고, Provider의 승인/NDA 체결 후 전달하겠음) 정보공..

이승훈 14.08.30 9
참여교수 성과 - IP A 12b 100MS/s 1.34mm2 25.3mW 0.11um CMOS ADC

port : 있음(File을 등록하지 않고, Provider의 승인/NDA 체결 후 전달하겠음) 정보공..

이승훈 14.08.30 16
참여교수 성과 - IP A 12b 10MS/s 0.34mm2 2.4mW 0.11um CMOS SAR ADC

port : 있음(File을 등록하지 않고, Provider의 승인/NDA 체결 후 전달하겠음) 정보공..

이승훈 14.08.30 13
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