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  제목 강사정보 등록일
1 Verilog 언어를 활용한 FPGA 실습 서기범/교수/우송대학교 2015.10.29
교육자료
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질문/답변
  제목 작성자 작성일 조회
2563 [답변] LVS 질문드립니다

port하여 IO cell의 schematic 파일을 얻을 수 있으면 문제가 해결될 것 같습니다. ..

한영훈 23.01.14 102
2562 [답변] lvs 관련 문의

port가 있는데  DRC Error Report만 작성하면 되는건가요?     [선혜..

김영기 23.01.13 6
2561 [답변] lvs 관련 문의

port 작성하세요     감사합니다      [김영기]님의..

선혜승 23.01.13 63
2560 LVS 관련 문의

port from layout viewer와 export from schematic viewer 가 체크 된 상태에서 이러한 ..

장형준 23.01.13 41
2559 [답변] LVS 관련 문의

port from schematic viewer 옵션을 켜고 진행하세요    감사합니다  ..

선혜승 23.01.13 28
2558 [답변] LVS 관련 문의

port from schematic viewer 옵션을 켜고 진행하세요    감사합니다  ..

장형준 23.01.13 14
2557 [답변] LVS 관련 문의

port from schematic viewer 옵션을 켜고 진행하세요    감사합니다  ..

선혜승 23.01.13 73
2556 TCAD sentaurus 라이센스 관련 오류 문의

port : 2121 ID : cadtmp   안녕하십니까, 경북대학교 강인만 교수님 연..

이상호 23.01.12 26
2555 [답변] TCAD sentaurus 라이센스 관련 오류 문의

port : 2121 ID : cadtmp   안녕하십니까, 경북대학교 강인만 교수님 연..

조인신 23.01.12 38
2554 [답변] About install TCAD

port" is right for BASH    Thanks    [안동환]님의 글 ======..

선혜승 23.01.11 18
2553 28nm LVS관련 문의드립니다.

port가 있습니다.   /home/merge/S28_Merge/CADENCE_Env/LVS   감사합니다..

김용수 23.01.10 38
2552 [답변] 28nm LVS관련 문의드립니다.

port가 있습니다.   /home/merge/S28_Merge/CADENCE_Env/LVS   감사합니다..

선혜승 23.01.10 40
2551 [답변] 28nm LVS관련 문의드립니다.

port가 있습니다.   /home/merge/S28_Merge/CADENCE_Env/LVS   감사합니다..

김용수 23.01.11 15
2550 [답변] 28nm LVS관련 문의드립니다.

port가 있습니다.   /home/merge/S28_Merge/CADENCE_Env/LVS   감사합니다..

선혜승 23.01.11 17
2549 [답변] 28nm LVS관련 문의드립니다.

port가 있습니다.   /home/merge/S28_Merge/CADENCE_Env/LVS   감사합니다..

김용수 23.01.11 63
2548 [답변] 28nm LVS관련 문의드립니다.

port가 있습니다.   /home/merge/S28_Merge/CADENCE_Env/LVS   감사합니다..

김용수 23.01.11 73
2547 [답변] DRC error

portant that you should insist to keep your design with those errors, then you coul..

선혜승 23.01.10 665
2546 Sentaurus Work bench의 tdr이 열리지 않는 오류문제

port XLIB_NO_SHM=1 이 코드도 추가해보았지만 오류가 지속되고있는데, 해결방법이 없을..

이승준 23.01.08 18
2545 [답변] Sentaurus Work bench의 tdr이 열리지 않는 오류문제

port XLIB_NO_SHM=1 이 코드도 추가해보았지만 오류가 지속되고있는데, 해결방법이 없을..

조인신 23.01.09 15
2544 MPW DB 제출 관련 문의드립니다.

port file . . ================================================================ ..

김용수 23.01.07 19
1 ◀ 71 72 73 74 75 76 77 78 79 80 ▶ 205
자료실
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1 e2l-접적회로-컴퓨터이용설계의 기초

port deadline-12/16 Final examination 키워드 : CAD, algorithm, complexity, optimi..

구재희 05.01.05 735
1
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구분 제목 작성자 작성일 조회
참여교수 성과 - IP LEA-128/192/256

ports three key lengths of 128, 192, and 256 bits. The LEA-128/192/256 IP perform..

신경욱 15.08.26 27
참여교수 성과 - IP LEA-128 Encryption/Decryption

port for encryption and decryption of 128-bit block cipher LEA - Support for key l..

신경욱 15.08.26 19
참여교수 성과 - IP LEA-128 Encryption

ports three key lengths of 128, 192, and 256 bits. The LEA128-Enc IP performs enc..

신경욱 15.08.26 20
참여교수 성과 - IP Census transform based adaptive support weight stereo matching IP

port weight stereo matching IP

문병인 15.08.25 38
공지사항 제23회 한국반도체학술대회 Chip Design Contest (CDC) 개최 (2016.02.23..

ported by the IDEC' 문구 삽입 ..

김하늘 15.11.09 7158
공지사항 JICAS(Vol1. No.2) 논문 모집 안내

JICAS 논문 모집 안내  반도체설계교육센터(IDEC)을 통해 매년 300여 개의 칩을 통..

이의숙 15.11.05 7387
참여교수 성과 - IP High Efficiency Current-Regulated Charge Pump for LED Driver

portant for a liquid crystal display (LCD) panel to get high quality display with l..

김철우 14.09.20 30
참여교수 성과 - IP 6Gbps injection locked CDR

portional to the jitter-tolerance performance. However, the injection strength can ..

김철우 14.09.20 20
공지사항 JICAS 논문 모집 안내

JICAS 논문 모집 안내   반도체설계교육센터(IDEC)을 통해 매년 300여 개의 칩을 ..

전항기 14.12.26 17588
참여교수 성과 - IP 4.5GHz Injection locked all-digital PLL

portional path and integral path to generate high quality clock and make overall lo..

김철우 14.09.20 17
참여교수 성과 - IP Tile-based Rasterizer for 3D graphics

portant, the amount of calculation in rasterization phase which is required to calc..

이광엽 14.09.18 34
공지사항 제22회 한국반도체학술대회 Chip Design Contest(CDC) 개최(2015.02.11(..

ported by the IDEC' 문구 삽입 시상 Award 명수상팀수내역Best Desig..

구재희 14.10.20 26913
공지사항 [채용공고] KAIST IDEC 행정원 채용 공고(신입/경력)

 KAIST IDEC 행정원 채용 공고(신입/경력)   반도체설계교육센터(..

석은주 14.09.16 19129
참여교수 성과 - IP AXI protocol converter

port all the operations required by the protocol

이찬호 14.09.02 16
참여교수 성과 - IP 8x8 AXI Interconnect

port operation with improved efficiency of the communication protocol. It also sup..

이찬호 14.09.02 21
구인/구직 (재)충북테크노파크 2014년 제5차 직원채용 공고

공고번호 : 충북TP-2014 - A7호(재)충북테크노파크 직원채용 공고 지역산업기술의 ..

전항기 15.01.08 5697
참여교수 성과 - IP A 12b 10MS/s 0.34mm2 2.0mW 0.11um CMOS SAR ADC

port : 없음(자체 보유한 Silicon Proven Report가 없음) 정보공유 여부 : N

이승훈 14.08.30 51
참여교수 성과 - IP A 14b 50MS/s 1.17mm2 146.1mW 0.13um CMOS ADC

port : 있음(File을 등록하지 않고, Provider의 승인/NDA 체결 후 전달하겠음) 정보공..

이승훈 14.08.30 9
참여교수 성과 - IP A 12b 100MS/s 1.34mm2 25.3mW 0.11um CMOS ADC

port : 있음(File을 등록하지 않고, Provider의 승인/NDA 체결 후 전달하겠음) 정보공..

이승훈 14.08.30 16
참여교수 성과 - IP A 12b 10MS/s 0.34mm2 2.4mW 0.11um CMOS SAR ADC

port : 있음(File을 등록하지 않고, Provider의 승인/NDA 체결 후 전달하겠음) 정보공..

이승훈 14.08.30 13
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