Logo

홈 회원가입로그인 ENGLISH naver youtube  
search 

AND 검색 : 단어사이 띄어쓰기.     예) 반도체⌒설계

OR    검색 : 단어사이 or 표기.       예) 반도체⌒or⌒설계
VOD
  제목 강사정보 등록일
1 Verilog 언어를 활용한 FPGA 실습 서기범/교수/우송대학교 2015.10.29
교육자료
  제목 작성자 작성일 조회
질문/답변
  제목 작성자 작성일 조회
2443 [답변] cshrc 문의드립니다

port MMSIMHOME=/home/idec/tools/CADENCE/MMSIM181 export CDS_LIC_FILE=5280@license_..

선혜승 22.07.14 84
2442 라이센스 갱신 관련 문의드립니다.

port LM_LICENSE_FILE=5280 으로 시작하는 코드가 함께 포함되어 있었습니다. 그럼 이 코..

이규훈 22.07.13 22
2441 [답변] 라이센스 갱신 관련 문의드립니다.

port number 를 보니 cadence tool 을 사용하려는 것으로 파악됩니다. 라이선스 설치 가..

조인신 22.07.13 20
2440 [답변] SCL Tool 업데이트 관련 문의드립니다.

port/licensing-installation-computeplatforms/licensing/scl-supported-os.html) <..

이희승 22.08.09 22
2439 [답변] SCL Tool 업데이트 관련 문의드립니다.

port/licensing-installation-computeplatforms/licensing/scl-supported-os.html) <..

조인신 22.08.10 15
2438 [답변] SCL Tool 업데이트 관련 문의드립니다.

port/licensing-installation-computeplatforms/licensing/scl-supported-os.html) <..

이희승 22.08.10 13
2437 [답변] SCL Tool 업데이트 관련 문의드립니다.

port/licensing-installation-computeplatforms/licensing/scl-supported-os.html) <..

조인신 22.08.10 10
2436 [답변] SCL Tool 업데이트 관련 문의드립니다.

port DC_HOME=/tools/license/synopsys/DesignCompiler/DC/syn/S-2021.06-SP4export SNPS..

이희승 22.08.10 16
2435 [답변] SCL Tool 업데이트 관련 문의드립니다.

port DC_HOME=/tools/license/synopsys/DesignCompiler/DC/syn/S-2021.06-SP4export SNPS..

조인신 22.08.11 75
2434 [답변] ftp 접속이 불가능 합니다

port LM_LICENSE_FILE 로 시작)를 추가해야 하는데 tool 환경설정 파일이 무엇인지, 어떻..

이규훈 22.07.13 34
2433 [답변] ftp 접속이 불가능 합니다

port LM_LICENSE_FILE 로 시작)를 추가해야 하는데 tool 환경설정 파일이 무엇인지, 어떻..

조인신 22.07.13 26
2432 머지 작업중에 문제 (케이던스 라이센스 문제) 문의드립니다.

ported Linux configuration.2022/07/12 15:05:08 For more info, please run CheckSysCo..

박상수 22.07.12 73
2431 [답변] 머지 작업중에 문제 (케이던스 라이센스 문제) 문의드립니다.

ported Linux configuration.2022/07/12 15:05:08 For more info, please run CheckSysCo..

조인신 22.07.13 69
2430 EDA Tool 설치 관련 질문 사항

port@host or license file is being used, or the port or hostname in the license fil..

맹경호 22.07.11 119
2429 [답변] EDA Tool 설치 관련 질문 사항

port@host or license file is being used, or the port or hostname in the license fil..

조인신 22.07.11 60
2428 [답변] EDA Tool 설치 관련 질문 사항

port를 열어 줄 수 있다고 이야기 하였는데, 그렇다면 공인 IP를 신청하고 해당 IP로 por..

맹경호 22.07.12 38
2427 [답변] EDA Tool 설치 관련 질문 사항

port를 열어 줄 수 있다고 이야기 하였는데, 그렇다면 공인 IP를 신청하고 해당 IP로 por..

조인신 22.07.13 46
2426 [답변] EDA Tool 설치 관련 질문 사항

port를 열어 줄 수 있다고 이야기 하였는데, 그렇다면 공인 IP를 신청하고 해당 IP로 por..

맹경호 22.07.21 124
2425 virtuoso 실행 오류 문의드립니다. (DB-320001)

ported Linux configuration.2022/07/11 00:52:15 For more info, please run CheckSysCo..

양성훈 22.07.11 98
2424 [답변] virtuoso 실행 오류 문의드립니다. (DB-320001)

ported Linux configuration.2022/07/11 00:52:15 For more info, please run CheckSysCo..

조인신 22.07.11 64
1 ◀ 81 82 83 84 85 86 87 88 89 90 ▶ 205
자료실
  제목 작성자 작성일 조회
1 e2l-접적회로-컴퓨터이용설계의 기초

port deadline-12/16 Final examination 키워드 : CAD, algorithm, complexity, optimi..

구재희 05.01.05 735
1
기타 게시판
구분 제목 작성자 작성일 조회
참여교수 성과 - IP LEA-128/192/256

ports three key lengths of 128, 192, and 256 bits. The LEA-128/192/256 IP perform..

신경욱 15.08.26 27
참여교수 성과 - IP LEA-128 Encryption/Decryption

port for encryption and decryption of 128-bit block cipher LEA - Support for key l..

신경욱 15.08.26 19
참여교수 성과 - IP LEA-128 Encryption

ports three key lengths of 128, 192, and 256 bits. The LEA128-Enc IP performs enc..

신경욱 15.08.26 20
참여교수 성과 - IP Census transform based adaptive support weight stereo matching IP

port weight stereo matching IP

문병인 15.08.25 38
공지사항 제23회 한국반도체학술대회 Chip Design Contest (CDC) 개최 (2016.02.23..

ported by the IDEC' 문구 삽입 ..

김하늘 15.11.09 7158
공지사항 JICAS(Vol1. No.2) 논문 모집 안내

JICAS 논문 모집 안내  반도체설계교육센터(IDEC)을 통해 매년 300여 개의 칩을 통..

이의숙 15.11.05 7387
참여교수 성과 - IP High Efficiency Current-Regulated Charge Pump for LED Driver

portant for a liquid crystal display (LCD) panel to get high quality display with l..

김철우 14.09.20 30
참여교수 성과 - IP 6Gbps injection locked CDR

portional to the jitter-tolerance performance. However, the injection strength can ..

김철우 14.09.20 20
공지사항 JICAS 논문 모집 안내

JICAS 논문 모집 안내   반도체설계교육센터(IDEC)을 통해 매년 300여 개의 칩을 ..

전항기 14.12.26 17588
참여교수 성과 - IP 4.5GHz Injection locked all-digital PLL

portional path and integral path to generate high quality clock and make overall lo..

김철우 14.09.20 17
참여교수 성과 - IP Tile-based Rasterizer for 3D graphics

portant, the amount of calculation in rasterization phase which is required to calc..

이광엽 14.09.18 34
공지사항 제22회 한국반도체학술대회 Chip Design Contest(CDC) 개최(2015.02.11(..

ported by the IDEC' 문구 삽입 시상 Award 명수상팀수내역Best Desig..

구재희 14.10.20 26913
공지사항 [채용공고] KAIST IDEC 행정원 채용 공고(신입/경력)

 KAIST IDEC 행정원 채용 공고(신입/경력)   반도체설계교육센터(..

석은주 14.09.16 19129
참여교수 성과 - IP AXI protocol converter

port all the operations required by the protocol

이찬호 14.09.02 16
참여교수 성과 - IP 8x8 AXI Interconnect

port operation with improved efficiency of the communication protocol. It also sup..

이찬호 14.09.02 21
구인/구직 (재)충북테크노파크 2014년 제5차 직원채용 공고

공고번호 : 충북TP-2014 - A7호(재)충북테크노파크 직원채용 공고 지역산업기술의 ..

전항기 15.01.08 5697
참여교수 성과 - IP A 12b 10MS/s 0.34mm2 2.0mW 0.11um CMOS SAR ADC

port : 없음(자체 보유한 Silicon Proven Report가 없음) 정보공유 여부 : N

이승훈 14.08.30 51
참여교수 성과 - IP A 14b 50MS/s 1.17mm2 146.1mW 0.13um CMOS ADC

port : 있음(File을 등록하지 않고, Provider의 승인/NDA 체결 후 전달하겠음) 정보공..

이승훈 14.08.30 9
참여교수 성과 - IP A 12b 100MS/s 1.34mm2 25.3mW 0.11um CMOS ADC

port : 있음(File을 등록하지 않고, Provider의 승인/NDA 체결 후 전달하겠음) 정보공..

이승훈 14.08.30 16
참여교수 성과 - IP A 12b 10MS/s 0.34mm2 2.4mW 0.11um CMOS SAR ADC

port : 있음(File을 등록하지 않고, Provider의 승인/NDA 체결 후 전달하겠음) 정보공..

이승훈 14.08.30 13
1 ◀ 11 12