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  제목 강사정보 등록일
1 Verilog 언어를 활용한 FPGA 실습 서기범/교수/우송대학교 2015.10.29
교육자료
  제목 작성자 작성일 조회
질문/답변
  제목 작성자 작성일 조회
2143 [답변] calibre ftp 다운 관련 문의

 안녕하세요 구글 드라이브는 용량 문제로 더이상 업로드 할수 없습니다. 혹시 제..

관리자 21.11.04 13
2142 [답변] calibre ftp 다운 관련 문의

안녕하세요. 정덕균 교수님 연구실 송영근입니다. 제 구글 드라이브(용량 무제한)에 공..

정덕균 21.11.04 11
2141 [답변] calibre ftp 다운 관련 문의

 mks@idec.or.kr 입니다     [정덕균]님의 글 ======================..

관리자 21.11.04 12
2140 [답변] calibre ftp 다운 관련 문의

드라이브 공유 메일 드렸습니다. 감사합니다.     [관리자]님의 글 ======..

정덕균 21.11.05 45
2139 StarRC .spf 파일 추출

port 하여 transistor level netlist 를 추출하였습니다. finesim 을 이용하여 node 를 ..

박현철 21.11.03 17
2138 [답변] StarRC .spf 파일 추출

port 하여 transistor level netlist 를 추출하였습니다. finesim 을 이용하여 node 를 ..

선혜승 21.11.03 63
2137 Cadence Layout XL 관련해서 질문드립니다.

port Summary: |+-----------------------------------------------------+| 0 Min spaci..

김정남 21.10.26 71
2136 [답변] Cadence Layout XL 관련해서 질문드립니다.

port Summary: |+-----------------------------------------------------+| 0 Min spaci..

조인신 21.10.26 96
2135 [DB-320001 Error] Virtuoso License Error 문의드립니다.

port for assistance.   오늘 오후까지만 해도 잘 작동하였는데, 해당 licen..

조우영 21.10.13 43
2134 [답변] [DB-320001 Error] Virtuoso License Error 문의드립니다.

port for assistance.   오늘 오후까지만 해도 잘 작동하였는데, 해당 licen..

조인신 21.10.14 60
2133 Pad Top에서 Clock Path관련하여 질문드립니다.

port에서 Slack 발생한 부분 스크린샷 첨부하였습니다.) 조금 이해가 되지 않는 것이 ..

허재훈 21.10.13 21
2132 [답변] Pad Top에서 Clock Path관련하여 질문드립니다.

port 가 나온 것 같습니다   다만, 주기는 좀 저도 이해가 되지 않는데 ..

선혜승 21.10.13 40
2131 [답변] Synopsys Coware(PA) license 관련

 안녕하세요,  해당 port를 확인해본 결과 저희 학교에서 외부로 나가는 port..

이상협 21.10.08 7
2130 [답변] Synopsys Coware(PA) license 관련

  IDEC 선혜승입니다     어디에서나 쓸 수 있는 것이 아니라&nb..

선혜승 21.10.08 9
2129 Multi clock Timing constraint

ports CLK_IN] create_generated_clock -divide_by 4 -name "CLK_gen" -source CLK_IN [..

문한결 21.10.06 17
2128 [답변] Multi clock Timing constraint

ports CLK_IN] create_generated_clock -divide_by 4 -name "CLK_gen" -source CLK_IN [..

선혜승 21.10.07 39
2127 IC618 대용량 시뮬레이션 데이터 취급 시 꺼지는 문제

port를 시도 해도 가용 메모리와 스왑을 전부 소진한 뒤에 운영체제 수준에서 kill signa..

전진우 21.10.06 30
2126 [답변] IC618 대용량 시뮬레이션 데이터 취급 시 꺼지는 문제

port를 시도 해도 가용 메모리와 스왑을 전부 소진한 뒤에 운영체제 수준에서 kill signa..

조인신 21.10.06 41
2125 [답변] HSPICE 라이센스 관련 문의드립니다

port logging. Use Flexera's 17:26:34 (lmgrd) software license administration soluti..

이동욱 21.10.07 52
2124 [답변] HSPICE 라이센스 관련 문의드립니다

port logging. Use Flexera's 17:26:34 (lmgrd) software license administration soluti..

조인신 21.10.08 108
자료실
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1 e2l-접적회로-컴퓨터이용설계의 기초

port deadline-12/16 Final examination 키워드 : CAD, algorithm, complexity, optimi..

구재희 05.01.05 735
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구분 제목 작성자 작성일 조회
참여교수 성과 - 특허 Disparity Computation Method Through Stereo Matching Based on Census..

port Weight and System Thereof

문병인 15.08.25 3
참여교수 성과 - 논문 A Flexible Programmable Memory BIST for Embedded Single-port Memory ..

강성호 14.09.16 16
참여교수 성과 - 논문 Multi-stage FIR filter design for portable digital spectrum analyzers

이성주 14.09.15 5
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ports the 224-bit ECC over GF(p) and the 2,048-bit RSA defined by NIST Std. FIPS PU..

신경욱 18.10.29 33
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ports five modes of operation of ARIA including ECB, CBC, OFB, CTR and CFB, and sup..

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참여교수 성과 - IP AES-GCM Authenticated Encryption Core IP

ports CTR mode of operation of AES and two key sizes of 128-bit and 256-bit for enc..

신경욱 18.10.29 28
공지사항 2018 XUP(Xilinx University Program) Professor Workshop Invitation

port/university/workshops/korea-registration-form.html     &nb..

석은주 18.10.19 47880
참여교수 성과 - IP ECC-P224 core

port 224-bit elliptic curve over prime field defined by NIST - Support for private..

신경욱 17.10.24 82
참여교수 성과 - IP ECC-B233 core

port 233-bit elliptic curve over binary field defined by NIST - Support for privat..

신경욱 17.10.24 60
공지사항 ISOCC 2018 call for paper

portant Dates : □ Submission of Special Session and Tutorial Proposals: June 22, 2..

김하늘 18.06.29 40191
개설 희망 강좌 신청 low drop-out regulator 설계 관련 강의가 열렸으면 좋겠습니다.

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김필수 18.09.22 6662
공지사항 [한국반도체학술대회] '제 2회 강대원상'의 주인공을 찾습니다! (신청 마..

『제 25회 한국반도체학술대회』 The 25th Korean Conference on Semiconductors 2018..

김하늘 17.12.22 28519
참여교수 성과 - IP Tiny AES-128 Crypto-core

ports three different key sizes; 128, 192, 256 bits.The Tiny AES-128 crypto-core su..

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참여교수 성과 - IP Anti-harmonic Fractional-ratio Frequency Multiplying Delay-Locked Loop

ports DLL mode for de-skewing. Feature - Process : 65 nm - Supply : 1.0 V - F..

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참여교수 성과 - IP Multi-phase Fractional-ratio Frequency Multiplying Delay-Locked Loop

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김종선 15.09.05 5
참여교수 성과 - IP All-digital Fractional-ratio Frequency Multiplying Delay-Locked Loop

portability. Implemented in a 65nm 1.0-V CMOS process, the proposed clock generato..

김종선 15.09.05 11
참여교수 성과 - IP Displayport v1.2a Receiver PHY

Displayport v1.2a Receiver PHY

김철우 15.09.03 20
참여교수 성과 - 논문 시그마 델타 변조를 이용한 HDMI 표준의 Display port 오디오 타임스탬프..

강진구 14.09.03 15
참여교수 성과 - 특허 Antenna device for a portable terminal

적층기판 환경에서 구성한 소형 LC loaded 안테나

김문일 14.09.15 3
참여교수 성과 - IP LPDDR Memory Controller

port 100MHz speed grades of LPDDR devices. It is designed using Verilog-HDL and ver..

이찬호 15.08.27 18
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