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| 제목 | 강사정보 | 등록일 | |
|---|---|---|---|
| 1 | Verilog 언어를 활용한 FPGA 실습 | 서기범/교수/우송대학교 | 2015.10.29 |
교육자료
| 제목 | 작성자 | 작성일 | 조회 |
|---|
질문/답변
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 2143 |
[답변] calibre ftp 다운 관련 문의
안녕하세요 구글 드라이브는 용량 문제로 더이상 업로드 할수 없습니다. 혹시 제.. |
관리자 | 21.11.04 | 13 |
| 2142 |
[답변] calibre ftp 다운 관련 문의
안녕하세요. 정덕균 교수님 연구실 송영근입니다. 제 구글 드라이브(용량 무제한)에 공.. |
정덕균 | 21.11.04 | 11 |
| 2141 |
[답변] calibre ftp 다운 관련 문의
mks@idec.or.kr 입니다 [정덕균]님의 글 ======================.. |
관리자 | 21.11.04 | 12 |
| 2140 |
[답변] calibre ftp 다운 관련 문의
드라이브 공유 메일 드렸습니다. 감사합니다. [관리자]님의 글 ======.. |
정덕균 | 21.11.05 | 45 |
| 2139 |
StarRC .spf 파일 추출
port 하여 transistor level netlist 를 추출하였습니다. finesim 을 이용하여 node 를 .. |
박현철 | 21.11.03 | 17 |
| 2138 |
[답변] StarRC .spf 파일 추출
port 하여 transistor level netlist 를 추출하였습니다. finesim 을 이용하여 node 를 .. |
선혜승 | 21.11.03 | 63 |
| 2137 |
Cadence Layout XL 관련해서 질문드립니다.
port Summary: |+-----------------------------------------------------+| 0 Min spaci.. |
김정남 | 21.10.26 | 71 |
| 2136 |
[답변] Cadence Layout XL 관련해서 질문드립니다.
port Summary: |+-----------------------------------------------------+| 0 Min spaci.. |
조인신 | 21.10.26 | 96 |
| 2135 |
[DB-320001 Error] Virtuoso License Error 문의드립니다.
port for assistance. 오늘 오후까지만 해도 잘 작동하였는데, 해당 licen.. |
조우영 | 21.10.13 | 43 |
| 2134 |
[답변] [DB-320001 Error] Virtuoso License Error 문의드립니다.
port for assistance. 오늘 오후까지만 해도 잘 작동하였는데, 해당 licen.. |
조인신 | 21.10.14 | 60 |
| 2133 |
Pad Top에서 Clock Path관련하여 질문드립니다.
port에서 Slack 발생한 부분 스크린샷 첨부하였습니다.) 조금 이해가 되지 않는 것이 .. |
허재훈 | 21.10.13 | 21 |
| 2132 |
[답변] Pad Top에서 Clock Path관련하여 질문드립니다.
port 가 나온 것 같습니다 다만, 주기는 좀 저도 이해가 되지 않는데 .. |
선혜승 | 21.10.13 | 40 |
| 2131 |
[답변] Synopsys Coware(PA) license 관련
안녕하세요, 해당 port를 확인해본 결과 저희 학교에서 외부로 나가는 port.. |
이상협 | 21.10.08 | 7 |
| 2130 |
[답변] Synopsys Coware(PA) license 관련
IDEC 선혜승입니다 어디에서나 쓸 수 있는 것이 아니라&nb.. |
선혜승 | 21.10.08 | 9 |
| 2129 |
Multi clock Timing constraint
ports CLK_IN] create_generated_clock -divide_by 4 -name "CLK_gen" -source CLK_IN [.. |
문한결 | 21.10.06 | 17 |
| 2128 |
[답변] Multi clock Timing constraint
ports CLK_IN] create_generated_clock -divide_by 4 -name "CLK_gen" -source CLK_IN [.. |
선혜승 | 21.10.07 | 39 |
| 2127 |
IC618 대용량 시뮬레이션 데이터 취급 시 꺼지는 문제
port를 시도 해도 가용 메모리와 스왑을 전부 소진한 뒤에 운영체제 수준에서 kill signa.. |
전진우 | 21.10.06 | 30 |
| 2126 |
[답변] IC618 대용량 시뮬레이션 데이터 취급 시 꺼지는 문제
port를 시도 해도 가용 메모리와 스왑을 전부 소진한 뒤에 운영체제 수준에서 kill signa.. |
조인신 | 21.10.06 | 41 |
| 2125 |
[답변] HSPICE 라이센스 관련 문의드립니다
port logging. Use Flexera's 17:26:34 (lmgrd) software license administration soluti.. |
이동욱 | 21.10.07 | 52 |
| 2124 |
[답변] HSPICE 라이센스 관련 문의드립니다
port logging. Use Flexera's 17:26:34 (lmgrd) software license administration soluti.. |
조인신 | 21.10.08 | 108 |
자료실
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 1 |
e2l-접적회로-컴퓨터이용설계의 기초
port deadline-12/16 Final examination 키워드 : CAD, algorithm, complexity, optimi.. |
구재희 | 05.01.05 | 735 |
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기타 게시판
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| 참여교수 성과 - IP |
LEA-128/192/256
ports three key lengths of 128, 192, and 256 bits. The LEA-128/192/256 IP perform.. |
신경욱 | 15.08.26 | 27 |
| 참여교수 성과 - IP |
LEA-128 Encryption/Decryption
port for encryption and decryption of 128-bit block cipher LEA - Support for key l.. |
신경욱 | 15.08.26 | 19 |
| 참여교수 성과 - IP |
LEA-128 Encryption
ports three key lengths of 128, 192, and 256 bits. The LEA128-Enc IP performs enc.. |
신경욱 | 15.08.26 | 20 |
| 참여교수 성과 - IP |
Census transform based adaptive support weight stereo matching IP
port weight stereo matching IP |
문병인 | 15.08.25 | 38 |
| 공지사항 |
제23회 한국반도체학술대회 Chip Design Contest (CDC) 개최 (2016.02.23..
ported by the IDEC' 문구 삽입 .. |
김하늘 | 15.11.09 | 7158 |
| 공지사항 |
JICAS(Vol1. No.2) 논문 모집 안내
JICAS 논문 모집 안내 반도체설계교육센터(IDEC)을 통해 매년 300여 개의 칩을 통.. |
이의숙 | 15.11.05 | 7386 |
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High Efficiency Current-Regulated Charge Pump for LED Driver
portant for a liquid crystal display (LCD) panel to get high quality display with l.. |
김철우 | 14.09.20 | 30 |
| 참여교수 성과 - IP |
6Gbps injection locked CDR
portional to the jitter-tolerance performance. However, the injection strength can .. |
김철우 | 14.09.20 | 20 |
| 공지사항 |
JICAS 논문 모집 안내
JICAS 논문 모집 안내 반도체설계교육센터(IDEC)을 통해 매년 300여 개의 칩을 .. |
전항기 | 14.12.26 | 17588 |
| 참여교수 성과 - IP |
4.5GHz Injection locked all-digital PLL
portional path and integral path to generate high quality clock and make overall lo.. |
김철우 | 14.09.20 | 17 |
| 참여교수 성과 - IP |
Tile-based Rasterizer for 3D graphics
portant, the amount of calculation in rasterization phase which is required to calc.. |
이광엽 | 14.09.18 | 34 |
| 공지사항 |
제22회 한국반도체학술대회 Chip Design Contest(CDC) 개최(2015.02.11(..
ported by the IDEC' 문구 삽입 시상 Award 명수상팀수내역Best Desig.. |
구재희 | 14.10.20 | 26913 |
| 공지사항 |
[채용공고] KAIST IDEC 행정원 채용 공고(신입/경력)
KAIST IDEC 행정원 채용 공고(신입/경력) 반도체설계교육센터(.. |
석은주 | 14.09.16 | 19129 |
| 참여교수 성과 - IP |
AXI protocol converter
port all the operations required by the protocol |
이찬호 | 14.09.02 | 16 |
| 참여교수 성과 - IP |
8x8 AXI Interconnect
port operation with improved efficiency of the communication protocol. It also sup.. |
이찬호 | 14.09.02 | 21 |
| 구인/구직 |
(재)충북테크노파크 2014년 제5차 직원채용 공고
공고번호 : 충북TP-2014 - A7호(재)충북테크노파크 직원채용 공고 지역산업기술의 .. |
전항기 | 15.01.08 | 5697 |
| 참여교수 성과 - IP |
A 12b 10MS/s 0.34mm2 2.0mW 0.11um CMOS SAR ADC
port : 없음(자체 보유한 Silicon Proven Report가 없음) 정보공유 여부 : N |
이승훈 | 14.08.30 | 51 |
| 참여교수 성과 - IP |
A 14b 50MS/s 1.17mm2 146.1mW 0.13um CMOS ADC
port : 있음(File을 등록하지 않고, Provider의 승인/NDA 체결 후 전달하겠음) 정보공.. |
이승훈 | 14.08.30 | 9 |
| 참여교수 성과 - IP |
A 12b 100MS/s 1.34mm2 25.3mW 0.11um CMOS ADC
port : 있음(File을 등록하지 않고, Provider의 승인/NDA 체결 후 전달하겠음) 정보공.. |
이승훈 | 14.08.30 | 16 |
| 참여교수 성과 - IP |
A 12b 10MS/s 0.34mm2 2.4mW 0.11um CMOS SAR ADC
port : 있음(File을 등록하지 않고, Provider의 승인/NDA 체결 후 전달하겠음) 정보공.. |
이승훈 | 14.08.30 | 13 |


