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  제목 강사정보 등록일
1 Verilog 언어를 활용한 FPGA 실습 서기범/교수/우송대학교 2015.10.29
교육자료
  제목 작성자 작성일 조회
질문/답변
  제목 작성자 작성일 조회
2123 [답변] 삼성 28nm 공정의 PEX inductance extraction 관련하여 질문드립니다.

port로 구분하여(pdk의 lvsres 사용) 설계하였습니다.이후에 PEX를 통해 SPEF format으로..

조인신 21.10.06 42
2122 [답변] 삼성 28nm 공정의 PEX inductance extraction 관련하여 질문드립니다.

port로 구분하여(pdk의 lvsres 사용) 설계하였습니다.이후에 PEX를 통해 SPEF format으로..

박철호 21.10.06 19
2121 [답변] 삼성 28nm 공정의 PEX inductance extraction 관련하여 질문드립니다.

port로 구분하여(pdk의 lvsres 사용) 설계하였습니다.이후에 PEX를 통해 SPEF format으로..

조인신 21.10.06 83
2120 virtuoso 실행 오류(IC617)

ported by cdsGetOABinPath.virtuoso: INFO: Note that OpenAccess (OA) requires runnin..

송윤흡 21.10.05 88
2119 [답변] virtuoso 실행 오류(IC617)

ported by cdsGetOABinPath.virtuoso: INFO: Note that OpenAccess (OA) requires runnin..

조인신 21.10.05 40
2118 [답변] virtuoso 실행 오류(IC617)

ported by cdsGetOABinPath.virtuoso: INFO: Note that OpenAccess (OA) requires runnin..

송윤흡 21.10.06 17
2117 [답변] virtuoso 실행 오류(IC617)

ported by cdsGetOABinPath.virtuoso: INFO: Note that OpenAccess (OA) requires runnin..

조인신 21.10.06 13
2116 [답변] virtuoso 실행 오류(IC617)

ported by cdsGetOABinPath.virtuoso: INFO: Note that OpenAccess (OA) requires runnin..

송윤흡 21.10.06 7
2115 [답변] virtuoso 실행 오류(IC617)

ported by cdsGetOABinPath.virtuoso: INFO: Note that OpenAccess (OA) requires runnin..

조인신 21.10.06 14
2114 [답변] virtuoso 실행 오류(IC617)

ported by cdsGetOABinPath.virtuoso: INFO: Note that OpenAccess (OA) requires runnin..

송윤흡 21.10.06 11
2113 [답변] virtuoso 실행 오류(IC617)

ported by cdsGetOABinPath.virtuoso: INFO: Note that OpenAccess (OA) requires runnin..

조인신 21.10.06 7
2112 [답변] virtuoso 실행 오류(IC617)

ported by cdsGetOABinPath.virtuoso: INFO: Note that OpenAccess (OA) requires runnin..

송윤흡 21.10.07 8
2111 [답변] virtuoso 실행 오류(IC617)

ported by cdsGetOABinPath.virtuoso: INFO: Note that OpenAccess (OA) requires runnin..

조인신 21.10.07 149
2110 [답변] ICC init_design/ module modified관련

port 차이로 인해서 pt eco를 진행할 때마다 icc에서 negative hold가 발생합니다. clock..

문한결 21.09.28 13
2109 [답변] ICC init_design/ module modified관련

port 차이로 인해서 pt eco를 진행할 때마다 icc에서 negative hold가 발생합니다. clock..

선혜승 21.10.01 8
2108 [답변] ICC init_design/ module modified관련

port에서 hold margin에 추가되던데 이것이 hold와 관련 없다는 말씀이신가요?   ..

문한결 21.10.01 6
2107 [답변] ICC init_design/ module modified관련

port에서 hold margin에 추가되던데 이것이 hold와 관련 없다는 말씀이신가요?   ..

선혜승 21.10.01 69
2106 [답변] tcad svisual 오류, 환경변수 설정 문의

port 로 내용이 시작하는 라인이 있다면 bash 기준이고, setenv 로 시작하는 라인이 있..

조인신 21.09.13 38
2105 [답변] cadence liberate

port 페이지에서 다운 로드 할 수 있을 것입니다.   [석준하]님의 글 ===========..

조인신 21.09.10 19
2104 [답변] TCAD Svisual 실행이 안되어 질문드립니다

port XLIB_NO_SHM=1 csh 의 경우 setenv XLIB_NO_SHM 1 환경변수를 추가하고 실행하여 ..

조인신 21.09.06 56
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1 e2l-접적회로-컴퓨터이용설계의 기초

port deadline-12/16 Final examination 키워드 : CAD, algorithm, complexity, optimi..

구재희 05.01.05 735
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portability. Implemented in a 65nm 1.0-V CMOS process, the proposed clock generato..

김종선 15.09.05 11
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Displayport v1.2a Receiver PHY

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참여교수 성과 - 논문 시그마 델타 변조를 이용한 HDMI 표준의 Display port 오디오 타임스탬프..

강진구 14.09.03 15
참여교수 성과 - 특허 Antenna device for a portable terminal

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김문일 14.09.15 3
참여교수 성과 - IP LPDDR Memory Controller

port 100MHz speed grades of LPDDR devices. It is designed using Verilog-HDL and ver..

이찬호 15.08.27 18
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