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| 제목 | 강사정보 | 등록일 | |
|---|---|---|---|
| 13 | Reliability of Analog and mixed-signal circuits | 김병호 한양대학교 교수 | 2024.02.07 |
| 12 | 신호 및 전력 무결성 (signal_Power Integrity)를 고려한 Package, PCB 및 Intercon.. | 김영우/교수/세종대 | 2023.03.17 |
| 11 | CMOS Analog 전자회로 설계 - 2019(2) | 박주성/이사/(주)텔로팜 | 2019.09.23 |
| 10 | CMOS Analog 전자회로설계 - 2019 | 박주성/교수/부산대학교 | 2019.03.26 |
| 9 | Matlab을 이용한 Digital signal Processing - 2019 | 김태훈/교수/동의과학대 | 2019.03.26 |
| 8 | 임베디드 시스템 설계_Digital Debugging | 심규현 강사 한성대학교 | 2018.10.04 |
| 7 | CMOS Analog 전자회로설계 | 최영식/교수/부경대학교 | 2018.02.20 |
| 6 | CMOS Analog 전자회로 설계 | 박주성/교수/부산대학교 | 2016.12.12 |
| 5 | CMOS Analog 회로설계 | 최영식/교수/부경대학교 | 2016.12.12 |
| 4 | [무료세미나]Fallacies of Computational Analog | 송방섭 교수(U.S San Diego) | 2016.03.25 |
| 3 | Matlab을 이용한 Digital signal Processing | 김태훈 부교수(동의과학대) | 2015.11.09 |
| 2 | [무료세미나]How analog has been evolved_송방섭 교수(U. C. San Diego) | 송방섭 교수(U. C. San Diego) | 2014.10.31 |
| 1 | CMOS 이미지 센서 교육 | 이성수 상무(픽셀플러스) | 2014.10.31 |
교육자료
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 2 | Matlab을 이용한 digital signal processing | 윤성심 | 15.08.25 | 997 |
| 1 | Analog/RF/Mixed-signal circuit design trend in Silicon Valley for High-Speed Wir | 구재희 | 13.08.01 | 739 |
질문/답변
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 414 |
SF28 DRC 에러 관련 문의입니다.
안녕하세요. 저는 유니스트 김경록 교수님 연구실의 대학원생 송유빈입니다. 다름이 아.. |
송유빈 | 24.02.15 | 42 |
| 413 |
[답변] SF28 DRC 에러 관련 문의입니다.
안녕하세요. IDEC이종행입니다. DRC에러 부분이 발생한 것에 대해 다른 소자 영향의 Wai.. |
이종행 | 24.02.15 | 27 |
| 412 |
[답변] SF28 DRC 에러 관련 문의입니다.
안녕하세요. 답신 감사드립니다. 어떤 말씀이신지 이해하였습니다. Minimum dens.. |
송유빈 | 24.02.15 | 15 |
| 411 |
[답변] SF28 DRC 에러 관련 문의입니다.
해당건은 연구 목적을 포함하여 PPT 로 상세히 작성 후 아래 메일로 보내 .. |
김연태 | 24.02.15 | 82 |
| 410 |
[답변] SF28 min density error 관련 질문
에러 항목을 보면 IB, IA 메탈에 대한 Density 에러로 보입니다. I.. |
김연태 | 24.02.13 | 27 |
| 409 |
[답변] SF28 min density error 관련 질문
답변 감사드립니다 연구원님. 제가 처음 첨부한 사진은 metal 5에 대한 density error이.. |
유지민 | 24.02.14 | 53 |
| 408 |
IC Compiler Power Routing 관련 Via 사라짐 오류 문의드립니다.
signal_layers {LB} \ -preferred_direction_only_layers {M1 M2 M3 M4 M5 M6 M7 IA IB} .. |
장익수 | 24.01.30 | 98 |
| 407 |
Quantus QRC 실행 시 허가 거부 에러 관련 질문
--EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) : Cadence Virtuoso, Assura, Quantu.. |
이주연 | 23.12.08 | 86 |
| 406 |
[답변] Quantus QRC 실행 시 허가 거부 에러 관련 질문
안녕하세요. IDEC 조인신입니다. 해당 문제는 라이선스와 QRC 가 아닌.. |
조인신 | 23.12.11 | 25 |
| 405 |
[답변] Quantus QRC 실행 시 허가 거부 에러 관련 질문
안녕하세요 조인신 연구원님. 성균관대학교 김소영 교수님 연구실의 석박통합과.. |
이주연 | 23.12.12 | 25 |
| 404 |
[답변] Quantus QRC 실행 시 허가 거부 에러 관련 질문
assura 로 진행해도 문제 없습니다. ksh 가 설치되어 있는지 다시 확인해 보시.. |
조인신 | 23.12.12 | 78 |
| 403 |
[답변] [SS28-2302] Standard Cell rail width 관련 문의
signal pin port 가 위치하고 있으므로 상단과 하단에 두껍게 메탈이 지나갈 경우.. |
김연태 | 23.12.06 | 68 |
| 402 |
[SF28-2301] signal Pin Rule 관련 질문
signal pin rule에서 power and ground 관련 에러가 발생하고 있습니다. 관련해서 조.. |
이민재 | 23.12.01 | 24 |
| 401 |
[답변] [SF28-2301] signal Pin Rule 관련 질문
signal pin rule에서 power and ground 관련 에러가 발생하고 있습니다. 관련해서 조.. |
김연태 | 23.12.01 | 52 |
| 400 |
SF28공정 merge 서버 virtuoso tool error관련 문의
안녕하세요, 서울과학기술대학교 전자공학과 이승은 교수님 연구실 소속의 고광현.. |
고광현 | 23.11.21 | 15 |
| 399 |
[답변] SF28공정 merge 서버 virtuoso tool error관련 문의
안녕하세요. IDEC 조인신입니다. 사용하고 있는 클라우드 서버가 IDEC.. |
조인신 | 23.11.21 | 22 |
| 398 |
Liberate MX 사용관련 질문
signal macro용 liberate_ams를 사용해보려고 하는데 license가 없는 것 같습니다. 혹시.. |
이주흔 | 23.11.17 | 12 |
| 397 |
[답변] Liberate MX 사용관련 질문
signal macro용 liberate_ams를 사용해보려고 하는데 license가 없는 것 같습니다. 혹시.. |
조인신 | 23.11.17 | 25 |
| 396 |
[SF28-2301회] FD-SOI관련 질의사항
signal 로 설계를 진행 하고 있기때문에. Power Clamp 이외 IO에 대한 정보가 필요 합니.. |
이상현 | 23.11.15 | 63 |
| 395 |
[답변] [SF28-2301회] FD-SOI관련 질의사항
signal 로 설계를 진행 하고 있기때문에. Power Clamp 이외 IO에 대한 정보가 필요 합니.. |
김연태 | 23.11.15 | 90 |
자료실
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 15 |
SerDes System 설계 관련 웨비나 공유
SerDes 설계에 참고 할 수 있는 다양한 웨비나 리스트를 아래 공유 드립니다. (웨비나 6.. |
김영지 | 21.03.10 | 1280 |
| 14 |
e2l-반도체공학-초고주파 반도체 물리학
영문제목 : RF Semiconductor Physics 개요 : 초고주파대역의 반도체물리 및 소자에 대.. |
구재희 | 06.08.09 | 1981 |
| 13 |
e2l-반도체공학-반도체의 주요 응용 분야: 통신 및 신호처리와 반도체
영문제목 : communication & semiconductor 개요 : 키워드 : VLSI, Communication, .. |
구재희 | 06.06.13 | 1459 |
| 12 |
e2l-반도체공학-집적회로 설계 기술: 배선 및 신호의 무결성
signalIntegity 개요 : 키워드 : 배선, 신호의 무결성 |
구재희 | 05.09.07 | 1520 |
| 11 |
e2l-반도체공학-반도체의 주요 응용 분야: 통신 및 신호처리와 반도체
영문제목 : communication & semiconductor 개요 : ● 전송 및 교환, 모뎀: 전전자식 교.. |
구재희 | 04.12.30 | 852 |
| 10 |
e2l-반도체공학-집적회로 설계 기술: 배선 및 신호의 무결성
signalIntegity 개요 : ● Scaling ● Low-k ● Copper ●지연 시간 ●전송선 모델 ● signal.. |
구재희 | 04.12.30 | 1060 |
| 9 |
e2l-디지털시스템-디지털 통신
signal representation, baseband transmission, passband transmission, transmission o.. |
구재희 | 08.07.16 | 815 |
| 8 |
e2l-디지털시스템-소프트웨어 래디오 설계 방법론
signal-processing platform for Software Defined Radio (SDR) applications such as Ta.. |
구재희 | 06.12.21 | 842 |
| 7 |
e2l-접적회로-CAD algorithms: design verification of VLSI systems
영문제목 : CAD algorithms: design verification of VLSI systems 개요 : 키워드 :.. |
구재희 | 05.09.07 | 754 |
| 6 |
e2l-접적회로-A/D 및 D/A 변환기 설계, 혼성모드 Layout
영문제목 : Design of ADC and DAC and Mixed-signal Layout 개요 : 키워드 : ADC, .. |
구재희 | 05.09.07 | 755 |
| 5 |
e2l-접적회로-A/D 및 D/A 변환기 설계, 혼성모드 Layout
영문제목 : Design of ADC and DAC and Mixed-signal Layout 개요 : ● CAD 알고리즘이.. |
구재희 | 05.04.14 | 635 |
| 4 |
e2l-접적회로-CMOS Analog 설계
signal 해석, 회로설계 |
구재희 | 05.01.05 | 966 |
| 3 |
e2l-접적회로-CAD algorithms: design verification of VLSI systems
영문제목 : CAD algorithms: design verification of VLSI systems 개요 : ● CAD 알고.. |
구재희 | 04.12.30 | 831 |
| 2 |
e2l-접적회로-A/D 및 D/A 변환기 설계, 혼성모드 Layout
영문제목 : Design of ADC and DAC and Mixed-signal Layout 개요 : ● CAD 알고리즘이.. |
구재희 | 04.12.30 | 748 |
| 1 |
e2l-통신 및 신호처리-VLSI Digital signal Processing
영문제목 : VLSI Digital signal Processing 개요 : 디지털 신호처리는 비디오 압축, .. |
구재희 | 05.01.05 | 644 |
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기타 게시판
| 구분 | 제목 | 작성자 | 작성일 | 조회 |
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| 참여교수 성과 - 논문 |
Band pass Filter with Pseudo-Resistor for Biosensor signal Detection
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최영완 | 14.09.22 | 7 |
| 참여교수 성과 - 특허 |
EMORY DEVICE BASED ON DOMAIN WALL MEMORY AND READING AND
EMORY DEVICE BASED ON DOMAIN WALL MEMORY AND READING ANDWRITING METHOD THEREOF, AND.. |
박종선 | 16.10.19 | 7 |
| 참여교수 성과 - 특허 |
SYNTHESIZING METHOD OF signal HAVING VARIABLE FREQUENCY AND SYNTHESI..
|
김재하 | 16.10.18 | 2 |
| 참여교수 성과 - 특허 |
송신기
signaling 기술을 적용한 transmitter에 대한 발명으로 데이터 transition에 소모되는 전.. |
유창식 | 16.09.29 | 4 |
| 참여교수 성과 - 논문 |
MEMS piezoelectric artificial basilar membrane with passive frequenc..
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최홍수 | 14.09.20 | 1 |
| 참여교수 성과 - 특허 |
POWER AMPLIFIER WITH ADVANCED LINEARITY
signal; a high power amplification unit amplifying a signal suppressed by the input.. |
서철헌 | 15.09.07 | 3 |
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저스윙 저전력 니어-그라운드 시그널링 송수신기 및 그 동작 방법
【발명의 명칭】 저스윙 저전력 니어-그라운드 시그널링 송수신기 및 그 동작 방법{LOW-.. |
김종선 | 15.09.05 | 0 |
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Design and Measurement of a Compact On-interposer Passive Equalizer ..
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김정호 | 14.09.19 | 4 |
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Long Life-Time Amorphous-InGaZnO TFT-Based Shift Register Using a Re..
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정훈주 | 14.09.18 | 4 |
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Control of IMD Asymmetry of CMOS Power Amplifier for Broadband Opera..
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김범만 | 14.09.18 | 3 |
| 참여교수 성과 - 논문 |
Design of crosstalk compensation passive equalizers for high-speed d..
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김정호 | 14.09.18 | 4 |
| 참여교수 성과 - 특허 |
DIGITAL signal PROCESSOR AND DATA INPUTTING/OUTPUTTING METHOD
디지털 신호처리 프로세서 및 데이터 입출력 방법 |
박종선 | 15.09.02 | 3 |
| 참여교수 성과 - 논문 |
Control signal Aware Slice-Level Window Based Legalization Method fo..
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한양대 캠퍼스 | 14.09.18 | 9 |
| 참여교수 성과 - 특허 |
APPARATUS AND METHOD FOR GENERATING RAMP signal
APPARATUS AND METHOD FOR GENERATING RAMP signal |
김철우 | 15.09.02 | 5 |
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An 1.61mW mixed-signal column processor for BRISK feature extraction..
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유회준 | 14.09.18 | 10 |
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Multi Sensor Voltage signal Conditioner with Adaptive Level Shift an..
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유형준 | 14.09.18 | 12 |
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LOGIC GATE USING SCHMITT TRIGGER CIRCUIT
signals, perform a NAND logic operation, and output a first output signal; and a DT.. |
김소영 | 15.09.01 | 15 |
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Receiver, system including the same, and calibration method thereof
signal received from a clock channel by a predetermined time and output a second cl.. |
정덕균 | 15.09.01 | 9 |
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Level-down shifter
signal, and adjusting a first node voltage of the first node based on the reference.. |
정덕균 | 15.09.01 | 5 |
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Rail-to-rail comparator, pulse amplitude modulation receiver, and co..
signals to differential reference voltage. |
범진욱 | 15.09.01 | 10 |


