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  제목 강사정보 등록일
13 Reliability of Analog and mixed-signal circuits 김병호 한양대학교 교수 2024.02.07
12 신호 및 전력 무결성 (signal_Power Integrity)를 고려한 Package, PCB 및 Intercon.. 김영우/교수/세종대 2023.03.17
11 CMOS Analog 전자회로 설계 - 2019(2) 박주성/이사/(주)텔로팜 2019.09.23
10 CMOS Analog 전자회로설계 - 2019 박주성/교수/부산대학교 2019.03.26
9 Matlab을 이용한 Digital signal Processing - 2019 김태훈/교수/동의과학대 2019.03.26
8 임베디드 시스템 설계_Digital Debugging 심규현 강사 한성대학교 2018.10.04
7 CMOS Analog 전자회로설계 최영식/교수/부경대학교 2018.02.20
6 CMOS Analog 전자회로 설계 박주성/교수/부산대학교 2016.12.12
5 CMOS Analog 회로설계 최영식/교수/부경대학교 2016.12.12
4 [무료세미나]Fallacies of Computational Analog 송방섭 교수(U.S San Diego) 2016.03.25
3 Matlab을 이용한 Digital signal Processing 김태훈 부교수(동의과학대) 2015.11.09
2 [무료세미나]How analog has been evolved_송방섭 교수(U. C. San Diego) 송방섭 교수(U. C. San Diego) 2014.10.31
1 CMOS 이미지 센서 교육 이성수 상무(픽셀플러스) 2014.10.31
교육자료
  제목 작성자 작성일 조회
2 Matlab을 이용한 digital signal processing 윤성심 15.08.25 997
1 Analog/RF/Mixed-signal circuit design trend in Silicon Valley for High-Speed Wir 구재희 13.08.01 739
질문/답변
  제목 작성자 작성일 조회
214 [답변] 삼성65nm waive ESD관련 DRC 에러 해결 방법 및 waive 가능여부

signal pads must be connected to either: n+ satisfying ESD01a and p+ satisfying ESD..

선혜승 20.09.11 89
213 SS65 2002회차 LVS 관련 문의드립니다.

signal을 연결하기 시작하면서 현재 이 error가 사라지지 않고 있습니다.   혹시 ..

강윤하 20.08.26 28
212 [답변] SS65 2002회차 LVS 관련 문의드립니다.

signal을 연결하기 시작하면서 현재 이 error가 사라지지 않고 있습니다.   혹시 ..

조인신 20.08.27 49
211 metal hole, via hole 관련 문의드립니다.

signal routing에서 metal hole 과 via hole 을 막기 위해선 어떻게 해야하는지 알 수 있..

박태환 20.08.26 15
210 [답변] metal hole, via hole 관련 문의드립니다.

signal routing에서 metal hole 과 via hole 을 막기 위해선 어떻게 해야하는지 알 수 있..

조인신 20.08.26 6
209 [답변] metal hole, via hole 관련 문의드립니다.

signal line 에 hole들을 생성하는지 알수있을까요?   Q2 : hole이 있고 없고에 ..

박태환 20.08.26 4
208 [답변] metal hole, via hole 관련 문의드립니다.

signal line 과 관련없이 모든 metal 에서 생성되는 것으로 보입니다.   2. 해당 ..

조인신 20.08.26 20
207 Synopsys Sentaurus error 문의

--EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) : Sentaurus EDA Tool 버전(SCL/LCU..

양주원 20.08.06 36
206 [답변] Synopsys Sentaurus error 문의

안녕하세요. IDEC 연구원 조인신입니다.   svisual 을 실행하면서 파일이 꼬인 ..

조인신 20.08.10 29
205 DRC rule 관련 질문입니다.

signal 를 보호하는데  중요한 역할을 합니다.   혹시 첨부된 파일의 DRC ru..

박태환 20.07.09 37
204 [답변] DRC rule 관련 질문입니다.

signal 를 보호하는데  중요한 역할을 합니다.   혹시 첨부된 파일의 DRC ru..

선혜승 20.07.09 15
203 [답변] DRC rule 관련 질문입니다.

signal 를 보호하는데  중요한 역할을 합니다.   혹시 첨부된 파일의 DRC ru..

박태환 20.07.10 20
202 [답변] DRC rule 관련 질문입니다.

signal 를 보호하는데  중요한 역할을 합니다.   혹시 첨부된 파일의 DRC ru..

선혜승 20.07.10 67
201 synopsys 라이센스 구동 관련 문의

안녕하세요? 경희대학교 장익준교수님 연구실 조교 전현철입니다.   다름이아니라..

전현철 20.07.01 75
200 [답변] synopsys 라이센스 구동 관련 문의

안녕하세요. IDEC 연구원 조인신입니다.   우선 데몬의 버전이 2016.12_SP1로 확..

조인신 20.07.01 113
199 [답변] TCAD 워크벤치 예제를 돌리면 dataexcode.txt 에러가 발생합니다.

signal 이 들어온다고하는데 혹시 저번에 다중 라이센스 사용자가 많아서 일부 사용자들..

박동근 20.06.30 6
198 [답변] TCAD 워크벤치 예제를 돌리면 dataexcode.txt 에러가 발생합니다.

signal 이 들어온다고하는데 혹시 저번에 다중 라이센스 사용자가 많아서 일부 사용자들..

조인신 20.06.30 25
197 [답변] ICC2 pg ring 관련 (수정)

signal pin 'xx/x' cannot be determined. 와 같은 에러가 모든 cell의 모든 pin에서 발..

문승식 20.05.21 23
196 [답변] ICC2 pg ring 관련 (수정)

signal pin 'xx/x' cannot be determined. 와 같은 에러가 모든 cell의 모든 pin에서 발..

선혜승 20.05.21 13
195 [답변] ICC2 pg ring 관련 (수정)

signal pin 'xx/x' cannot be determined. 와 같은 에러가 모든 cell의 모든 pin에서 발..

문승식 20.05.21 6
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  제목 작성자 작성일 조회
15 SerDes System 설계 관련 웨비나 공유

SerDes 설계에 참고 할 수 있는 다양한 웨비나 리스트를 아래 공유 드립니다. (웨비나 6..

김영지 21.03.10 1280
14 e2l-반도체공학-초고주파 반도체 물리학

영문제목 : RF Semiconductor Physics 개요 : 초고주파대역의 반도체물리 및 소자에 대..

구재희 06.08.09 1981
13 e2l-반도체공학-반도체의 주요 응용 분야: 통신 및 신호처리와 반도체

영문제목 : communication & semiconductor 개요 : 키워드 : VLSI, Communication, ..

구재희 06.06.13 1459
12 e2l-반도체공학-집적회로 설계 기술: 배선 및 신호의 무결성

signalIntegity 개요 : 키워드 : 배선, 신호의 무결성

구재희 05.09.07 1520
11 e2l-반도체공학-반도체의 주요 응용 분야: 통신 및 신호처리와 반도체

영문제목 : communication & semiconductor 개요 : ● 전송 및 교환, 모뎀: 전전자식 교..

구재희 04.12.30 852
10 e2l-반도체공학-집적회로 설계 기술: 배선 및 신호의 무결성

signalIntegity 개요 : ● Scaling ● Low-k ● Copper ●지연 시간 ●전송선 모델 ● signal..

구재희 04.12.30 1060
9 e2l-디지털시스템-디지털 통신

signal representation, baseband transmission, passband transmission, transmission o..

구재희 08.07.16 815
8 e2l-디지털시스템-소프트웨어 래디오 설계 방법론

signal-processing platform for Software Defined Radio (SDR) applications such as Ta..

구재희 06.12.21 842
7 e2l-접적회로-CAD algorithms: design verification of VLSI systems

영문제목 : CAD algorithms: design verification of VLSI systems 개요 : 키워드 :..

구재희 05.09.07 754
6 e2l-접적회로-A/D 및 D/A 변환기 설계, 혼성모드 Layout

영문제목 : Design of ADC and DAC and Mixed-signal Layout 개요 : 키워드 : ADC, ..

구재희 05.09.07 755
5 e2l-접적회로-A/D 및 D/A 변환기 설계, 혼성모드 Layout

영문제목 : Design of ADC and DAC and Mixed-signal Layout 개요 : ● CAD 알고리즘이..

구재희 05.04.14 635
4 e2l-접적회로-CMOS Analog 설계

signal 해석, 회로설계

구재희 05.01.05 966
3 e2l-접적회로-CAD algorithms: design verification of VLSI systems

영문제목 : CAD algorithms: design verification of VLSI systems 개요 : ● CAD 알고..

구재희 04.12.30 831
2 e2l-접적회로-A/D 및 D/A 변환기 설계, 혼성모드 Layout

영문제목 : Design of ADC and DAC and Mixed-signal Layout 개요 : ● CAD 알고리즘이..

구재희 04.12.30 748
1 e2l-통신 및 신호처리-VLSI Digital signal Processing

영문제목 : VLSI Digital signal Processing 개요 : 디지털 신호처리는 비디오 압축, ..

구재희 05.01.05 644
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구분 제목 작성자 작성일 조회
참여교수 성과 - 논문 A Speculative Divide-and-Conquer Optimization Method for Large Analo..

김병섭 24.03.04 6
참여교수 성과 - 논문 A Wireline Transceiver with 3-bit per Symbol Using Common-Mode NRZ a..

김철우 24.02.20 16
참여교수 성과 - 논문 A 24.1 TOPS/W mixed-signal BNN processor in 28-nm CMOS

범진욱 24.02.13 6
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이수연 24.02.08 3
참여교수 성과 - 논문 A New Line-by-Line SWEEP signal Generation Method for PWM Driving Mi..

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참여교수 성과 - 특허 Spectral Leakage-Based Loopback Method for Predicting Performance of..

signal circuit. The method includes generating, by an on-chip Digital signal Proces..

김병호 24.02.01 7
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차혁규 24.02.01 8
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이재성 24.01.30 13
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이형민 24.01.21 5
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제민규 24.01.12 49
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참여교수 성과 - 논문 Leaky FinFET for Reservoir Computing with Temporal signal Processing

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조규성 24.01.05 3
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김철우 24.01.05 9
참여교수 성과 - 논문 A 65nm 12.92 nJ/inference Mixed-signal Neuromorphic Processor for Im..

전동석 24.01.03 8
참여교수 성과 - 논문 TFET-Based Pixel Source Follower of CMOS Image Sensor for Improved L..

윤일구 24.01.03 5
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