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우선 ykchoi_2018_Sentaurus hostname 을 가진 서버에서 네트워크 라이선스를 ..

답변 감사드립니다.   라이센스 파일에 작성된 hostname을 이미 변경하고 나서 라..

라이선스 파일에서 추가로 수정할 부분은 없습니다. 터미널 창에서 hostname 엔터 하여 ..

터미널 창에서 hostname 명령어를 입력하였을경우 정상적으로 ykchoi_2018_Sentauru..

서버의 hostname 변경 후 /etc/hosts 파일에 해당 서버에 대한 내용 중 hostname 을 수..

 /etc/hosts의 hostname을 수정하지 않았었습니다.   정상적으로 작동합니다..

안녕하세요. 인천대학교 전자공학과 송준영입니다.   서버 재부팅 후 Synopsys l..

안녕하세요. IDEC 연구원 조인신입니다.   VENDOR snpslmd /data1/tools/SYNOPSY..

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안녕하십니까 극동대학교 강이구 교수님 연구실 석사과정중인 김세영 입니다. 이번 lic..

안녕하세요. IDEC 연구원 조인신입니다.   첨부한 내용을 보면 라이선스 데..

안녕하십니까 극동대학교 강이구교수님 연구실 석사과정중인 김세영 입니다.   감..

사용하고 있는 서버의 OS type 및 종류, 버전등이 확인되지 않으나 사용..

  카이스트 신영수교수님 연구실 cad tool담당 정영광입니다.   3:16:59 (s..

안녕하세요. IDEC 연구원 조인신입니다.   다운로드 받은 라이선스 파일에는 여..

안녕하세요, 고려대학교 이형민교수님 연구실 이한솔이라고 합니다.  이번에 진행..

 안녕하세요 IDEC 김연태 입니다.  ㄷ  cadence tool 을 이용하여 칩 ..

SerDes 설계에 참고 할 수 있는 다양한 웨비나 리스트를 아래 공유 드립니다. (웨비나 6..

영문제목 : RF Semiconductor Physics 개요 : 초고주파대역의 반도체물리 및 소자에 대..

영문제목 : communication & semiconductor 개요 : 키워드 : VLSI, Communication, ..

signalIntegity 개요 : 키워드 : 배선, 신호의 무결성

영문제목 : communication & semiconductor 개요 : ● 전송 및 교환, 모뎀: 전전자식 교..

signalIntegity 개요 : ● Scaling ● Low-k ● Copper ●지연 시간 ●전송선 모델 ● signal..

signal representation, baseband transmission, passband transmission, transmission o..

signal-processing platform for Software Defined Radio (SDR) applications such as Ta..

영문제목 : CAD algorithms: design verification of VLSI systems 개요 : 키워드 :..

영문제목 : Design of ADC and DAC and Mixed-signal Layout 개요 : 키워드 : ADC, ..

영문제목 : Design of ADC and DAC and Mixed-signal Layout 개요 : ● CAD 알고리즘이..

signal 해석, 회로설계

영문제목 : CAD algorithms: design verification of VLSI systems 개요 : ● CAD 알고..

영문제목 : Design of ADC and DAC and Mixed-signal Layout 개요 : ● CAD 알고리즘이..

영문제목 : VLSI Digital signal Processing 개요 : 디지털 신호처리는 비디오 압축, ..

빠른 시일 내로 개설 부탁드립니다. 1월에서 2월 사이 정원초과로 인해 추가로 학생은 ..

빠른 시일 내로 개설 부탁드립니다. 1월에서 2월 사이  정원초과로 인해 추가로 학..

안녕하세요. signal Integrity 분석을 위한 이론 교육이 개설되었으면 좋겠습니다. 업..