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| 제목 | 강사정보 | 등록일 | |
|---|---|---|---|
| 13 | Reliability of Analog and mixed-signal circuits | 김병호 한양대학교 교수 | 2024.02.07 |
| 12 | 신호 및 전력 무결성 (signal_Power Integrity)를 고려한 Package, PCB 및 Intercon.. | 김영우/교수/세종대 | 2023.03.17 |
| 11 | CMOS Analog 전자회로 설계 - 2019(2) | 박주성/이사/(주)텔로팜 | 2019.09.23 |
| 10 | CMOS Analog 전자회로설계 - 2019 | 박주성/교수/부산대학교 | 2019.03.26 |
| 9 | Matlab을 이용한 Digital signal Processing - 2019 | 김태훈/교수/동의과학대 | 2019.03.26 |
| 8 | 임베디드 시스템 설계_Digital Debugging | 심규현 강사 한성대학교 | 2018.10.04 |
| 7 | CMOS Analog 전자회로설계 | 최영식/교수/부경대학교 | 2018.02.20 |
| 6 | CMOS Analog 전자회로 설계 | 박주성/교수/부산대학교 | 2016.12.12 |
| 5 | CMOS Analog 회로설계 | 최영식/교수/부경대학교 | 2016.12.12 |
| 4 | [무료세미나]Fallacies of Computational Analog | 송방섭 교수(U.S San Diego) | 2016.03.25 |
| 3 | Matlab을 이용한 Digital signal Processing | 김태훈 부교수(동의과학대) | 2015.11.09 |
| 2 | [무료세미나]How analog has been evolved_송방섭 교수(U. C. San Diego) | 송방섭 교수(U. C. San Diego) | 2014.10.31 |
| 1 | CMOS 이미지 센서 교육 | 이성수 상무(픽셀플러스) | 2014.10.31 |
교육자료
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 2 | Matlab을 이용한 digital signal processing | 윤성심 | 15.08.25 | 997 |
| 1 | Analog/RF/Mixed-signal circuit design trend in Silicon Valley for High-Speed Wir | 구재희 | 13.08.01 | 739 |
질문/답변
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 54 |
AMS 디자인 관련 문의드립니다.
signal simulation 수업을 idec에서 듣고 제 컴퓨터에 설치도중 문의사항이 생겨 글을 남.. |
양이삭 | 17.03.08 | 7 |
| 53 |
[답변] AMS 디자인 관련 문의드립니다.
signal simulation 수업을 idec에서 듣고 제 컴퓨터에 설치도중 문의사항이 생겨 글을 남.. |
조인신 | 17.03.08 | 8 |
| 52 |
[답변] [답변] AMS 디자인 관련 문의드립니다.
signal simulation 수업을 idec에서 듣고 제 컴퓨터에 설치도중 문의사항이 생겨 글을 남.. |
양이삭 | 17.03.08 | 6 |
| 51 |
[답변] VCS fsdb 관련 문의
signal in all scope -1 : all signal in current scope -2 : a.. |
김연태 | 17.02.13 | 57 |
| 50 |
[장익준] Synopsys VCS: Mixed signal compiled error
Hello, I tried to mix the Customsim-XA and VCS. After compiled, I got 1 problem as.. |
Thanh | 17.01.05 | 37 |
| 49 |
[답변] Synopsys VCS: Mixed signal compiled error
Dear Thanh Sorry we can't know exactly about your problems .. |
선혜승 | 17.01.06 | 28 |
| 48 |
[답변] [답변] Synopsys VCS: Mixed signal compiled error
Hello , After registered, They said that Only 2 users can be registered to t.. |
Thanh | 17.01.06 | 4 |
| 47 |
[답변] [답변] [답변] Synopsys VCS: Mixed signal compiled error
Dear Thanh Then, your professor or your colleagues may know the sy.. |
선혜승 | 17.01.09 | 28 |
| 46 |
[정하연] spectre 관련 monte carlo save 방법 질문드립니다.
signal voltage 값을 보고 있습니다. 하지만, monte carlo를 돌리고 결과값 파일을 관찰.. |
이강훈 | 16.11.10 | 11 |
| 45 |
[답변] spectre 관련 monte carlo save 방법 질문드립니다.
signal voltage 값을 보고 있습니다. 하지만, monte carlo를 돌리고 결과값 파일을 관찰.. |
조인신 | 16.11.10 | 3 |
| 44 |
[답변] [답변] spectre 관련 monte carlo save 방법 질문드립니다.
signal voltage 값을 보고 있습니다. 하지만, monte carlo를 돌리고 결과값 파일을 관찰.. |
이강훈 | 16.11.10 | 3 |
| 43 |
[답변] [답변] [답변] spectre 관련 monte carlo save 방법 질문드립니다.
signal voltage 값을 보고 있습니다. 하지만, monte carlo를 돌리고 결과값 파일을 관찰.. |
조인신 | 16.11.10 | 14 |
| 42 |
[정하연] 안녕하세요. virtuoso calculator에 관해 질문 드립니다.
signal의 개수를 count 하고 싶습니다. 때문에, Cross 함수를 이용하여 0.3V에 도달하는.. |
이강훈 | 16.10.29 | 9 |
| 41 |
[답변] 안녕하세요. virtuoso calculator에 관해 질문 드립니다.
signal의 개수를 count 하고 싶습니다. 때문에, Cross 함수를 이용하여 0.3V에 도달하는.. |
조인신 | 16.10.31 | 6 |
| 40 |
[답변] [답변] 안녕하세요. virtuoso calculator에 관해 질문 드립니다.
signal을 count 하는것이 아니라, 입력 y값에 따른 x값을 불러왔습니다. .. |
이강훈 | 16.10.31 | 4 |
| 39 |
[답변] [답변] [답변] 안녕하세요. virtuoso calculator에 관해 질문 드립니다.
signal을 count 하는것이 아니라, 입력 y값에 따른 x값을 불러왔습니다. .. |
조인신 | 16.10.31 | 4 |
| 38 |
[답변] [답변] 삼성 65nm DRC, LVS 관련 질문드립니다.
signal line주변에 채워 지는 것이 걱정이 되서 여쭤보는 것입니다. 첨부한 사진과 같이.. |
김신영 | 16.10.07 | 33 |
| 37 |
[답변] [답변] [답변] 삼성 65nm DRC, LVS 관련 질문드립니다.
signal line주변에 채워 지는 것이 걱정이 되서 여쭤보는 것입니다. 첨부한 사진과 같이.. |
선혜승 | 16.10.07 | 145 |
| 36 |
[답변] [답변] spectreVerilog simulator, ADEXL 문의
signal SIGTERM.oo [조인신 ]님의글 =========================.. |
정동혁 | 16.07.20 | 20 |
| 35 |
[답변] [답변] [답변] spectreVerilog simulator, ADEXL 문의
signal SIGTERM.oo [조인신 ]님의글 =========================.. |
조인신 | 16.07.20 | 11 |
자료실
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 15 |
SerDes System 설계 관련 웨비나 공유
SerDes 설계에 참고 할 수 있는 다양한 웨비나 리스트를 아래 공유 드립니다. (웨비나 6.. |
김영지 | 21.03.10 | 1280 |
| 14 |
e2l-반도체공학-초고주파 반도체 물리학
영문제목 : RF Semiconductor Physics 개요 : 초고주파대역의 반도체물리 및 소자에 대.. |
구재희 | 06.08.09 | 1981 |
| 13 |
e2l-반도체공학-반도체의 주요 응용 분야: 통신 및 신호처리와 반도체
영문제목 : communication & semiconductor 개요 : 키워드 : VLSI, Communication, .. |
구재희 | 06.06.13 | 1459 |
| 12 |
e2l-반도체공학-집적회로 설계 기술: 배선 및 신호의 무결성
signalIntegity 개요 : 키워드 : 배선, 신호의 무결성 |
구재희 | 05.09.07 | 1520 |
| 11 |
e2l-반도체공학-반도체의 주요 응용 분야: 통신 및 신호처리와 반도체
영문제목 : communication & semiconductor 개요 : ● 전송 및 교환, 모뎀: 전전자식 교.. |
구재희 | 04.12.30 | 852 |
| 10 |
e2l-반도체공학-집적회로 설계 기술: 배선 및 신호의 무결성
signalIntegity 개요 : ● Scaling ● Low-k ● Copper ●지연 시간 ●전송선 모델 ● signal.. |
구재희 | 04.12.30 | 1060 |
| 9 |
e2l-디지털시스템-디지털 통신
signal representation, baseband transmission, passband transmission, transmission o.. |
구재희 | 08.07.16 | 815 |
| 8 |
e2l-디지털시스템-소프트웨어 래디오 설계 방법론
signal-processing platform for Software Defined Radio (SDR) applications such as Ta.. |
구재희 | 06.12.21 | 842 |
| 7 |
e2l-접적회로-CAD algorithms: design verification of VLSI systems
영문제목 : CAD algorithms: design verification of VLSI systems 개요 : 키워드 :.. |
구재희 | 05.09.07 | 754 |
| 6 |
e2l-접적회로-A/D 및 D/A 변환기 설계, 혼성모드 Layout
영문제목 : Design of ADC and DAC and Mixed-signal Layout 개요 : 키워드 : ADC, .. |
구재희 | 05.09.07 | 755 |
| 5 |
e2l-접적회로-A/D 및 D/A 변환기 설계, 혼성모드 Layout
영문제목 : Design of ADC and DAC and Mixed-signal Layout 개요 : ● CAD 알고리즘이.. |
구재희 | 05.04.14 | 635 |
| 4 |
e2l-접적회로-CMOS Analog 설계
signal 해석, 회로설계 |
구재희 | 05.01.05 | 966 |
| 3 |
e2l-접적회로-CAD algorithms: design verification of VLSI systems
영문제목 : CAD algorithms: design verification of VLSI systems 개요 : ● CAD 알고.. |
구재희 | 04.12.30 | 831 |
| 2 |
e2l-접적회로-A/D 및 D/A 변환기 설계, 혼성모드 Layout
영문제목 : Design of ADC and DAC and Mixed-signal Layout 개요 : ● CAD 알고리즘이.. |
구재희 | 04.12.30 | 748 |
| 1 |
e2l-통신 및 신호처리-VLSI Digital signal Processing
영문제목 : VLSI Digital signal Processing 개요 : 디지털 신호처리는 비디오 압축, .. |
구재희 | 05.01.05 | 644 |
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기타 게시판
| 구분 | 제목 | 작성자 | 작성일 | 조회 |
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| 참여교수 성과 - 논문 |
Band pass Filter with Pseudo-Resistor for Biosensor signal Detection
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최영완 | 14.09.22 | 7 |
| 참여교수 성과 - 특허 |
EMORY DEVICE BASED ON DOMAIN WALL MEMORY AND READING AND
EMORY DEVICE BASED ON DOMAIN WALL MEMORY AND READING ANDWRITING METHOD THEREOF, AND.. |
박종선 | 16.10.19 | 7 |
| 참여교수 성과 - 특허 |
SYNTHESIZING METHOD OF signal HAVING VARIABLE FREQUENCY AND SYNTHESI..
|
김재하 | 16.10.18 | 2 |
| 참여교수 성과 - 특허 |
송신기
signaling 기술을 적용한 transmitter에 대한 발명으로 데이터 transition에 소모되는 전.. |
유창식 | 16.09.29 | 4 |
| 참여교수 성과 - 논문 |
MEMS piezoelectric artificial basilar membrane with passive frequenc..
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최홍수 | 14.09.20 | 1 |
| 참여교수 성과 - 특허 |
POWER AMPLIFIER WITH ADVANCED LINEARITY
signal; a high power amplification unit amplifying a signal suppressed by the input.. |
서철헌 | 15.09.07 | 3 |
| 참여교수 성과 - 특허 |
저스윙 저전력 니어-그라운드 시그널링 송수신기 및 그 동작 방법
【발명의 명칭】 저스윙 저전력 니어-그라운드 시그널링 송수신기 및 그 동작 방법{LOW-.. |
김종선 | 15.09.05 | 0 |
| 참여교수 성과 - 논문 |
Design and Measurement of a Compact On-interposer Passive Equalizer ..
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김정호 | 14.09.19 | 4 |
| 참여교수 성과 - 논문 |
Long Life-Time Amorphous-InGaZnO TFT-Based Shift Register Using a Re..
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정훈주 | 14.09.18 | 4 |
| 참여교수 성과 - 논문 |
Control of IMD Asymmetry of CMOS Power Amplifier for Broadband Opera..
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김범만 | 14.09.18 | 3 |
| 참여교수 성과 - 논문 |
Design of crosstalk compensation passive equalizers for high-speed d..
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김정호 | 14.09.18 | 4 |
| 참여교수 성과 - 특허 |
DIGITAL signal PROCESSOR AND DATA INPUTTING/OUTPUTTING METHOD
디지털 신호처리 프로세서 및 데이터 입출력 방법 |
박종선 | 15.09.02 | 3 |
| 참여교수 성과 - 논문 |
Control signal Aware Slice-Level Window Based Legalization Method fo..
|
한양대 캠퍼스 | 14.09.18 | 9 |
| 참여교수 성과 - 특허 |
APPARATUS AND METHOD FOR GENERATING RAMP signal
APPARATUS AND METHOD FOR GENERATING RAMP signal |
김철우 | 15.09.02 | 5 |
| 참여교수 성과 - 논문 |
An 1.61mW mixed-signal column processor for BRISK feature extraction..
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유회준 | 14.09.18 | 10 |
| 참여교수 성과 - 논문 |
Multi Sensor Voltage signal Conditioner with Adaptive Level Shift an..
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유형준 | 14.09.18 | 12 |
| 참여교수 성과 - 특허 |
LOGIC GATE USING SCHMITT TRIGGER CIRCUIT
signals, perform a NAND logic operation, and output a first output signal; and a DT.. |
김소영 | 15.09.01 | 15 |
| 참여교수 성과 - 특허 |
Receiver, system including the same, and calibration method thereof
signal received from a clock channel by a predetermined time and output a second cl.. |
정덕균 | 15.09.01 | 9 |
| 참여교수 성과 - 특허 |
Level-down shifter
signal, and adjusting a first node voltage of the first node based on the reference.. |
정덕균 | 15.09.01 | 5 |
| 참여교수 성과 - 특허 |
Rail-to-rail comparator, pulse amplitude modulation receiver, and co..
signals to differential reference voltage. |
범진욱 | 15.09.01 | 10 |


