반도체설계교육센터

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	제목	강사정보	등록일
22	(2025) Cell-Based Chip Design Flow_Day1	김연태,선혜승/연구원/IDEC	2025.12.30
21	Standard Cell Based Design (RTL-to-GDSII)	박희천 조교수(UNIST)	2025.01.20
20	[IDEC 제작강좌] Full Custom Layout Design (PEX)	정용운/조교수/세종대학교	2024.10.23
19	[IDEC 제작강좌] Full Custom Layout Design (DRC&LVS)	정용운/조교수/세종대학교	2024.10.23
18	(2021) AMBA AXI와 AXI-Stream 설계와 검증	기안도 겸직교수(KAIST)	2021.05.11
17	논리합성 설계툴을 활용한 회로설계 및 STA분석 이해 및 실습	손병복 연구소장 (주)아이즈비	2020.03.24
16	Verilog 설계 언어 초급	송재훈 대표이사 INNOTIO(주)	2020.03.24
15	파워반도체 소자 핵심이론	강혜민/박사/Cambridge University	2019.12.19
14	Verilog 기초 및 Digital 설계	조경순/교수/한국외국어대학교	2019.09.25
13	Verilog HDL 언어 초급 및 설계 가이드라인	송재훈 대표이사 INNOTIO(주)	2018.11.02
12	Verilog HDL 이론 및 응용	이찬호/교수/숭실대학교	2018.10.30
11	Verilog HDL 언어 초급 및 설계 가이드라인	송재훈 대표이사 INNOTIO(주)	2017.11.30
10	(2017)기가비트 이더넷제어기 설계와 응용설계	기안도 소장 (주)다이나릿시스템	2017.02.15
9	Mobile transceiver RFIC 설계	문현원 교수 대구대학교	2016.12.16
8	Verilog HDL 언어 초급 및 설계 가이드라인	송재훈 대표이사 INNOTIO	2016.12.13
7	고성능 TI SAR ADC설계를 위한 이론 및 실습	홍혁기 박사(전자정보연구소)	2016.07.27
6	(2016)CPU-GPU Heterogeneous Computing	장병현 교수(the University of Mississippi)	2016.06.16
5	[무료세미나]Fallacies of Computational Analog	송방섭 교수(U.S San Diego)	2016.03.25
4	RTOS 지원 시스템 설계와 RTOS 이식	기안도 소장 (다이나릿시스템)	2016.02.24
3	Verilog 설계언어 초·중급	송재훈 대표이사 INNOTIO	2015.10.15
2	[무료세미나]How analog has been evolved_송방섭 교수(U. C. San Diego)	송방섭 교수(U. C. San Diego)	2014.10.31
1	(2014)CPU-GPU Heterogeneous Computing	장병현 교수(the University of Mississippi)	2014.10.31

교육자료

	제목	작성자	작성일	조회
4	Protocol Transducer Synthesis using Divide and Conquer Approach	구재희	07.04.25	72
3	Gigabit Ethernet Switch/Router의 설계 및 구현	구재희	02.05.09	153
2	Synopsys Chip Synthesis 교육	구재희	01.04.13	736
1	Synopsys Tool 교육(VCS & Chip Synthesis)	구재희	00.06.02	1239

질문/답변

	제목	작성자	작성일	조회
3084	[답변] SS28 PEX Configuration issue the virtuoso 2. Used the LVS rule file as the PEX rule file --> pdk_..	조인신	24.12.24	22
3083	Catapult Ultra와 Design Compiler 연동 질문 thesis Tool을 Design Compiler로 합성을 진행하고 있습니다 RTL코드 생성까지..	김상현	24.12.15	30
3082	[답변] Catapult Ultra와 Design Compiler 연동 질문 thesis Tool을 Design Compiler로 합성을 진행하고 있습니다 RTL코드 생성까지..	김연태	24.12.24	16
3081	TCAD 라이선스 구동 오류 the problem You could try running: rpm -Va --nofiles --nodigest	이관용	24.12.14	53
3080	[답변] TCAD 라이선스 구동 오류 the problem You could try running: rpm -Va --nofiles --nodigest	조인신	24.12.16	34
3079	[답변] Siemens Calibre PEX 오류 the PDB 가 체크되어 있는지 확인해 보시기 바랍니다. [이종복]님의 글 =======..	조인신	24.12.16	10
3078	[SF28-2402] - LMF-02015, ELI-00138 ERROR 안녕하세요 경기대학교 김지훈 교수님 연구실 학부연구생 ..	김지훈	24.12.09	29
3077	[답변] [SF28-2402] - LMF-02015, ELI-00138 ERROR 안녕하세요. IDEC 조인신입니다. 라이선스 서버에 갑자기 문제가 발생..	조인신	24.12.09	23
3076	[답변] [SF28-2402] - LMF-02015, ELI-00138 ERROR 접속되는거 확인했습니다. 감사합니다. [조인신]님의 글 =======..	김지훈	24.12.09	39
3075	[SF28-2402] PSS 시뮬레이션 관련 문의 these convergence difficulties. 1. Evaluate and resolve any notice, warning, or er..	김상윤	24.12.09	22
3074	[답변] [SF28-2402] PSS 시뮬레이션 관련 문의 these convergence difficulties. 1. Evaluate and resolve any notice, warning, or er..	조인신	24.12.09	36
3073	[SS28-2402] Digital LVS - v2lvs on merge server the log result when convert write_data.lvs.v.gz to write_data.lvs.spi&nbs..	TRAN SANG	24.12.05	37
3072	[답변] [SS28-2402] Digital LVS - v2lvs on merge server the log result when convert write_data.lvs.v.gz to write_data.lvs.spi&nbs..	김연태	24.12.05	71
3071	Request for clarifying about shrink process the CMOS 28LP process uses a 90% shrink process. My design includes an inductor&mda..	변경수	24.12.05	19
3070	[답변] Request for clarifying about shrink process the CMOS 28LP process uses a 90% shrink process. My design includes an inductor&mda..	김연태	24.12.05	23
3069	[답변] [SS28-2402] virtuoso 실행 문제 문의드립니다. the value of variable 'mismatchdepfile', in tool[.partition] 'spectre.mc' - it has ..	우희정	24.12.04	54
3068	[답변] [SS28-2402] virtuoso 실행 문제 문의드립니다. the value of variable 'mismatchdepfile', in tool[.partition] 'spectre.mc' - it has ..	조인신	24.12.04	59
3067	[SS28-2402] Can not fix hold violation in hierachy top module the top only? Thank you. set_dont_touch AE_v2set_dont_touch EA_V2set_dont_touch To..	TRAN SANG	24.12.03	24
3066	[답변] [SS28-2402] Can not fix hold violation in hierachy top module the 'slack_lesser_than' clause. You can fix it by directly inserting a buffer. &n..	김연태	24.12.04	41
3065	Error of set_operating_condition, unmapped cell thesis 진행 중에 오류가 생겨 질문드립니다. 1. set operating condition 오류 합성..	박하늘	24.11.28	35

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자료실

	제목	작성자	작성일	조회
6	e2l-접적회로-CAD 및 컴퓨터시스템 특론 thesis 시스템을 구축하기 위한 방법론에 대하여 연구한다. 이를 위해 design automation..	구재희	05.01.05	790
5	e2l-접적회로-Basic theory and Application of PLL 영문제목 : Basic theory and Application of PLL 개요 : ● CMOS A/D 변환기의 기능과 ..	구재희	04.12.30	786
4	e2l-통신 및 신호처리-Fourier변환과 Laplace변환 their applications to circuit analysis 개요 : 전자회로1을 수강하는 학생을 대상으..	구재희	06.07.18	768
3	e2l-초고주파 회로-CMOS RF thesizer	구재희	05.01.11	970
2	e2l-초고주파 회로-RF-IC thesizer	구재희	05.01.05	788
1	e2l-초고주파 회로-RF IC공학 thesizer, wireless	구재희	05.01.05	909

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기타 게시판

구분	제목	작성자	작성일	조회
공지사항	[MPW]2026년 MPW 지원 공정 및 일정_4월 IC Design Education Center(IDEC) 2026년 IDEC MPW 모집 안..	이의숙	26.04.07	179
공지사항	[홍보] 제2회 2026년 시스템 반도체 설계 챌린지 대회 개최 안내 안녕하세요. 반도체설계교육센터(IDEC)에서 전국 대학교 학부생을 대상으로, ‘..	전우숙	26.03.27	3921
참여교수 성과 - 논문	Suppressing the Capacitive Coupling by Adjusting the Precharge Biasi..	김장현	26.03.23	2
공지사항	[홍보]차세대 반도체 소자 워크샵 2026 (2026.04.03(금) , 한국반도체산.. theieie.org/events/?part=02&c_id=982 ▶ 초대의 글 현재 반도..	이의숙	26.03.18	217
참여교수 성과 - 논문	A Synthesizable Quarter-Rate CDR based on All DigitalFractional-N PL..	심재윤	26.02.24	4
참여교수 성과 - 논문	Improving the Efficiency of a 10 MHz Voltage Regulator Using a PCB-E..	김소영	26.02.20	7
참여교수 성과 - 논문	Design of Analog Front-End for the Wideband Wireline Receiver	남재원	26.02.20	3
참여교수 성과 - 논문	MASH Digital Delta-Sigma Modulators for the CMOS Qubit Controller	남재원	26.02.20	2
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