| 강의제목 | (2017)기가비트 이더넷제어기 설계와 응용설계 | |||||||||||||||||||||||||||||||||||||
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| 구분 | 본센터 / 설계강좌 / 중급 / 이론+실습 | |||||||||||||||||||||||||||||||||||||
| 강의시간 | 11.25시간 | 열람기간 | 15일 | |||||||||||||||||||||||||||||||||||
| 이용료(일반) | 무료 | 이용료(학생) | 무료 | |||||||||||||||||||||||||||||||||||
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[강좌 개요] 기가비트 이더넷 제어기(Gigabit Ethernet Controller, MAC)를 설계하고 활용하는 방법을 RTL 설계부터 FPGA 보드에 적용하는 과정까지 배우고 실습한다. 더 나아가 내장형 프로세서를 통합하여 통신응용을 개발해 보는 과정을 이해하고 실습함으로써 이더넷과 관련한 하드웨어/소프트웨어 통합설계/검증 방법을 배우고 익힌다. 주요 내용은 다음과 같다. -첫째, 기가비트 이더넷을 중심으로 이더넷의 이해 -둘째, C 프로그램으로 PC 의 네트워크 카드를 통해 정보를 송수신하는 방법 -셋째, 이더넷 제어기(MAC)를 RTL 부터 설계하고 FPGA 보드에 적용 -넷째, 설계한 이더넷 제어기를 이용하여 통신프로토콜 스택 이식 -다섯째, 통신 응용으로 TFTP, HTTP (Webserver) 등을 구현하여 적용 -여섯째, 이더넷과 관련된 주요 응용기술 소개와 실습 (video over Ethernet, time synchronization, industrial Ethernet) [강의대상] 시스템반도체 설계자와 내장형시스템 설계자 [사전지식] Digital Logic, Computer Architecture, Computer Communication, C programming/compilation/debugging, Verilog design/simulation/synthesis, FPGA design flow, On-Chip bus (AMBA), text editor (VI), Shell pr§§§ ※ 이 영상은 저작권법에 의해 보호됩니다. 본 강의 영상의 무단 복제 및 배포를 금지합니다
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