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delay 파일을 만들어내구요    ICC 에서 write_parasitics -format SPE..

de하려고 하는데요. 해당 파일을 찾을 수가 없어서 어떤 파일을 include 하면 될지 문의..

del 폴더에 있는  .V 들을 이용하시면 됩니다  hgi 는 io 라이브러리 입니다 ..

안녕하세요. IdeC 연구원 조인신입니다.   결과 창의 좌표에 문제가 있어 창이 ..

  .cgidrcdb, .cgilvsdb, .cgipexdb, .rvedb 을 삭제하여 문제를 해결하였습니다. ..

de 하면 될 것으로 보입니다. 파일 생성은 기본 제공 par 파일을 참고하여 작성하시기 ..

안녕하십니까. 부산대학교 Bit engineering lab입니다. 저희가 현재 design compiler, ..

dec.or.kr/board.php?db=m7_3&uid=8&no=16895&c=view&page=1&sch_se..

안녕하세요. IdeC 연구원 조인신입니다.   우선 사용하고 있는 calibre 의 버전..

흠 보내주신 calview.cellmap파일도 동일한 warning이 발생하네요 현재 사용하고 있는 c..

문제가 발생하는 것은 사용하고 있는 calibre 의 버전이 낮아 ..

demon 버젼은 11.11버젼이었습니다.  데몬 버젼이 낮아서 그런걸까요?  [조..

demon 버젼은 11.11버젼이었습니다.  데몬 버젼이 낮아서 그런걸까요?  [조..

dec.or.kr): mgcld: UP v11.13.1Feature usage info: Users of accuparts: (Total of 3..

안녕하세요. IdeC 연구원 조인신입니다.   CDL import 는 virtuoso do..

Error: Unexpected operator "<". Expected end of file or end of line.Error: SPICE..

device mapping 파일이 있어야 하는데 없다면 직접 만들어야 하고 제대로 만들려면 여러..

dec 서버 쪽 문제였다고 해주셨었는데, 이번에도 한 번 확인 부탁드립니다..

dec 서버 쪽 문제였다고 해주셨었는데, 이번에도 한 번 확인 부탁드립니다..

deck 에서 빠지게 됩니다.   Tool 이슈로 보이는데, 이와 관련된 답변을 얻을 수 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dec.or.kr/IdeC_library/library/view/?&no=46668  (권장 툴 버전은 진행하는 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

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dence Indago는 시뮬레이션 디버깅 툴 입니다. (debug Analyzer)시뮬레이션 파형과 소스..

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dec.or.kr 로 주시면 됩니다.  최종 수정일 : 2021년 4월 30일   ..

deling Serdes CTLE Using Transfer Function Data 전달함수 데이터를 이용한 Serdes CT..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence Virtuoso Ade L, XL (제공자 : KAIST 류승탁 교수, 김예담)    ..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

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device and having a negative capacitance, wherein the FinFET device has an extensio..

“연속적인 근사 레지스터 아날로그 디지털 변환 장치,” 출원번호: 제10-2017..

“레인지-스케일링 기반의 복합 파이프라인 아날로그-디지털 컨버터,” 출원번..

“데이터 구동 회로 및 이를 포함하는 표시 장치,” 출원번호: 제10-2017-0012..

“부분 소자 정합 기법 기반의 전류 구동 디지털 아날로그 컨버터,” 출원번호..

“이중채널 비동기 파이프라인 SAR ADC,” (10비트 200MS/s 28nm CMOS), 출원..

device”, [미국 출원 관리번호 P2017-0079US, 출원번호 15/439,647, 출원일자 2017..

“채널 간 오프셋 부정합을 최소화하는 시간 인터리빙 구조의 파이프라인 SAR ADC,&..

양방향성 주파수 검출기(FD: Frequency detector)와 주파수 대역 선택기를 이용한 기준 ..