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질문/답변
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 1273 |
[답변] 삼성65nm 공정 관련 문의드립니다.
IdeC 선혜승입니다 죄송합니다 규정상 삼성 서버이외에는.. |
선혜승 | 16.06.26 | 29 |
| 1272 |
[답변] [답변] 삼성65nm 공정 관련 문의드립니다.
안녕하세요. 인터넷에 검색해본 결과 터미널창에서 xpdf 라는 명령어로 pdf를 열.. |
서정덕 | 16.06.27 | 2 |
| 1271 |
[답변] [답변] [답변] 삼성65nm 공정 관련 문의드립니다.
IdeC 선혜승입니다 GUI 방식으로 접속하여 pdf 를 보신다고 하셨는.. |
선혜승 | 16.06.27 | 1 |
| 1270 |
[답변] [답변] [답변] [답변] 삼성65nm 공정 관련 문의드립니다.
GUI방식에서 pdf파일을 더블클릭하여실행하고 있습니다. 터미널에서 gnome-open .. |
서정덕 | 16.06.27 | 10 |
| 1269 |
[답변] OpenVPN 접속 불량 문제관련해서 문의드립니다.
IdeC 선혜승입니다 오늘과 내일 서버 관리자께서 출장입니다&nbs.. |
선혜승 | 16.06.27 | 13 |
| 1268 |
[김수환] Finesim 사용관련
de: promdResource Usage for Parsing(self/cum): 0.7/0.7 sec, 189.7/189.7 MBLicense: .. |
김현종 | 16.06.24 | 24 |
| 1267 |
[답변] Finesim 사용관련
de: promdResource Usage for Parsing(self/cum): 0.7/0.7 sec, 189.7/189.7 MBLicense: .. |
조인신 | 16.06.24 | 44 |
| 1266 |
[답변] 삼성65nm 공정 질문입니다.
IdeC 선혜승입니다 죄송하지만 질문하신 분은 삼성 공정.. |
선혜승 | 16.06.26 | 29 |
| 1265 |
[답변] [답변] 삼성65nm 공정 질문입니다.
안녕하세요. 성균관대학교 박사과정 안정근입니다. 지도교수님은 공배선 교수님이십니다.. |
안정근 | 16.06.26 | 3 |
| 1264 |
[답변] [답변] [답변] 삼성65nm 공정 질문입니다.
IdeC 선혜승입니다 가지고 계신 pdk 에 이미 들어 있습니다 .. |
선혜승 | 16.06.27 | 5 |
| 1263 |
[답변] 교육관련 문의입니다.
IdeC 선혜승입니다 해당 교육은 당장 기약은 없습니다만 .. |
선혜승 | 16.06.26 | 8 |
| 1262 |
[답변] 다이 포토 관련
안녕하세요. IdeC 연구원 조인신입니다. 칩 사진은 추후 칩 제작 완료 .. |
조인신 | 16.06.24 | 36 |
| 1261 |
[답변] Calibre 라이센스 획득 과정에서 자꾸 문제가 생깁니다.
안녕하세요. IdeC 연구원 조인신입니다. 첨부하신 파일만으로는 실.. |
조인신 | 16.06.23 | 20 |
| 1260 |
[답변] [답변] Calibre 라이센스 획득 과정에서 자꾸 문제가 생깁니다.
현재 lmstat의 정보입니다. 1717@tomato.postech.ac.kr은 저희가 따로 구비.. |
노현규 | 16.06.27 | 17 |
| 1259 |
[답변] [답변] [답변] Calibre 라이센스 획득 과정에서 자꾸 문제가 생깁니다.
안녕하세요. IdeC 연구원 조인신입니다. 하기 문의에 대해서는 전.. |
조인신 | 16.06.27 | 19 |
| 1258 |
[답변] 삼성 65nm drc 에러 질문드립니다.
design_manual_V1500.pdf 파일의 110~112 페이지를 참고하면 되며, 예시로 layout .. |
조인신 | 16.06.23 | 11 |
| 1257 |
[답변] 삼성 65nm 공정 drc 에러 질문드립니다.
design_manual_V1500.pdf 파일의 97 page 를 보면 해당 rule 에 대해 설명이 되어 있으.. |
조인신 | 16.06.22 | 24 |
| 1256 |
[답변] [답변] 삼성 65nm 공정 drc 에러 질문드립니다.
de를 N을 바꾸어 주고 연결한 다음 SUB 핀을 VDD에 따로 연결하여 주면 되는건가요? 질.. |
정재승 | 16.06.22 | 8 |
| 1255 |
[답변] [답변] [답변] 삼성 65nm 공정 drc 에러 질문드립니다.
de를 N을 바꾸어 주고 연결한 다음 SUB 핀을 VDD에 따로 연결하여 주면 되는건가요? 질.. |
조인신 | 16.06.22 | 47 |
| 1254 |
[답변] 디지털 코어 layout과정에 관하여 궁금하게 있어서 질문있습니다.
IdeC 선혜승입니다 말씀하신 것처럼 개별적으로 LAYOUT 가능합니.. |
선혜승 | 16.06.22 | 14 |
자료실
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 159 |
EDA Tool Vendor 의 System Requirements 안내_20251209 기준
dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 .. |
조인신 | 25.12.09 | 825 |
| 158 |
EDA Tool Vendor 의 System Requirements 안내_20250401 기준
dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 .. |
조인신 | 25.04.01 | 1209 |
| 157 |
Linux OS 설치 가이드 2025 (EDA Tool 사용을 위한)
dec.or.kr/IdeC_library/library/view/?&no=46668 (권장 툴 버전은 진행하는 .. |
관리자 | 25.03.20 | 1881 |
| 156 |
EDA Tool Vendor 의 System Requirements 안내_20241216 기준
dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 .. |
조인신 | 24.12.16 | 989 |
| 155 |
EDA Tool Vendor 의 System Requirements 안내_20240401 기준
dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 .. |
조인신 | 24.04.01 | 1489 |
| 154 |
EDA Tool Vendor 의 System Requirements 안내_20230912 기준
dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 .. |
조인신 | 23.09.12 | 973 |
| 153 |
EDA Tool Vendor 의 System Requirements 안내_20230127 기준
dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 .. |
조인신 | 23.01.27 | 2433 |
| 152 |
[CAdeNCE] INDAGO - debug Analyzer 소개
dence Indago는 시뮬레이션 디버깅 툴 입니다. (debug Analyzer)시뮬레이션 파형과 소스.. |
김연태 | 22.10.04 | 1086 |
| 151 |
EDA Tool Vendor 의 System Requirements 안내_20220901 기준
dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 .. |
조인신 | 22.08.31 | 743 |
| 150 |
EDA Tool Vendor 의 System Requirements 안내_20220214 기준
dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 .. |
조인신 | 22.02.14 | 4172 |
| 149 |
EDA Tool Vendor 의 System Requirements 안내_20210803 기준
dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 .. |
조인신 | 21.08.03 | 835 |
| 148 |
Linux OS 설치 가이드 2021 (EDA Tool 사용을 위한)
dec.or.kr 로 주시면 됩니다. 최종 수정일 : 2021년 4월 30일 .. |
관리자 | 21.04.30 | 8254 |
| 147 |
Serdes System 설계 관련 웨비나 공유
deling Serdes CTLE Using Transfer Function Data 전달함수 데이터를 이용한 Serdes CT.. |
김영지 | 21.03.10 | 1281 |
| 146 |
EDA Tool Vendor 의 System Requirements 안내_20210112 기준
dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일.. |
조인신 | 21.01.12 | 744 |
| 145 |
(Tool 활용법 공유) Cadence Manual - Virtuoso Ade L,XL (2020.06.24)
dence Virtuoso Ade L, XL (제공자 : KAIST 류승탁 교수, 김예담) .. |
석은주 | 20.06.24 | 2430 |
| 144 |
EDA Tool Vendor 의 System Requirements 안내_20200211 기준
dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일.. |
조인신 | 20.02.11 | 1044 |
| 143 |
EDA Tool Vendor 의 System Requirements 안내_20190620 기준
dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일.. |
조인신 | 19.06.19 | 623 |
| 142 |
EDA Tool Vendor 의 System Requirements 안내_20190128 기준
dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일.. |
조인신 | 19.01.28 | 408 |
| 141 |
EDA Tool Vendor 의 System Requirements 안내_20181122 기준
dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일.. |
조인신 | 18.11.22 | 3181 |
| 140 |
EDA Tool Vendor 의 System Requirements 안내_20180621 기준
dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일.. |
조인신 | 18.06.21 | 5171 |
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A Step down DC DC converter using a 0.18 um CMOS process for Mobile ..
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device and having a negative capacitance, wherein the FinFET device has an extensio.. |
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강진구 | 15.08.19 | 10 |
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“연속적인 근사 레지스터 아날로그 디지털 변환 장치,” 출원번호: 제10-2017.. |
이승훈 | 17.10.18 | 6 |
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“레인지-스케일링 기반의 복합 파이프라인 아날로그-디지털 컨버터,” 출원번.. |
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“데이터 구동 회로 및 이를 포함하는 표시 장치,” 출원번호: 제10-2017-0012.. |
이승훈 | 17.10.18 | 0 |
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제민규 | 14.09.29 | 36 |
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부분 소자 정합 기법 기반의 전류 구동 디지털 아날로그 컨버터
“부분 소자 정합 기법 기반의 전류 구동 디지털 아날로그 컨버터,” 출원번호.. |
이승훈 | 17.10.18 | 0 |
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High Bandwidth Efficiency and Low Power Consumption Walsh Code Imple..
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제민규 | 14.09.29 | 34 |
| 참여교수 성과 - 특허 |
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“이중채널 비동기 파이프라인 SAR ADC,” (10비트 200MS/s 28nm CMOS), 출원.. |
이승훈 | 17.10.18 | 1 |
| 참여교수 성과 - 특허 |
Digital-to-analog converter, driving integrated circuit, and display..
device”, [미국 출원 관리번호 P2017-0079US, 출원번호 15/439,647, 출원일자 2017.. |
이승훈 | 17.10.18 | 4 |
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“채널 간 오프셋 부정합을 최소화하는 시간 인터리빙 구조의 파이프라인 SAR ADC,&.. |
이승훈 | 17.10.18 | 1 |
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