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de한 파일의 경우 /SF28_dk/SF28_FDS/analog/pdk_analog/LN28FDS_CalibreXRC_S00-V2.7.3...

de해서 post sim진행을 할 텐데 sub-routine call하는 부분의 포트 순서와 pex진행한 블..

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de transient sim을 진행하면 Cap Bank selection control 신호가 정상 selection 되는..

dev=0 mismatch=1 mult=1 pre_layout_local=-1 C2\<2\> (VCM net051) cmim16acc_2p..

안녕하세요. IdeC 조인신입니다.     1. layout 에서는 sub 은 따로 없습..

안녕하세요. IdeC 조인신입니다.     해당 에러는 해결하기 어렵습니다. ..

안녕하세요. IdeC 조인신입니다.     OUTLINE (Sealring) 이 있는 Cell 에..

안녕하세요, IdeC 이종행입니다.   LVS진행시에 Softchk Database 부분에 대해 확..

안녕하세요,  IdeC 이종행입니다.   해당 에러는 수정이 되어야 합니다. se..

de, file not found*WARNING* The directory: '/SF28_dk/SF28_FDS/analog/pdk_analog/LN2..

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글을 작성 하기 전에 "유사한 질문이 있는지 검색"해 보시고, 공지글에 있는 "자주하는 ..

안녕하세요. 문의주신 내용 확인했고, 차단해제 처리하였습니다.불편드려 죄송합니다. ..

안녕하세요, IdeC 이종행입니다.   Active와 ptab space rule로 보이는데 삼성에..

안녕하세요. 연세대학교 정성욱 교수님 연구실 소속 오웅빈입니다. 현재 Merge 서버에서..

안녕하세요. IdeC 조인신입니다.     XX42/R3 N_28_X42/R3_pos X42/732 N_..

devices" 옵션을 켰더니 단순 "1" 로 표시되는 것이 아닌, 파라미터값으로 적용되어 에러..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dec.or.kr/IdeC_library/library/view/?&no=46668  (권장 툴 버전은 진행하는 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

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dence Indago는 시뮬레이션 디버깅 툴 입니다. (debug Analyzer)시뮬레이션 파형과 소스..

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dec.or.kr 로 주시면 됩니다.  최종 수정일 : 2021년 4월 30일   ..

deling Serdes CTLE Using Transfer Function Data 전달함수 데이터를 이용한 Serdes CT..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence Virtuoso Ade L, XL (제공자 : KAIST 류승탁 교수, 김예담)    ..

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   안녕하세요 전남대 IdeC 담당자입니다.   ONSITE 대기인원은 10명..

 안녕하세요 전남대 IdeC 담당자입니다. 'COMS를 이용한 아날로그 회로설계 및 레..

안녕하세요 IdeC 수강생 강민지라고 합니다. 이인용교수님께서 강의하시는 [CMOS를 이용..

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