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안녕하세요, 포항공대 송호진교수님 연구실 이종호 학생입니다.   참여교수신청 -..

안녕하세요. 메일로 답변드렸습니다.  감사합니다.      [송호..

   안녕하세요  IdeC 이의숙입니다.    귀팀을 포함하여 ..

안녕하세요. IdeC 조인신입니다.     lvt 소자의 경우 확인하신대로 NW 이..

답변 감사드립니다. 그러면 전원 공급은 rvt 소자와 동일하게 vdd는 NW이 있는 power me..

layout 을 어떻게 했는지 파악되지 않아 power metal 에 NW 의 유무가 무슨 의미인지 잘 ..

dentified as controlled, should be tied to GND or most negative chip supply (GND). ..

de_S00-V2.7.7.0.pdf 파일을 보면 LVT MOS 의 구조가 있습니다. 이 내용부터 확인..

design 이후 place_opt 단계에서부터 아래 사진과 같은 에러가 뜨는것을 확인할 수 있었..

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design rule check 입니다.  standard cell 은 phantom cell 이므로 lef to ndm 생..

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안녕하세요. IdeC 조인신입니다.     PEX 의 output 을 calibreview ..

안녕하세요. IdeC 조인신입니다.     cmom_6U1x_2U2x_2T8x_LB_2p 소자에 f..

deckyt@kaist.ac.kr) 삼성 측과 협의 후 회신 드리겠습니다.  다만 답변에 시간이..

de (Direction: Right) --- set_pg_strategy vdd_L -macros [get_cells $pads_L -filter..

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dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dec.or.kr/IdeC_library/library/view/?&no=46668  (권장 툴 버전은 진행하는 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

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dence Indago는 시뮬레이션 디버깅 툴 입니다. (debug Analyzer)시뮬레이션 파형과 소스..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

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dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dec.or.kr 로 주시면 됩니다.  최종 수정일 : 2021년 4월 30일   ..

deling Serdes CTLE Using Transfer Function Data 전달함수 데이터를 이용한 Serdes CT..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence Virtuoso Ade L, XL (제공자 : KAIST 류승탁 교수, 김예담)    ..

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  안녕하세요. IdeC충북대지역센터 담당자입니다.    본 강의와 관련..

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안녕하십니까. 3년전에 진행되었던 MATLAB과 Simulink로 시작하는 모델기반 설계 ..

demy.idec.or.kr:444/track/apply/list/)  8. 기타 정보: 홈페이지 참고 (https://..

dec.or.kr 로그인 => myidec => IdeC 참여내역 => CDC 신청내역 [참고 사항] ..

 안녕하세요 IdeC 전남대캠퍼스입니다   사용 가능한 PC와 라이센스 수량이..