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design manual p.18 소수 2째자리가 있으면 안됨 2) GRA2.d3 / GRA2.d3  - c..

design is not specified in the layer map file. Specify the layer-purpose pair in th..

design is not specified in the layer map file. Specify the layer-purpose pair in th..

안녕하세요,  IdeC 이종행입니다. dummy protection layer 사용 가능합니다. &nbs..

 답변 감사합니다. drc error capture 해서 첨부드립니다.     [이..

density를 맞춰야 합니다. 해당 에러는 제조 공정상 waive 불가한 항목입니다.   ..

안녕하세요,  IdeC 이종행입니다.   결론적으로, I/O metal >=3um 이상..

안녕하세요. IdeC 조인신입니다.     Sealring (Crackstop) 이 있는 상태..

dence.cshrc  virtuoso & 이후에 다음과 같이 에러가 발생하는데, 어떻게 해..

dence 라이선스를 사용하기 위해 접속한 정보가 없어 원인을 파악하기 어렵습니다. 환경..

de 또는 model guide 파일   [우희정]님의 글 =================================..

define이 맞습니다. 2. VDD가 여러 개 있으면 각각 POWER_ESD 붙여야 합니다. 3. VSS도..

안녕하세요. IdeC 조인신입니다.     라이선스 서버에 문제가 있었던 것 ..

안녕하세요 이강윤교수님 연구실 석사과정 유승완입니다. PAD 관련 DRC 질문 드립니다 ..

안녕하세요,  IdeC 이종행입니다.   ESD PAD cell 자체에 DRC error는 없습..

 ESD PAD 자체에는 Error가 없습니다만 상위 메탈을 올려 연결할 시에 DRC가 발생합..

해당 ESD cell에 VSS 연결은 그림의 Ring MET2로 연결하는게 불가한가요? 에러나는 GDS ..

 이런식으로 MET2로 연결하는 GDS로 만드어서 진행을 해도 DRC가 발생합니다. &nbs..

definition 되어야 합니다. design manual p.219 보면 POWER_ESD/GROUND_ESD 를 M5ESD l..

안녕하세요. 금번 SS28-2402회차 MPW 참여중인 경북대학교 문병인교수님 연구실 김정환..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dec.or.kr/IdeC_library/library/view/?&no=46668  (권장 툴 버전은 진행하는 ..

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dence Indago는 시뮬레이션 디버깅 툴 입니다. (debug Analyzer)시뮬레이션 파형과 소스..

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dec.or.kr 로 주시면 됩니다.  최종 수정일 : 2021년 4월 30일   ..

deling Serdes CTLE Using Transfer Function Data 전달함수 데이터를 이용한 Serdes CT..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence Virtuoso Ade L, XL (제공자 : KAIST 류승탁 교수, 김예담)    ..

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  IdeC충북대지역센터입니다.   파운드리 공정 강좌에 많은 분들의 관심으..

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dec@cbnu.ac.kr로 문의를 주시기 바랍니다.            ..

올 2월에 진행하는 [충북대] 충북대 반도체 파운드리 소재 및 공정 강의를 신청하려..

dec에서 양질의 강의를 제공해주시고 관리해주셔서 항상 감사드립니다. 이번, "반도체 ..

[충북대 IdeC] 반도체 파운드리 소재 및 공정 증원 요청드립니다