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안녕하세요. IdeC 조인신입니다.     PEX 를 No RC 로 했다면 schematic ..

 안녕하세요. No RC 추출 시 mosfet의 간단한 I-V 곡선 확인을 통해 multiplier 및 ..

첨부한 파일의 pmos 의 pararmeter 를 보면 fingers=1, simM=1, totalM=6 으로 되어 있습..

defined symbol: _ZN8oaCommon11FactoryBase11getRefCountEv 위와 같은 에러가 떠서, ca..

defined symbol: _ZN8oaCommon11FactoryBase11getRefCountEv 위와 같은 에러가 떠서, ca..

안녕하세요. IdeC 조인신입니다.     PAD ring의 origin은 0,0으로 되어 ..

정 중앙으로 이동시켜봤는데 여전히 동일 에러가 뜹니다 혹시 PAD ring을 잘못 구성하면..

에러가 발생하는 부분이 어디인지 확인이 되지 않습니다. MPW.2 는 Searling 외부에 어..

안녕하세요. IdeC 조인신입니다.  질문/답변 페이지의 글 중 "[SF28-2401] DRC W..

 DRC 중에 GRLUP.D.10.1 이라는 DRC 에러가 있습니다. Excel 파일에는 GRLUP.D..

GRLUP.D.10 이 excel 에 있습니다. 해당 에러는 waive 가능한 것으로 확인됩니다. ..

density error가 발생합니다. 아마도 ind가 M1, OI, LB로만 구성되어서 위 같은 error가..

density는 area 기준으로 report 합니다.  소자 주변에 메탈 패턴이 있다면 min de..

density error를 확인했을 때 나타나는 영역표시입니다. 표시가 ind pcell 내부에 그려져..

density error가 발생합니다.      [김준엽]님의 글 ================..

density error 가 발생합니다. M2~IB layer 가 없기 때문입니다. density 는 dummy Fil..

density가 발생하는 metal들의 더미가 쌓인다고 이해하면 될까요? 만약 위 같은 상황이 ..

density 에러는 직접 dummy layer를 삽입하여야 하고  직접 삽입한 dummy 들의 영..

dence.com/apex/ArticleAttachmentPortal?id=a1Od0000000uiBBEAY&pageName=ArticleCo..

dence.com/apex/ArticleAttachmentPortal?id=a1Od0000000uiBBEAY&pageName=ArticleCo..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dec.or.kr/IdeC_library/library/view/?&no=46668  (권장 툴 버전은 진행하는 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

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dence Indago는 시뮬레이션 디버깅 툴 입니다. (debug Analyzer)시뮬레이션 파형과 소스..

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dec.or.kr 로 주시면 됩니다.  최종 수정일 : 2021년 4월 30일   ..

deling Serdes CTLE Using Transfer Function Data 전달함수 데이터를 이용한 Serdes CT..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence Virtuoso Ade L, XL (제공자 : KAIST 류승탁 교수, 김예담)    ..

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  반도체 기업 취업전략 및 기술 특강 릴레이 세미나  반도체기술인 협..

dec.or.kr, 042-350-8538    

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deep neural network (DNN) 기술을 적용하여 놀랄 만한 다양한 성과들을 보여 주고 있으..

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반도체집적회로 10b 200MS/s 28nm CMOS Asynchronous Pipeline SAR ADC : 2015SG 10b200M..

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Automatic 128 channel de-skewing 4~9Gbps Transceiver for GDDR4 BOST (Built-Out Self..

dec.or.kr -> 로그인 -> 참여교수 클릭     3. 신청대상 : I..

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Verilog 초급 : 8월 7일~8일 Verilog 중급 : 8월 9일~10일 강의 진행합니다.   &..

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