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de area 구문을 보면 pnr 과정에서 메모리가 core area 밖에 위치했을 가능성이 있어 보..

안녕하세요. IdeC 조인신입니다.    scl 을 2024 가 아닌 scl_v2023.0..

안녕하세요. 경북대학교 장병철 교수님 연구실 석사과정생 신현우입니다. 알려주신 방..

첨부한 파일을 보니 라이선스 서버가 IdeC 의 서버로 설정되어 있습니다. 실제 연구실에..

dence 툴 사용중 응답지연이 발생하더니 지금은 사용할 수 없을정도로 지연이 심해졌습..

dence tool 실행 및 사용을 해보았으나  지연되는 현상이 심하지는 않습니다. (카..

de 옵션을 사용한다면 (M5~LB, PC, RX, CA, JQ, VV등 없는 옵션은 제외) 첨부 드린 사진..

density 에러가 발생하는 부분이 exclude layer 를 그린 내부인지 외부인지에 ..

desnity error가 내부에서 발생하여 문제 해결은 해볼 예정입니다. 하지만 쉽지는 않을 ..

de layer 를 과도하게 사용하는 것은 권하지 않으며, 실제로도 DRC 에러 때문에 진행하..

density error가 발생하였습니다.   GR641b_xx  (xx = M3, M5, M6, M7) 'xx..

density 는 되도록 해결하는 것이 좋습니다. short 가 될 수도 있습니다. waive 는 될 ..

안녕하세요. IdeC 조인신입니다.     처음부터 설치를 해야 한다는 것이 ..

안녕하세요. IdeC 조인신입니다.     에러 내용을 보면 해당 파일을 찾지 ..

 안녕하세요,황인균입니다.  답변해주셔서 감사합니다.path를 꼼꼼하게 check..

   mapping 파일을 같이 기입해 보시기 바랍니다.    read_paras..

   감사합니다~근데 layber map file에서 conducting_layers 나 via_lay..

 다음엔 그림은 제가 직접 만든 map파일입니.이거하고 read_parasitic_tech -t..

   해당 건은 DK 이슈이므로 DK 를 받은 곳에 문의 하시기 바랍니다.  ..

DK를 어디서 문의 할 수 있을까요?       [김연태]님의 글 =====..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dec.or.kr/IdeC_library/library/view/?&no=46668  (권장 툴 버전은 진행하는 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

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dence Indago는 시뮬레이션 디버깅 툴 입니다. (debug Analyzer)시뮬레이션 파형과 소스..

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dec.or.kr 로 주시면 됩니다.  최종 수정일 : 2021년 4월 30일   ..

deling Serdes CTLE Using Transfer Function Data 전달함수 데이터를 이용한 Serdes CT..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence Virtuoso Ade L, XL (제공자 : KAIST 류승탁 교수, 김예담)    ..

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METHOD FOR PROVIDING CHIP-TO-CHIP WIRELESS COMMUNICATION AND ELECTRONIC deVICE THER..

der) 트리를 사용하므로 더욱 지연시간을 줄이기 어렵다. 상술한 문제점을 해결하기 위해..

MULTI-CHIP deTECTOR APPRATUS

본 연구는 IdeC에서 EDA Tool를 지원받아 작성하였습니다.

본 연구는 IdeC에서 EDA Tool를 지원받아 수행하였습니다.

본 연구는 IdeC에서 EDA Tool를 지원받아 수행하였습니다.

본 연구는 IdeC에서 EDA Tool를 지원받아 수행하였습니다.

본 연구는 IdeC에서 EDA Tool를 지원받아 수행하였습니다.

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