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de layer를 필요한 부분에 설정하면 가능합니다. 하지만 과도한 사용은 자제 되어야 특..

de에 대해 다시 한번 문의 드리면 제가 원하는 해당 cell은 사진용이기에 전부 ground에 ..

de layer를 설정하면, dummy filling이 되지 않습니다.   결론적으로 exclude lay..

de layer를 pc/ca/rx/V5~LB로 놔두면 Metal 및 MOSFET이 전부 dummy filling이 되지 않는..

de 옵션을 통해 pc/ca/rx/V5~LB의 exclude layer를 깔았습니다. (CA, JQ, VV exclud..

design compiler를 진행 중에 있는데, 합성이 제대로 되지 않는 문제가 있어 문의 드립니..

안녕하세요 경북대 IdeC 입니다. 수강 취소했습니다. 감사합니다.     [..

   안녕하세요 IdeC 정쟁희입니다. 먼저 라이선스 사용에 불편을 드려 죄송..

안녕하세요.숙명여자대학교 석사과정 송예슬입니다.   다름이 아니라 이번에 DB18..

  안녕하세요. IdeC이종행입니다. 해당 Library는 변경사항이 없이 적용가능합니..

     안녕하세요 IdeC 정쟁희입니다. 먼저 라이선스 사용에 불편을 드..

de가 아닌 high side tr을 적용하여야 합니다. (내압에 맞게 소자는 선택필요) 감사합..

dence xmverilog(xcelium) 실행 시 1809, 1903, 2009, 2303의 모든 버전으로 source한 뒤..

dence virtuoso EDA Tool 버전(SCL/LCU/MGLS 포함) : IC618 OS 종류 및 버전 : centOS7..

dence virtuoso EDA Tool 버전(SCL/LCU/MGLS 포함) : IC618 OS 종류 및 버전 : centOS7..

안녕하세요. 서울과학기술대학교 이승은 교수님 연구실에 박정민 학생입니다.   ..

안녕하세요. IdeC 조인신입니다.     IdeC 홈페이지의 Hostname / IP Addr..

안녕하세요. 서울과학기술대학교 이승은 교수님 연구실에 박정민 학생입니다.   ..

등록한 서버의 적용에 약간의 문제가 있었던 것 같습니다. 등록한 서버에서 tool 실행이..

de layer를 사용하게 되어 DRC를 진행하면,GR543PD : M1_predicted(100) density (%) wit..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dec.or.kr/IdeC_library/library/view/?&no=46668  (권장 툴 버전은 진행하는 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

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dence Indago는 시뮬레이션 디버깅 툴 입니다. (debug Analyzer)시뮬레이션 파형과 소스..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

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dec.or.kr 로 주시면 됩니다.  최종 수정일 : 2021년 4월 30일   ..

deling Serdes CTLE Using Transfer Function Data 전달함수 데이터를 이용한 Serdes CT..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence Virtuoso Ade L, XL (제공자 : KAIST 류승탁 교수, 김예담)    ..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

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  안녕하세요. IdeC충북대 지역센터입니다.    늦은 시간까지 수강신..

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안녕하세요 경북대 IdeC 입니다. 추가 신청 계획은 아직 없습니다. 일단 신청 기간이 ..

안녕하세요 경북대 IdeC 입니다. 저희는 대기자 신청을 하고 있지 않습니다. 일단 신..

 안녕하세요 전남대IdeC 입니다   대기자로 신청하시고 현재 대기자 상태이..

안녕하세요 경북대 IdeC 입니다. 증원 예정은 없습니다. 아직 수강신청 기간 중이니 ..

[Synposys] Multi-Voltage design 구현을 위한 Synopsys low power 설계 (PnR) 과정에서 ..

  안녕하세요 전남대IdeC입니다   온라인 인원은 최대인원으로 설정하여 ..

안녕하세요 전남대IdeC입니다   온라인 인원은 최대인원으로 설정하여 신청받았..

안녕하세요 부산대IdeC입니다. 해당강좌 20명 정원 대기자 10명까지 신청할 수 있습니..

 안녕하세요 전남대 IdeC입니다   문의주신 강좌의 경우 현재 추가 증..

dence : Virtuoso, Spectre3) Siemens EDA : Calibre, Questa (구 ModelSim) 외 &nb..

IC design Education Center(IdeC)   (채용) KAIST 반도체..