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decap과 filler cell 간에 접촉이 문제인 것으로 이해가 되는데 이를 해결하기 위해 제..

dec.or.kr)      GR553q2_V1   에러는 단순하게는 V1 간격..

density across full chip ; value: 0.2 GRDV.deN.2는 density error 인 것으로 알고 있..

density across full chip ; value: 0.2 GRDV.deN.2는 density error 인 것으로 알고 있..

부산대IdeC입니다 권효원님, 수강취소 처리해 드렸습니다.     [권효..

안녕하세요 .  High-speed Serial Link and CDR designs 의 강의를 수강하였고, 퀴..

density의 경우 waive가 가능할거라고 생각하여 안테나를 설계하였습니다. 안테나의 경..

density 관련하여 waive 하여 여러차례 진행하고 있고 제작 후에도 특별한 문제가 발생..

density 에러의 경우 다른 소자에 영향을 미치지 않는 에러로 알고 있는데, waive가 불가..

density 에러의 경우 다른 소자에 영향을 미치지 않는 에러로 알고 있는데, waive가 불가..

density와 M2의 Maximum width DRC를 제외하고는 모두 수정중에 있습니다만,, 저희의 MPW..

dec.or.kr   [송유빈]님의 글 ================================================..

density over local 125 um x 125 um areas stepped in 62.500 um increments. Exclusion..

density over local 125 um x 125 um areas stepped in 62.500 um increments. Exclusion..

density over local 125 um x 125 um areas stepped in 62.500 um increments. Exclusion..

안녕하세요. IdeC이종행입니다. 첨부된 좌표의 PC width를 확인하여 보니 w>0.4um가 ..

 안녕하세요 연구원님, 답변에 감사드립니다.   top에서 해당 PC width를 0...

density across full chip ; value: 0.01 Dummy fill로는 LV layer가 채워지지 않는 것 ..

density 에러 미발생의 경우 full chip에서 더미를 사용하였습니다. 따라서 해당 DV lay..

device EDA Tool 버전(SCL/LCU/MGLS 포함) :   2023 V OS 종류 및 버전 : 최..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dec.or.kr/IdeC_library/library/view/?&no=46668  (권장 툴 버전은 진행하는 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

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dence Indago는 시뮬레이션 디버깅 툴 입니다. (debug Analyzer)시뮬레이션 파형과 소스..

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dec.or.kr 로 주시면 됩니다.  최종 수정일 : 2021년 4월 30일   ..

deling Serdes CTLE Using Transfer Function Data 전달함수 데이터를 이용한 Serdes CT..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence Virtuoso Ade L, XL (제공자 : KAIST 류승탁 교수, 김예담)    ..

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안녕하세요 경북대 IdeC 입니다.   053-950-6858번으로 연락 부탁드립니다. 감..

안녕하세요 부산대 반도체설계교육센터입니다 더 많은 수강기회를 드리고 싶지만 원활..

안녕하세요 경북대 IdeC 입니다. 아직 신청 기간이 많이 남아 홈페이지를 살펴봐 주시..

안녕하세요   Testable design of VLSI Semiconductor for Low Power Consumption..

안녕하세요 IdeC교육생 양동현입니다. 다름이 아니라 디지털회로설계 (RTL-to-GDSI..

   추가 신청하실 수 있도록 조치 하겠사오니  담당자 메일(senachung@..

  안녕하세요   경북대 IdeC 입니다.   아직 신청 기간이 많이 남아..

안녕하세요 경북대 IdeC 입니다. 아직 신청 기간이 많이 남아 홈페이지를 살펴봐 주시..

안녕하세요, 광운대 IdeC 캠퍼스입니다.  현재 실습실 및 툴 수량의 제한으로 증원..

온라인 강의 정원 초과로 인하여 증원신청 드리고 싶습니다. 감사합니다.

dec@knu.ac.kr 메일로 성함과 연락처 보내주세요. 감사합니다.     [..

안녕하세요, 광운대 IdeC 캠퍼스입니다.  실습실 및 툴 제한으로 증원은 불가합니..

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안녕하세요, 광운대 IdeC 캠퍼스입니다.  실습실 및 툴 제한으로 증원은 불가하며,..

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