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design을 하고 있는데요 route_opt 가 끝난 상태에서 다음과 같이 signal과 VDD가 만나 s..

design 부터 끝까지의  스크립트 파일들은 그냥 수정없이 두고  rm_setup 폴..

design 부터 끝까지의  스크립트 파일들은 그냥 수정없이 두고  rm_setup 폴..

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안녕하세요. IdeC 연구원 조인신입니다.     삼성28nm 공정의 grid 는 0.0..

design, I got DRC error for my design. Sir can you please tell me which are no..

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안녕하세요. 연세대학교 최우영 교수님 연구실 노대원입니다.    이번에 Ta..

  IdeC 선혜승입니다     해당 정보는 저희도 알수가 없습니다&n..

IdeC 서버가 너무 좋지 않아서 수강신청 전에 사이트가 이미 마비되고 수강신청을 진행할..

 안녕하세요, 광운대 IdeC입니다.    요청하신 대로 수강신청 취소처리..

1월 9일부터 시작되는 본센터에서하는 [IdeC 연구원 교육] Full-Custom Chip design..

dence virtuoso 6버전 이후부터는 자체적으로 layer를 편집하여 layer name을 변경할 수 ..

de 를 참고 바랍니다. 위 파일을 /virtuoso설치폴더/doc/techfileuser 폴더에 tech..

de 를 참고 바랍니다. 위 파일을 /virtuoso설치폴더/doc/techfileuser 폴더에 tech..

dence 라이선스를 사용하려면  IC617_ISR23 또는 IC618 을 사용해야 하며, IC618 ..

dence 라이선스를 사용하려면  IC617_ISR23 또는 IC618 을 사용해야 하며, IC618 ..

dence 라이선스를 사용하려면  IC617_ISR23 또는 IC618 을 사용해야 하며, IC618 ..

design, I got DRC error for my design Please help us to fix this error, I tri..

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dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dec.or.kr/IdeC_library/library/view/?&no=46668  (권장 툴 버전은 진행하는 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence Indago는 시뮬레이션 디버깅 툴 입니다. (debug Analyzer)시뮬레이션 파형과 소스..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dec.or.kr 로 주시면 됩니다.  최종 수정일 : 2021년 4월 30일   ..

deling Serdes CTLE Using Transfer Function Data 전달함수 데이터를 이용한 Serdes CT..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence Virtuoso Ade L, XL (제공자 : KAIST 류승탁 교수, 김예담)    ..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

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    안녕하세요. 한양대 IdeC입니다. 강의 수강인원 최대로 인원설정을 해..

dec.or.kr)              ▶ 희망공정 참여 취..

안녕하세요 전남대IdeC 입니다   문의주신 강좌의 경우 vod 업로드 예정이 없습..

dec.or.kr/edu/edu_request/view/?&page=13&no=30923   건의사항은 Synop..

  안녕하세요. IdeC충북대 지역센터입니다.    늦은 시간까지 수강신..

  안녕하세요. IdeC충북대 지역센터입니다.    늦은 시간까지 수강신..

  안녕하세요. IdeC충북대 지역센터입니다.    늦은 시간까지 수강신..

  안녕하세요. IdeC충북대 지역센터입니다.    늦은 시간까지 수강신..

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안녕하세요 경북대 IdeC 입니다. 추가 신청 계획은 아직 없습니다. 일단 신청 기간이 ..

안녕하세요 경북대 IdeC 입니다. 저희는 대기자 신청을 하고 있지 않습니다. 일단 신..

 안녕하세요 전남대IdeC 입니다   대기자로 신청하시고 현재 대기자 상태이..

안녕하세요 경북대 IdeC 입니다. 증원 예정은 없습니다. 아직 수강신청 기간 중이니 ..

[Synposys] Multi-Voltage design 구현을 위한 Synopsys low power 설계 (PnR) 과정에서 ..

  안녕하세요 전남대IdeC입니다   온라인 인원은 최대인원으로 설정하여 ..

안녕하세요 전남대IdeC입니다   온라인 인원은 최대인원으로 설정하여 신청받았..

안녕하세요 부산대IdeC입니다. 해당강좌 20명 정원 대기자 10명까지 신청할 수 있습니..