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design을 하고 있는데요 route_opt 가 끝난 상태에서 다음과 같이 signal과 VDD가 만나 s..

design 부터 끝까지의  스크립트 파일들은 그냥 수정없이 두고  rm_setup 폴..

design 부터 끝까지의  스크립트 파일들은 그냥 수정없이 두고  rm_setup 폴..

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안녕하세요. IdeC 연구원 조인신입니다.     삼성28nm 공정의 grid 는 0.0..

design, I got DRC error for my design. Sir can you please tell me which are no..

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안녕하세요. 연세대학교 최우영 교수님 연구실 노대원입니다.    이번에 Ta..

  IdeC 선혜승입니다     해당 정보는 저희도 알수가 없습니다&n..

IdeC 서버가 너무 좋지 않아서 수강신청 전에 사이트가 이미 마비되고 수강신청을 진행할..

 안녕하세요, 광운대 IdeC입니다.    요청하신 대로 수강신청 취소처리..

1월 9일부터 시작되는 본센터에서하는 [IdeC 연구원 교육] Full-Custom Chip design..

dence virtuoso 6버전 이후부터는 자체적으로 layer를 편집하여 layer name을 변경할 수 ..

de 를 참고 바랍니다. 위 파일을 /virtuoso설치폴더/doc/techfileuser 폴더에 tech..

de 를 참고 바랍니다. 위 파일을 /virtuoso설치폴더/doc/techfileuser 폴더에 tech..

dence 라이선스를 사용하려면  IC617_ISR23 또는 IC618 을 사용해야 하며, IC618 ..

dence 라이선스를 사용하려면  IC617_ISR23 또는 IC618 을 사용해야 하며, IC618 ..

dence 라이선스를 사용하려면  IC617_ISR23 또는 IC618 을 사용해야 하며, IC618 ..

design, I got DRC error for my design Please help us to fix this error, I tri..

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dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dec.or.kr/IdeC_library/library/view/?&no=46668  (권장 툴 버전은 진행하는 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence Indago는 시뮬레이션 디버깅 툴 입니다. (debug Analyzer)시뮬레이션 파형과 소스..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dec.or.kr 로 주시면 됩니다.  최종 수정일 : 2021년 4월 30일   ..

deling Serdes CTLE Using Transfer Function Data 전달함수 데이터를 이용한 Serdes CT..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence Virtuoso Ade L, XL (제공자 : KAIST 류승탁 교수, 김예담)    ..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

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device and having a negative capacitance, wherein the FinFET device has an extensio..

“연속적인 근사 레지스터 아날로그 디지털 변환 장치,” 출원번호: 제10-2017..

“레인지-스케일링 기반의 복합 파이프라인 아날로그-디지털 컨버터,” 출원번..

“데이터 구동 회로 및 이를 포함하는 표시 장치,” 출원번호: 제10-2017-0012..

“부분 소자 정합 기법 기반의 전류 구동 디지털 아날로그 컨버터,” 출원번호..

“이중채널 비동기 파이프라인 SAR ADC,” (10비트 200MS/s 28nm CMOS), 출원..

device”, [미국 출원 관리번호 P2017-0079US, 출원번호 15/439,647, 출원일자 2017..

“채널 간 오프셋 부정합을 최소화하는 시간 인터리빙 구조의 파이프라인 SAR ADC,&..

양방향성 주파수 검출기(FD: Frequency detector)와 주파수 대역 선택기를 이용한 기준 ..