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design, I got DRC error for my design Please help us to fix this error, I tri..

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안녕하세요. UNIST 신세운 교수님 연구실 석박통합과정 이승주라고 합니다. 어제 개최된..

IdeC 선혜승입니다     상황은 잘 이해가 되는데   원인을 ..

  IdeC 선혜승입니다     머지 계정을 준비해드릴 것이고 &..

design 후의 결과) - Half의 경우는 어떤 식으로 Verilog 코드에 IO셀에 대한 정보를 추..

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안녕하세요. IdeC 연구원 조인신입니다.     첨부한 파일 중 hspice ..

안녕하세요. IdeC 연구원 조인신입니다.     현재 상황이 CHIP이 2개 이고..

  네 조언해주신 대로 진행했더니 해결 했습니다. 감사합니다!   [조인신]..

안녕하세요. 아이보세미의 신동철입니다.   VOD서비스로 제공되고 있는  20..

   IdeC 선혜승입니다     죄송합니다만 저희 서비스는 대..

density (%) within 'GUARdeDG' or 'Cell Extent' <=85, EXEMPTIONS: Tile touching &..

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안녕하세요. IdeC 연구원 조인신입니다.     passive 소자 사용 시 PEX 추..

  안녕하세요 단국대학교 반도체 설계연구실 박사과정 권상욱입니다. IC617을 설..

안녕하세요. IdeC 연구원 조인신입니다.     cds.lib 파일의 경로를 보면 ..

  IdeC 선혜승입니다    담당자 이경옥 선생님을 통해 받으신 계정 정..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dec.or.kr/IdeC_library/library/view/?&no=46668  (권장 툴 버전은 진행하는 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

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dence Indago는 시뮬레이션 디버깅 툴 입니다. (debug Analyzer)시뮬레이션 파형과 소스..

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dec.or.kr 로 주시면 됩니다.  최종 수정일 : 2021년 4월 30일   ..

deling Serdes CTLE Using Transfer Function Data 전달함수 데이터를 이용한 Serdes CT..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence Virtuoso Ade L, XL (제공자 : KAIST 류승탁 교수, 김예담)    ..

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안녕하세요. 저희 Zoom 라이선스 제약상 300명이 최대 수강할수 있습니다. 양해를 부탁..

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der & Tag 칩 개발에 적합한 엔지니어(Digital/Analog)를 모십니다.  [ 회..

안녕하세요 임소정님. 경북대 IdeC 입니다. 수강 관련하여 내일 053-950-6858 번으로 ..

안녕하세요 경북대 IdeC 입니다.  코로나로 인하여 Onsite 강의실 들어 갈 수 있..

   안녕하세요 전남대 IdeC 담당자입니다.   ONSITE 대기인원은 10명..

 안녕하세요 전남대 IdeC 담당자입니다. 'COMS를 이용한 아날로그 회로설계 및 레..

안녕하세요 IdeC 수강생 강민지라고 합니다. 이인용교수님께서 강의하시는 [CMOS를 이용..

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