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dc analysis 후,   Ade 창 - result - annotate - dc operaiong point 을 클릭 후..

안녕하세요. IdeC 연구원 조인신입니다.     첨부한 파일을 참고하시기 바..

안녕하세요? Ade - transient simulation을 할 때 homotopy = gmin, source, dptran 단..

안녕하세요. IdeC 연구원 조인신입니다.     시뮬레이션 설정이 어떻게 되..

안녕하세요. Cell-Based Chip design Flow 강의를 보고 저희가 설계한 소스 코드에 timi..

  IdeC 선혜승입니다     사실 DRC에 관한 것들  transiti..

 갑사합니다! 혹시 check timing을 진행할 때 end points에 constraint가 적..

  IdeC 선혜승입니다     확인이 늦었습니다  무조건 CLEA..

  IdeC선혜승입니다     공교롭게도 1번에 대한 내용은 없고요&n..

이광선님 안녕하세요? IdeC 이경옥입니다.   해당 문의사항은 Synopsys사 측으로 ..

안녕하세요. IdeC 연구원 조인신입니다.     원래대로 복구해도 됩니다. ..

   안녕하십니까 인천대학교 전자공학과 송준영 교수님 연구실 안종찬 입니다..

de) 를 제공 받을 수 있는지 문의 드립니다.

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dence virtuoso EDA Tool 버전(SCL/LCU/MGLS 포함) : virtuoso 6.18 OS 종류 및 버전 :..

dence virtuoso EDA Tool 버전(SCL/LCU/MGLS 포함) : virtuoso 6.18 OS 종류 및 버전 :..

--EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) : EDA Tool 버전(SCL/LCU/MGLS 포함..

안녕하세요. IdeC 연구원 조인신입니다.     해당 문제가 발생하는 것에 ..

안녕하세요.    동부공정으로 설계를 진행중에 있습니다.   다름이 ..

안녕하세요. IdeC 연구원 조인신입니다.     글의 내용만으로는 원인을 파..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

dec.or.kr/IdeC_library/library/view/?&no=46668  (권장 툴 버전은 진행하는 ..

dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 ..

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dence Indago는 시뮬레이션 디버깅 툴 입니다. (debug Analyzer)시뮬레이션 파형과 소스..

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dec.or.kr 로 주시면 됩니다.  최종 수정일 : 2021년 4월 30일   ..

deling Serdes CTLE Using Transfer Function Data 전달함수 데이터를 이용한 Serdes CT..

dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일..

dence Virtuoso Ade L, XL (제공자 : KAIST 류승탁 교수, 김예담)    ..

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device and having a negative capacitance, wherein the FinFET device has an extensio..

“연속적인 근사 레지스터 아날로그 디지털 변환 장치,” 출원번호: 제10-2017..

“레인지-스케일링 기반의 복합 파이프라인 아날로그-디지털 컨버터,” 출원번..

“데이터 구동 회로 및 이를 포함하는 표시 장치,” 출원번호: 제10-2017-0012..

“부분 소자 정합 기법 기반의 전류 구동 디지털 아날로그 컨버터,” 출원번호..

“이중채널 비동기 파이프라인 SAR ADC,” (10비트 200MS/s 28nm CMOS), 출원..

device”, [미국 출원 관리번호 P2017-0079US, 출원번호 15/439,647, 출원일자 2017..

“채널 간 오프셋 부정합을 최소화하는 시간 인터리빙 구조의 파이프라인 SAR ADC,&..

양방향성 주파수 검출기(FD: Frequency detector)와 주파수 대역 선택기를 이용한 기준 ..