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질문/답변
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 10391 |
[답변] SRAM device 관련 DRC 및 LVS 문의
dec.or.kr [박현호]님의 글 ================================================.. |
조인신 | 21.07.05 | 56 |
| 10390 |
tool 관련하여 IdeC에서 발행한 메뉴얼 책자 구매 관련하여 문의드립니다.
design 등 여러 회로 설계 관련하여 manual같은 책자를 발행하는 것으로 알고 있습니다. .. |
박창주 | 21.07.02 | 17 |
| 10389 |
[답변] tool 관련하여 IdeC에서 발행한 메뉴얼 책자 구매 관련하여 문의드립니다.
dec.or.kr [박창주]님의 글 ================================================.. |
조인신 | 21.07.05 | 18 |
| 10388 |
[답변] SYNOPSYS license 문의
IdeC 선혜승입니다 synopsys 라이센스 데몬의 상태를 확인.. |
선혜승 | 21.07.04 | 38 |
| 10387 |
[답변] SYNOPSYS license 문의
사용하고 있는 SCL 의 버전이 확인되지 않으나 scl_v2018.06 버전을 설치하여 데몬.. |
조인신 | 21.07.06 | 44 |
| 10386 |
[답변] body tie 관련
안녕하세요. IdeC 연구원 조인신입니다. nfet_rf 의 상하좌우에 둘러쳐져 있는.. |
조인신 | 21.07.05 | 25 |
| 10385 |
[답변] body tie 관련
pfet은 vdd에 연결하면 되나요? [조인신]님의 글 ==============.. |
방현태 | 21.07.05 | 16 |
| 10384 |
[답변] body tie 관련
보통 VDD(power net) 에 연결하나 이는 설계자가 결정하는 것입니다. 기본적으로는.. |
조인신 | 21.07.05 | 43 |
| 10383 |
Hierarchical design TOP 설계시 drc violation
design 에서 Top 의 PnR 작업을 진행하고 있습니다. write_data 까지 모두 마쳤으며, sta.. |
박현철 | 21.07.02 | 39 |
| 10382 |
[답변] Hierarchical design TOP 설계시 drc violation
design 에서 Top 의 PnR 작업을 진행하고 있습니다. write_data 까지 모두 마쳤으며, sta.. |
선혜승 | 21.07.02 | 22 |
| 10381 |
[답변] Hierarchical design TOP 설계시 drc violation
design 에서 Top 의 PnR 작업을 진행하고 있습니다. write_data 까지 모두 마쳤으며, sta.. |
박현철 | 21.07.02 | 95 |
| 10380 |
cadence install error
--EDA Tool정보-- EDA Tool 명(SCL/LCU/MGLS 포함) :virtuoso EDA Tool 버전(SCL/LCU/M.. |
박성윤 | 21.07.02 | 14 |
| 10379 |
[답변] cadence install error
안녕하세요. IdeC 연구원 조인신입니다. 환경 변수가 겹친 것 같은데 서버에 .. |
조인신 | 21.07.02 | 13 |
| 10378 |
[답변] cadence install error
안녕하세요 부산대학교 집적회로 연구실입니다. 재부팅후 접속이 가능하.. |
박성윤 | 21.07.02 | 6 |
| 10377 |
[답변] cadence install error
dence supported Linux configuration.2021/07/02 17:36:30 For more info, please run C.. |
조인신 | 21.07.02 | 33 |
| 10376 |
[답변] Synopsys sentaurus TCAD 네트워크 라이센스 인증관련 문의입니다.
안녕하세요. IdeC 연구원 조인신입니다. 문제가 해결되었으니 라이선스 .. |
조인신 | 21.07.02 | 35 |
| 10375 |
[답변] virtuoso 버전업그레이드 이후 키보드 입력 오류
안녕하세요. IdeC 연구원 조인신입니다. 서버에 접속 시 사용하는 프로그.. |
조인신 | 21.07.02 | 18 |
| 10374 |
[답변] virtuoso 버전업그레이드 이후 키보드 입력 오류
안녕하세요. 금오공과대학교 아날로그집적회로설계 연구실 도원규입니다. .. |
도원규 | 21.07.02 | 6 |
| 10373 |
[답변] virtuoso 버전업그레이드 이후 키보드 입력 오류
원인을 알 수 없으나 xmanager 를 사용할 경우 IC618 에서 입력에 오류가 발.. |
조인신 | 21.07.02 | 79 |
| 10372 |
[답변] synopsys EDA Tool TCAD 오류 관련
안녕하세요. IdeC 연구원 조인신입니다. 우선 ubuntu 는 TCAD 지원 OS 에.. |
조인신 | 21.07.02 | 53 |
자료실
| 제목 | 작성자 | 작성일 | 조회 | |
|---|---|---|---|---|
| 159 |
EDA Tool Vendor 의 System Requirements 안내_20251209 기준
dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 .. |
조인신 | 25.12.09 | 824 |
| 158 |
EDA Tool Vendor 의 System Requirements 안내_20250401 기준
dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 .. |
조인신 | 25.04.01 | 1209 |
| 157 |
Linux OS 설치 가이드 2025 (EDA Tool 사용을 위한)
dec.or.kr/IdeC_library/library/view/?&no=46668 (권장 툴 버전은 진행하는 .. |
관리자 | 25.03.20 | 1880 |
| 156 |
EDA Tool Vendor 의 System Requirements 안내_20241216 기준
dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 .. |
조인신 | 24.12.16 | 989 |
| 155 |
EDA Tool Vendor 의 System Requirements 안내_20240401 기준
dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 .. |
조인신 | 24.04.01 | 1489 |
| 154 |
EDA Tool Vendor 의 System Requirements 안내_20230912 기준
dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 .. |
조인신 | 23.09.12 | 973 |
| 153 |
EDA Tool Vendor 의 System Requirements 안내_20230127 기준
dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 .. |
조인신 | 23.01.27 | 2433 |
| 152 |
[CAdeNCE] INDAGO - debug Analyzer 소개
dence Indago는 시뮬레이션 디버깅 툴 입니다. (debug Analyzer)시뮬레이션 파형과 소스.. |
김연태 | 22.10.04 | 1086 |
| 151 |
EDA Tool Vendor 의 System Requirements 안내_20220901 기준
dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 .. |
조인신 | 22.08.31 | 743 |
| 150 |
EDA Tool Vendor 의 System Requirements 안내_20220214 기준
dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 .. |
조인신 | 22.02.14 | 4172 |
| 149 |
EDA Tool Vendor 의 System Requirements 안내_20210803 기준
dence, Siemens EDA, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 .. |
조인신 | 21.08.03 | 835 |
| 148 |
Linux OS 설치 가이드 2021 (EDA Tool 사용을 위한)
dec.or.kr 로 주시면 됩니다. 최종 수정일 : 2021년 4월 30일 .. |
관리자 | 21.04.30 | 8253 |
| 147 |
Serdes System 설계 관련 웨비나 공유
deling Serdes CTLE Using Transfer Function Data 전달함수 데이터를 이용한 Serdes CT.. |
김영지 | 21.03.10 | 1281 |
| 146 |
EDA Tool Vendor 의 System Requirements 안내_20210112 기준
dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일.. |
조인신 | 21.01.12 | 744 |
| 145 |
(Tool 활용법 공유) Cadence Manual - Virtuoso Ade L,XL (2020.06.24)
dence Virtuoso Ade L, XL (제공자 : KAIST 류승탁 교수, 김예담) .. |
석은주 | 20.06.24 | 2430 |
| 144 |
EDA Tool Vendor 의 System Requirements 안내_20200211 기준
dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일.. |
조인신 | 20.02.11 | 1044 |
| 143 |
EDA Tool Vendor 의 System Requirements 안내_20190620 기준
dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일.. |
조인신 | 19.06.19 | 623 |
| 142 |
EDA Tool Vendor 의 System Requirements 안내_20190128 기준
dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일.. |
조인신 | 19.01.28 | 408 |
| 141 |
EDA Tool Vendor 의 System Requirements 안내_20181122 기준
dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일.. |
조인신 | 18.11.22 | 3181 |
| 140 |
EDA Tool Vendor 의 System Requirements 안내_20180621 기준
dence, Mentor, Synopsys 의 System Requirements 에 대해 안내합니다. 업로드 한 파일.. |
조인신 | 18.06.21 | 5171 |
기타 게시판
| 구분 | 제목 | 작성자 | 작성일 | 조회 |
|---|---|---|---|---|
| 참여교수 성과 - 논문 |
Cross-Corner delay Variation Model for Standard Cell Libraries
|
정의영 | 21.12.27 | 17 |
| 공지사항 |
[IdeC] EDA Tool 라이선스 서버 이전에 따른 설정 변경 요청 및 중단 안..
dence사, Siemens EDA사 EDA Tool 및 Network 라이선스 사용시 환경설정을 변경하여 사용.. |
이경옥 | 21.12.21 | 11384 |
| 공지사항 |
[IdeC]2022년 IdeC 참여교수 모집 안내
dec.or.kr) 미가입자일 경우, 가입 후 연구회원 신청(조교수부터 신청 가능) * 연.. |
김하연 | 21.12.16 | 12949 |
| 참여교수 성과 - 논문 |
Dual-mode Supply Modulator IC with an Adaptive Quiescent Current Con..
|
양영구 | 21.12.15 | 16 |
| 개설 희망 강좌 신청 |
[답변] 증원이 이루어게 된다면 임의의 시간에 증원이 되는 걸까요?
dence Tool 사용법)> <반도체 종합공정> 위 강의들 중 될 수 있으면 .. |
김영지 | 21.12.15 | 2971 |
| 개설 희망 강좌 신청 |
증원이 이루어게 된다면 임의의 시간에 증원이 되는 걸까요?
dence Tool 사용법)> <반도체 종합공정> 위 강의들 중 될 수 있으면 .. |
안혜성 | 21.12.15 | 2782 |
| 개설 희망 강좌 신청 |
집적회로 설계 실무(Cadence Tool 사용법)
안녕하세요 제가 대기번호 3번으로 해당 강의를 신청하였는데 혹시 증원 계획은 더 없는 .. |
임세하 | 21.12.15 | 2572 |
| 공지사항 |
[MPW]HM-2105회 희망공정 지원팀 모집 안내(~12..22(수))
dec.or.kr) ▶ 희망공정 참여 취.. |
이의숙 | 21.12.14 | 10726 |
| 개설 희망 강좌 신청 |
[답변] Intel FPGA를 이용한 Verilog
안녕하세요. IdeC 김영지입니다. 예측하지 못한 서버 오류로 인해 수강신청에 .. |
김영지 | 21.12.14 | 3411 |
| 개설 희망 강좌 신청 |
[답변] Intel FPGA를 이용한 Verilog
안녕하세요. IdeC 김영지입니다. 예측하지 못한 서버 오류로 인해 수강신청에 .. |
김영지 | 21.12.14 | 3443 |
| 개설 희망 강좌 신청 |
[ 캠퍼스][답변] 차세대 메모리 및 뉴로모픽 반도체 기술 증원부탁드립니..
안녕하세요 경북대 IdeC 입니다. 현장 강의이다 보니 코로나로 인하여 증원은 어.. |
김지영 | 21.12.13 | 2863 |
| 참여교수 성과 - 논문 |
A 0.0084-mV-FOM, Fast-Transient and Low-Power External-Clock-Less Di..
|
최재혁 | 21.12.10 | 46 |
| 참여교수 성과 - 논문 |
An Ultra-Low Jitter, Low-Power, 102-GHz PLL Using a Power-Gating Inj..
|
최재혁 | 21.12.10 | 44 |
| 참여교수 성과 - 논문 |
A Uniformly Segmented SC-Flip decoder for Polar Codes with Memory Re..
|
선우명훈 | 21.11.23 | 12 |
| 개설 희망 강좌 신청 |
반도체 개발 관련 툴인 DC analyzer,LCD meter에 대한 강좌부탁드립니다
반도체 개발 관련 툴인 DC analyzer,LCD meter에 대한 online 강좌부탁드립니다 |
정보경 | 21.11.22 | 2684 |
| 공지사항 |
[홍보-채용] Synopsys사 A&MS Circuit design Engineer 채용 안내
dentify and refine circuit implementations to achieve optimal power, area and perfo.. |
이경옥 | 21.11.19 | 10220 |
| 공지사항 |
[홍보]IWFST 2021 개최 안내(2021.11.18(목)~19(금), COEX 317호)
IC design Education Center(IdeC) [홍보] IWFST 2021 .. |
이의숙 | 21.11.15 | 6855 |
| 공지사항 |
[휴무 안내]원내 행사로 인한 휴무 안내(11.12(월))
안녕하세요 11월 12일(금)은 원내 자체 행사로 인해 휴무일입니다. 문의가 있으.. |
이의숙 | 21.11.11 | 8577 |
| 참여교수 성과 - 논문 |
A Low-Gate-Count deeply Embedded 16-Bit EISC CPU
|
박성정 | 21.11.11 | 19 |
| 참여교수 성과 - 논문 |
High-Speed CMOS Frequency Dividers with Symmetric In-Phase and Quadr..
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박성정 | 21.11.11 | 10 |